concurrent assignment to a non-net 'res' is not permitted [D:/VivadoExp/project_1/project_1.srcs/sim_1/new/testbench.v:5

这个错误通常是由于尝试在 Verilog 中同时为一个非线网（non-net）变量进行多个赋值操作引起的。在 Verilog 中，非线网变量包括 reg 类型的变量和 integer、real、time 等类型的变量。

解决方法是确保你为非线网变量只进行单一的赋值操作，或者将其改为线网（net）变量。可以通过将变量类型改为 wire 来将其转换为线网变量：

wire res;

如果你需要在仿真过程中模拟非线网变量的多个赋值操作，可以使用 initial 或 always 块来实现。这些块可以在仿真开始时或者在特定条件下触发，执行一系列的赋值操作。例如：

reg res;
initial begin
  res = 0;
  #10 res = 1;
  #10 res = 2;
  #10 res = 3;
end

这段代码将在仿真开始时将 res 初始化为 0，然后在 10 个时间单位后依次将其赋值为 1、2、3。

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[VRFC 10-3236] concurrent assignment to a non-net 'led_out' is not permitted ["F:/vivado/project/project_4/project_4.srcs/sim_1/new/pwm_tb.v":33]

这个错误是由于在Verilog代码中对非网类型的变量 '_out' 进行了并发赋值致的。在您的代码中，您在 'pwm_tb.v' 文件的第33行对 'led_out' 进行了并发赋值操作。然而，并发赋值只能用于网类型（如 wire 或 reg），而不能用于非网类型（如 integer 或 real）。

要解决这个错误，您需要确保将并发赋值操作应用于网类型变量。如果 'led_out' 是一个非网类型的变量，并且您想要对它进行赋值操作，您可以考虑使用阻塞赋值或非阻塞赋值来实现。

例如，如果 'led_out' 是一个 reg 类型的变量，您可以使用阻塞赋值来对它进行赋值操作：

always @ (*) begin
  led_out = some_value;
end

或者，如果 'led_out' 是一个 reg 类型的变量，您可以使用非阻塞赋值来对它进行赋值操作：

always @ (*) begin
  led_out <= some_value;
end

请注意，使用阻塞赋值或非阻塞赋值取决于您的设计需求和时序要求。确保根据实际情况选择合适的赋值方式。

[Synth 8-1852] concurrent assignment to a non-net dout10 is not permitted [C:/Users/17971/clock.srcs/sources_1/new/clock.v:59]

这个错误通常表示您在代码中出现了非法的并行赋值。在Verilog HDL语言中，每个并行块只能对一个寄存器或线网进行赋值。如果您尝试对非线网（例如、reg变量）进行并行赋值，将会提示该错误。

在您的代码中，错误提示指出在第59行对非线网变量dout10进行了并行赋值。这可能是因为您在同一个始终块中使用了多个assign语句，对dout10进行了多次赋值。或者您在始终块中使用了多个always语句，每个语句都试图对同一个非线网变量进行赋值。

要解决这个错误，您需要检查代码中的始终块，确保每个始终块只对一个寄存器或线网进行赋值。如果您需要对同一个变量进行多次赋值，则需要使用顺序块或者条件块。如果您使用了多个始终块，则需要确保它们之间没有重叠的赋值语句。