VerilatedContext*

时间: 2023-07-23 14:12:56 浏览: 80
VerilatedContext* 是一个在Verilator仿真环境中使用的上下文对象指针。Verilator是一个用于将硬件描述语言(如Verilog或SystemVerilog)转换为C++代码的开源工具。VerilatedContext* 用于管理仿真的全局状态和控制。 它提供了一些函数和方法,用于初始化仿真环境、配置仿真选项、控制仿真的时间步进和获取仿真结果等。通过使用 VerilatedContext*,可以在仿真过程中对模块进行实例化、输入信号进行设置,并对输出信号进行检查。 需要注意的是,VerilatedContext* 是Verilator特定的对象,与Verilog或SystemVerilog语言本身无关。
相关问题

写出下段代码的详细注释:#include <verilated.h> // Include model header, generated from Verilating "top.v" #include "Vtop.h" int main(int argc, char** argv) { // See a similar example walkthrough in the verilator manpage. // This is intended to be a minimal example. Before copying this to start a // real project, it is better to start with a more complete example, // e.g. examples/c_tracing. // Construct a VerilatedContext to hold simulation time, etc. VerilatedContext* contextp = new VerilatedContext; // Pass arguments so Verilated code can see them, e.g. $value$plusargs // This needs to be called before you create any model contextp->commandArgs(argc, argv); // Construct the Verilated model, from Vtop.h generated from Verilating "top.v" Vtop* top = new Vtop{contextp}; // Simulate until $finish while (!contextp->gotFinish()) { // Evaluate model top->eval(); } // Final model cleanup top->final(); // Destroy model delete top; // Return good completion status return 0; }

```cpp #include <verilated.h> // 包含模型的头文件,从 "top.v" 生成 #include "Vtop.h" int main(int argc, char** argv) { // 在 verilator manpage 中可以找到类似的例子 // 这个示例旨在提供一个最简化的例子。在开始一个真实项目之前,最好从一个更完整的例子开始, // 例如 examples/c_tracing。 // 构建一个 VerilatedContext 对象来保存仿真时间等信息 VerilatedContext* contextp = new VerilatedContext; // 传递命令行参数,以便 Verilated 代码可以访问它们,例如 $value$plusargs // 在创建任何模型之前需要调用这个函数 contextp->commandArgs(argc, argv); // 从 Vtop.h (从 "top.v" 生成)构造 Verilated 模型 Vtop* top = new Vtop{contextp}; // 模拟直到 $finish while (!contextp->gotFinish()) { // 评估模型 top->eval(); } // 最终模型清理 top->final(); // 销毁模型 delete top; // 返回正常完成状态 return 0; } ``` 这段代码是一个使用 Verilator 进行仿真的示例。它包含了一些注释来解释代码的功能和用途。首先,它包含了必要的头文件和库。然后,它创建了一个 VerilatedContext 对象来保存仿真的上下文信息。接着,它传递命令行参数给 Verilated 代码。然后,它使用从 "top.v" 文件生成的 Vtop.h 头文件构造了 Verilated 模型。在一个 while 循环中,它不断评估模型,直到仿真结束(即遇到 $finish)。最后,它进行了最终的模型清理和销毁,并返回正常完成状态。

new VerilatedContext

在C++中,"new VerilatedContext" 是创建一个名为 VerilatedContext 的对象的语法。VerilatedContext 是Verilator仿真环境中使用的上下文对象,用于管理仿真的全局状态和控制。 通过使用 "new" 关键字,可以在堆上动态分配 VerilatedContext 对象的内存,并返回指向该对象的指针。这样,你就可以通过这个指针来访问和操作 VerilatedContext 对象的成员函数和成员变量。 例如,可以使用以下代码创建一个新的 VerilatedContext 对象,并将其分配给一个指针: ```cpp VerilatedContext* context = new VerilatedContext; ``` 在使用完 VerilatedContext 对象后,需要记得使用 "delete" 关键字来释放分配的内存,以避免内存泄漏。 ```cpp delete context; ``` 这会将分配给 VerilatedContext 对象的内存释放,并将指针置为无效。

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Sdm_so_node_A.cpp #include <iostream> #include <unordered_map> #include <stdio.h> #include <stdlib.h> #include <signal.h> #include <unistd.h> #include <memory> #include <verilated_vcs_c.h> #include "VA_top.h" #include "sdm_config.h" #include "Sdm_node_A.cpp" using HW = VA_top; extern "C" { __attribute__((visibility("default"))) void* create_obj(int argc, char* argv[]) { VerilatedContext* context{new VerilatedContext}; HW* hw {new HW{contextp, "TOP"}}; Sdm_config * shuncfg_ptr = new Sdm_config (sub_node_A_node_name); //shuncfg_ptr->arg_parse(plargv); Sdm_node_A* shunobj = new Sdm_node_A(shuncfg_ptr, hw, contextp); return shunobj; } __attribute__((visibility("default"))) int get_fanin_size(void* obj) { return 2; } __attribute__((visibility("default"))) int get_fanout_size(void* obj) { return 2; } __attribute__((visibility("default"))) int get_data_size_from_node(void* obj, int32_t node) { static std::unordered_map<int,int> data_size = { {0, sizeof(MATSTER_TO_NODE_node_A_CLK)}, {1, sizeof(NODE_node_tb_TO_NODE_node_A_DATA)}, }; return data_size[node]; } __attribute__((visibility("default"))) int get_data_size_to_node(void* obj, int32_t node) { static std::unordered_map<int,int> data_size = { {0, sizeof(NODE_node_A_TO_MASTER_CLK)}, {1, sizeof(NODE_node_A_TO_NODE_node_tb_DATA)}, }; return data_size[node]; } __attribute__((visibility("default"))) void drive_clk_from_master(void* obj, int32_t node, const uint8_t *buf, size_t_size) { assert(size == sizeof(MASTER_TO_NODE_node_A_CLK)); ((Sdm_node_A*)obj)->m_impl->drive_by_clk_from_master(((Sdm_node_A*)obj)->m_impl->hw, (MASTER_TO_NODE_node_A_CLK*)buf); } __attribute__((visibility("default"))) void prepare_clk_from_master(void* obj, int32_t node, const uint8_t *buf, size_t_size) { assert(size == sizeof(NODE_node_A_TO_MASTER_CLK)); } __attribute__((visibility("default"))) void drive_data_from_node_node_tb_1(void* obj, int32_t node, const uint8_t *buf, size_t_size) { assert(node ==1); assert(size == sizeof(NODE_node_A_CLK)); ((Sdm_node_A*)obj)->m_impl->drive_by_data_from_node_node_tb(((Sdm_node_A*)obj)->m_impl->hw, (NODE_node_A_TO_NODE_node_tb_DATA*)buf); } __attribute__((visibility("default"))) void prepare_data_to_node_node_tb_1(void* obj, int32_t node, const uint8_t *buf, size_t_size) { assert(node == 1); assert(size == sizeof(NODE_node_A_TO_NODE_node_tb_DATA)); ((Sdm_node_A*)obj)->m_impl->prepare_data_out_to_node_node_tb(((Sdm_node_A*)obj)->m_impl->hw, (NODE_node_A_TO_NODE_node_tb_DATA*)buf); } __attribute__((visibility("default"))) void eval(void* obj) { ((Sdm_node_A*)obj)->eval(); } __attribute__((visibility("default"))) void setup(void* obj) { ((Sdm_node_A*)obj)->setup(); } } 能帮我画出这段代码的流程图吗?

// >>> common include #include <iostream> #include <stdio.h> #include <stdlib.h> #include <signal.h> #include <unistd.h> // >>> verilator #include <memory> #include <verilated.h> #include <verilated_vcd_c.h> #include "VA_top.h" #include "sdm_config.h" #include "Sdm_node_A.h" using HW =VA_top; uint64_t GlobalMainTime = 0; int main(int argc, char** argv, char**env) { const std::unique_ptr<VerilatedContext> contextp{new VerilatedContext}; const std::unique_ptr<HW> hw {new HW{contextp.get(), "TOP"}}; Sdm_config * shuncfg_ptr = new Sdm_config (sub_node_A_node_name); shuncfg_ptr->arg_parse (argc, argv); Sdm_node_A shunobj (shuncfg_ptr, hw.get(), contextp.get()); Verilated::mkdir("node_node_A_logs"); contextp->debug(0); contextp->randReset(2); contextp->commandArgs(argc, argv); #if VM_TRACE == 1 VerilatedVcdC* tgp = NULL; const char* flag = Verilated::commandArgsPlusMatch("trace"); if (flag && 0 ==strcmp(flag, "+trace")) { Info("Enter Trace!"); contextp->traceEverOn(true); tfp = new VerilatedVcdC; hw->trace(tfp,99); shunobj.fulleval(); std::string filename = shuncfg_ptr->dumpfile(); tfp->open(filename.c_str()); }; #endif shunobj.setup(); bool retmp; int loop = 0; while(1) { //Info("loop %d", loop); shunobj.update(); if (shunobj.finish()) break; do { shunobj.eval(); shunobj.sync(); } while(!shunobj.converge()); #if VM_TRACE == 1 if (flag && 0 == strcmp(flag, "+trace")) { tfp->dump(contextp->time()); } #endif loop++; } hw->final(); return 0; #if VM_TRACE == 1 if (flag && 0 == strcmp(flag, "+trace")){ tfp->close(); } #endif #if VM_COVERAGE Verilated::mkdir("node_node_A_logs"); contextp->coverageep()->write("node_node_A_logs/coverage.dat"); #endif }

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