画出电路图用八选一数据选择器74LS151和门电路设计一个电 要求输入为4位二进制数，当输入数据能被2或5整际时输出1，否则为0。

电路图如下：


其中，A0~A3为输入端，Q为输出端。

门电路部分的设计：

当输入数据能被2整除时，说明最后一位二进制数为0，可以通过与门实现。即当A0为0时，Y1输出为1，否则为0。同时，对于不能被2整除的情况，需要将输出置为0，可以通过与非门实现。即当A0为1时，Y2输出为0，否则为1。

当输入数据能被5整除时，说明最后一位二进制数为0或5，可以通过与门实现。即当A0、A1同时为0时，Y3输出为1，否则为0。同时，对于不能被5整除的情况，需要将输出置为0，可以通过与非门实现。即当A0、A1有一位为1时，Y4输出为0，否则为1。

数据选择器部分的设计：

将以上四个门电路的输出分别连接到74LS151的8个数据输入端，将A0~A3分别连接到74LS151的4个地址输入端，将74LS151的输出端Q连接到输出端Q即可。在74LS151中，选择输入端的控制信号为A0~A3，选择所要输出的数据信号为门电路部分的输出信号。根据选择输入信号的不同，输出信号为能被2或5整除的情况下的1或0。

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试用74LS161和必要的门电路组成六十进制的计数器，画出电路图

好的，我可以为您画出这个电路的基本原理图，如下所示：


注：此电路图仅为基本原理图，具体电路实现还需要考虑各种细节和实际情况。

在上图中，74LS161是一个4位二进制同步计数器，它的CLK输入接时钟信号，其Q0~Q3输出接到一个4输入的与门中，使能信号EN输出。使能信号EN和时钟信号CLK60输入到一个与门中，得到60进制计数的时钟信号CLK60。

74LS161的Q0~Q1输出接入一个2位BCD码转换器中，将二进制数转换为BCD码。然后，将BCD码输出接入一个2位60进制编码器中，将BCD码转换为60进制数。

由于74LS161的计数范围是0~15，因此需要在电路中加入逻辑门来实现60进制的计数。在本电路中，我们使用了两个4位加法器，一个2位除法器和一个2位余数选择器。

首先，将BCD码转换为10进制数。可以将BCD码的高位和低位分别乘以10和1，然后相加，得到一个10进制数。然后，将10进制数除以60，得到商和余数。余数就是目标60进制数的个位，将其记录下来。然后将商再次除以60，得到商和余数。余数就是目标60进制数的十位，将其记录下来。

最后，将两个余数组合起来，得到目标60进制数。这个过程需要使用两个4位加法器、一个2位除法器和一个2位余数选择器。其中，两个4位加法器用于实现BCD码转10进制数的加法运算，一个2位除法器用于实现10进制数的除法运算，一个2位余数选择器用于从除法器的输出中选择余数。

需要注意的是，电路的具体实现还需要考虑各种细节和实际情况，如时钟信号的频率、加法器和除法器的类型、输入输出信号的电平等等。因此，在实际设计中，需要根据具体情况进行调整和修改。

用双四选一数据选择器74LS153来实现三人表决电路

首先，74LS153是一个双4选1多路复用器，不是一个三人表决电路的实现方案。但是，我们可以借助多路复用器来实现一个三人表决电路。

下面是一个基本的三人表决电路的实现：


这个电路由三个输入开关和一个输出灯组成。当三个输入开关中有两个或三个开关打开时，输出灯亮；否则输出灯灭。

现在我们需要将这个电路转换为使用74LS153的电路。首先，我们需要将三个输入开关的信号转换为两个二进制数，以便它们可以被多路复用器读取。这可以通过一个编码器（比如74LS147）来实现，将开关的状态转换为二进制数。

接下来，我们需要将两个二进制数连接到多路复用器的输入端，将多路复用器的输出连接到一个反相器（比如74LS04），然后将反相器的输出连接到输出灯。多路复用器的控制端需要连接到一个逻辑门电路，以便在两个或三个输入开关打开时选择正确的输入。

下面是一个使用74LS153实现三人表决电路的电路图：


在这个电路中，74LS147将三个输入开关的状态编码为两个二进制数。74LS153将这两个二进制数选择为输入，并将结果发送到反相器，然后将反相器的输出连接到输出灯。控制逻辑门电路使用AND门和NOT门来选择正确的输入。

需要注意的是，这个电路中使用的是74LS系列的数字逻辑芯片，这些芯片需要特殊的时序和电源电压来正常工作。如果您想要实现这个电路，请务必详细阅读芯片的数据手册，并按照手册提供的规格来设计电路。