`IW_PRIV_TYPE_INT` 和 `IW_PRIV_SIZE_FIXED` 分别代表什么？

时间: 2024-07-23 20:01:03 浏览: 54
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mad_priv.rar_MAD

`IW_PRIV_TYPE_INT` 是一种特定的网络接口私有（Private）信息类型，它表示一个整数值[^1]。这种类型的数据通常用于存储配置参数，比如可能是一个设置好的频道编号。 `IW_PRIV_SIZE_FIXED` 则表示该私有信息的大小是固定的。这意味着在定义时已经确定了这个私有字段占用的字节数，这在需要预先分配空间或对数据长度有严格限制的情况下很有用。
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重写下面代码;timer_handle_t itcs_timer_init(timer_handle_t handle, timer_event_cb_t cb_event) { timer_priv_t *timer_priv = handle; if (timer_priv->idx < 0 || timer_priv->idx >= CONFIG_TIMER_NUM) { return NULL; } set_clock_type("cpu-pclk"); // printf("enter timer init fun in driver\n"); uint32_t tempreg = 0; switch (timer_priv->idx) { case 0: timer_priv->base = ITCS_TIMER0_BASE; break; case 1: timer_priv->base = ITCS_TIMER1_BASE; break; default: break; } // printf("unit %d ,timeridx %d, base addr // %08x\n",timer_priv->idx,timer_priv->timeridx,timer_priv->base); switch (timer_priv->timeridx) { case 1: tempreg = readl(timer_priv->base + TIMER_CCR_CONTROL_C1); tempreg |= CCR_RST_ENABLE; writel(tempreg, timer_priv->base + TIMER_CCR_CONTROL_C1); tempreg = readl(timer_priv->base + TIMER_IER_C1); tempreg &= ~(IER_EVNT_ENABLE | IER_ITRV_ENABLE | IER_M1_ENABLE | IER_M2_ENABLE | IER_M3_ENABLE); writel(tempreg, timer_priv->base + TIMER_IER_C1); if (timer_priv->idx == 0) { timer_priv->irq = TTC0_TIMER1_IRQn; request_irq(TTC0_TIMER1_IRQn, itcs_timer_irq, "itcs_timer_irq01", timer_priv); } else { timer_priv->irq = TTC1_TIMER1_IRQn; request_irq(TTC1_TIMER1_IRQn, itcs_timer_irq, "itcs_timer_irq11", timer_priv); } break; case 2: tempreg = readl(timer_priv->base + TIMER_CCR_CONTROL_C2); tempreg |= CCR_RST_ENABLE; writel(tempreg, timer_priv->base + TIMER_CCR_CONTROL_C2); tempreg = readl(timer_priv->base + TIMER_IER_C2); tempreg &= ~(IER_EVNT_ENABLE | IER_ITRV_ENABLE | IER_M1_ENABLE | IER_M2_ENABLE | IER_M3_ENABLE); writel(tempreg, timer_priv->base + TIMER_IER_C2); if (timer_priv->idx == 0) { timer_priv->irq = TTC0_TIMER2_IRQn; request_irq(TTC0_TIMER2_IRQn, itcs_timer_irq, "itcs_timer_irq02", timer_priv); } else { timer_priv->irq = TTC1_TIMER2_IRQn; request_irq(TTC1_TIMER2_IRQn, itcs_timer_irq, "itcs_timer_irq12", timer_priv); } break; case 3: tempreg = readl(timer_priv->base + TIMER_CCR_CONTROL_C3); tempreg |= CCR_RST_ENABLE; writel(tempreg, timer_priv->base + TIMER_CCR_CONTROL_C3); tempreg = readl(timer_priv->base + TIMER_IER_C3); tempreg &= ~(IER_EVNT_ENABLE | IER_ITRV_ENABLE | IER_M1_ENABLE | IER_M2_ENABLE | IER_M3_ENABLE); writel(tempreg, timer_priv->base + TIMER_IER_C3); if (timer_priv->idx == 0) { timer_priv->irq = TTC0_TIMER3_IRQn; request_irq(TTC0_TIMER3_IRQn, itcs_timer_irq, "itcs_timer_irq03", timer_priv); // printf("unit timer1 ret=%08x , request irq3 success!\n",ret); } else { timer_priv->irq = TTC1_TIMER3_IRQn; request_irq(TTC1_TIMER3_IRQn, itcs_timer_irq, "itcs_timer_irq13", timer_priv); // printf("unit timer1 ret=%08x , request irq3 success!\n",ret); } break; default: return NULL; } timer_priv->cb_event = cb_event; // printf("init status irq id num:%d\n",timer_priv->irq); // printf("INIT TIMER %d Timer Count No %d SUCCESS\n", timer_priv->idx, // timer_priv->timeridx); return (timer_handle_t)timer_priv; }

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优化下面代码：switch (timer_priv->timeridx) { case 1: tempreg = readl(timer_priv->base + TIMER_CCR_CONTROL_C1); tempreg |= CCR_RST_ENABLE; writel(tempreg, timer_priv->base + TIMER_CCR_CONTROL_C1); tempreg = readl(timer_priv->base + TIMER_IER_C1); tempreg &= ~(IER_EVNT_ENABLE | IER_ITRV_ENABLE | IER_M1_ENABLE | IER_M2_ENABLE | IER_M3_ENABLE); writel(tempreg, timer_priv->base + TIMER_IER_C1); if (timer_priv->idx == 0) { timer_priv->irq = C_TTC0_TIMER0_IRQn; request_irq(C_TTC0_TIMER0_IRQn, itcs_timer_irq, "itcs_timer_irq01", timer_priv); } else { timer_priv->irq = C_TTC1_TIMER0_IRQn; request_irq(C_TTC1_TIMER0_IRQn, itcs_timer_irq, "itcs_timer_irq11", timer_priv); } break; case 2: tempreg = readl(timer_priv->base + TIMER_CCR_CONTROL_C2); tempreg |= CCR_RST_ENABLE; writel(tempreg, timer_priv->base + TIMER_CCR_CONTROL_C2); tempreg = readl(timer_priv->base + TIMER_IER_C2); tempreg &= ~(IER_EVNT_ENABLE | IER_ITRV_ENABLE | IER_M1_ENABLE | IER_M2_ENABLE | IER_M3_ENABLE); writel(tempreg, timer_priv->base + TIMER_IER_C2); if (timer_priv->idx == 0) { timer_priv->irq = C_TTC0_TIMER1_IRQn; request_irq(C_TTC0_TIMER1_IRQn, itcs_timer_irq, "itcs_timer_irq02", timer_priv); } else { timer_priv->irq = C_TTC1_TIMER1_IRQn; request_irq(C_TTC1_TIMER1_IRQn, itcs_timer_irq, "itcs_timer_irq12", timer_priv); } break;

试着把代码改写成：tempreg = readl(timer_priv->base + TIMER_CCR_CONTROL_C1); tempreg |= CCR_RST_ENABLE; writel(tempreg, timer_priv->base + TIMER_CCR_CONTROL_C1); tempreg = readl(timer_priv->base + ...

重写下方代码：int set_freq_div(timer_handle_t handle, uint32_t divnum) { uint32_t reg; timer_priv_t *timer_priv = handle; switch (timer_priv->timeridx) { case 1: reg = readl(timer_priv->base + TIMER_CCR_CONTROL_C1); reg = (reg & 0xffffffe1) | (divnum << 1); writel(reg, timer_priv->base + TIMER_CCR_CONTROL_C1); break; case 2: reg = readl(timer_priv->base + TIMER_CCR_CONTROL_C2); reg = (reg & 0xffffffe1) | (divnum << 1); writel(reg, timer_priv->base + TIMER_CCR_CONTROL_C2); break; case 3: reg = readl(timer_priv->base + TIMER_CCR_CONTROL_C3); reg = (reg & 0xffffffe1) | (divnum << 1); writel(reg, timer_priv->base + TIMER_CCR_CONTROL_C3); break; default: return -1; } // printf("SET DIV FREQ SUCCESS!\n"); return 0; }

timer_priv_t *timer_priv = (timer_priv_t *) handle; uint32_t reg = readl(timer_priv->base + TIMER_CCR_CONTROL_C1); if (timer_priv->timeridx == 1) { reg = (reg & ~(TIMER_CCR_CONTROL_C1_DIV_MASK))...

重写下面代码：int set_freq_div(timer_handle_t handle, uint32_t divnum) { uint32_t reg; timer_priv_t *timer_priv = handle; switch (timer_priv->timeridx) { case 1: reg = readl(timer_priv->base + TIMER_CCR_CONTROL_C1); reg = (reg & 0xffffffe1) | (divnum << 1); writel(reg, timer_priv->base + TIMER_CCR_CONTROL_C1); break; case 2: reg = readl(timer_priv->base + TIMER_CCR_CONTROL_C2); reg = (reg & 0xffffffe1) | (divnum << 1); writel(reg, timer_priv->base + TIMER_CCR_CONTROL_C2); break; case 3: reg = readl(timer_priv->base + TIMER_CCR_CONTROL_C3); reg = (reg & 0xffffffe1) | (divnum << 1); writel(reg, timer_priv->base + TIMER_CCR_CONTROL_C3); break; default: return -1; } // printf("SET DIV FREQ SUCCESS!\n"); return 0; }

writel(reg, timer_priv->base + TIMER_CCR_CONTROL_C1); break; case 2: reg = readl(timer_priv->base + TIMER_CCR_CONTROL_C2); reg = (reg & 0xfffff800) 0x000007ff; reg |= divnum; writel(reg, timer_priv->...
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int itcs_timer_irq(int idx, void *arg) { timer_priv_t *timer_priv = (timer_priv_t *)arg; uint32_t tempregisr = 0; switch (timer_priv->timeridx) { case 1: tempregisr = readl(timer_priv->base + TIMER_ISR_C1); // printf("BEFORE READ COUNT1 ISR STAT RET :%08x\n",tempregisr); if (GET_BIT(tempregisr, 4) == 1) { // printf("OVERFLOW INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_OVERFLOW_INTERRUPT; } if (GET_BIT(tempregisr, 0) == 1) { g_endtime = get_timer(0); // printf("INTERVAL INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_INTERVAL_INTERRUPT; } if (GET_BIT(tempregisr, 1) == 1) { g_endtimematch1 = get_timer(0); // printf("MATCH1 INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_MATCH1_INTERRUPT; } if (GET_BIT(tempregisr, 2) == 1) { g_endtimematch2 = get_timer(0); // printf("MATCH2 INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_MATCH2_INTERRUPT; } if (GET_BIT(tempregisr, 3) == 1) { g_endtimematch3 = get_timer(0); // printf("MATCH3 INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_MATCH3_INTERRUPT; } tempregisr = readl(timer_priv->base + TIMER_ISR_C1); // printf("AFTER READ COUNT1 ISR STAT RET :%08x\n",tempregisr); break; case 2: tempregisr = readl(timer_priv->base + TIMER_ISR_C2); // printf("BEFORE READ COUNT2 ISR STAT RET :%08x\n",tempregisr); if (GET_BIT(tempregisr, 4) == 1) { // printf("OVERFLOW INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_OVERFLOW_INTERRUPT; } if (GET_BIT(tempregisr, 0) == 1) { g_endtime = get_timer(0); // printf("INTERVAL INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_INTERVAL_INTERRUPT; } if (GET_BIT(tempregisr, 1) == 1) { // printf("MATCH1 INTERRUPT OCCUR\n"); g_endtimematch1 = get_timer(0); timer_priv->enum_interrupt = TIMER_MATCH1_INTERRUPT; } if (GET_BIT(tempregisr, 2) == 1) { g_endtimematch2 = get_timer(0); // printf("MATCH2 INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_MATCH2_INTERRUPT; } if (GET_BIT(tempregisr, 3) == 1) { g_endtimematch3 = get_timer(0); // printf("MATCH3 INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_MATCH3_INTERRUPT; } tempregisr = readl(timer_priv->base + TIMER_ISR_C2); // printf("AFTER READ COUNT2 ISR STAT RET :%08x\n",tempregisr); break; case 3: tempregisr = readl(timer_priv->base + TIMER_ISR_C3); // printf("BEFORE READ COUNT3 ISR STAT RET :%08x\n",tempregisr); if (GET_BIT(tempregisr, 4) == 1) { // printf("OVERFLOW INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_OVERFLOW_INTERRUPT; } if (GET_BIT(tempregisr, 0) == 1) { g_endtime = get_timer(0); // printf("INTERVAL INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_INTERVAL_INTERRUPT; } if (GET_BIT(tempregisr, 1) == 1) { g_endtimematch1 = get_timer(0); // printf("MATCH1 INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_MATCH1_INTERRUPT; } if (GET_BIT(tempregisr, 2) == 1) { g_endtimematch2 = get_timer(0); // printf("MATCH2 INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_MATCH2_INTERRUPT; } if (GET_BIT(tempregisr, 3) == 1) { g_endtimematch3 = get_timer(0); // printf("MATCH3 INTERRUPT OCCUR\n"); timer_priv->enum_interrupt = TIMER_MATCH3_INTERRUPT; } tempregisr = readl(timer_priv->base + TIMER_ISR_C3); // printf("AFTER READED COUNT3 ISR STAT RET :%08x\n",readregisr); break; default: break; } if (timer_priv->cb_event) { timer_priv->cb_event(timer_priv); } return 0; }

Depending on which bits are set in the register, the function sets a corresponding interrupt type in the "enum_interrupt" member of the "timer_priv" structure. Additionally, the function updates ...

优化一下下面这个函数 static u64 read_one_extent(struct zram *zram, u32 eid, u16 gid) { struct erdio *erdio = NULL; u32 ext_size = 0; int ret; struct erdio_priv *priv = NULL; priv = kmalloc(sizeof(struct erdio_priv), GFP_NOIO); if (!priv) goto err; priv->gid = gid; priv->zram = zram; erdio = extramdisk_io_get(eid, GFP_NOIO, REQ_OP_READ); if (!erdio) goto err; ext_size = extramdisk_extent_size(eid); ret = extramdisk_read_async(erdio, read_endio, priv); if (ret) goto err; return ext_size; err: extramdisk_io_put(erdio); kfree(priv); return 0; }

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