uvm_info打印的log 时间没有单位

时间: 2024-09-28 07:08:43 浏览: 36
在UVM (Universal Verification Methodology) 中,`uvm_info` 是一种用于调试信息记录的标准宏,它通常用于打印非关键的日志消息。`uvm_info` 的输出并不包含默认的时间戳或者单位,因为它是一个纯文本日志,目的是为了提供清晰的信息而设计的。 如果你想要在 `uvm_info` 输出中包含时间信息,你可以选择自定义一个带有时间戳的打印函数,比如添加当前系统时间或者模拟进程时间(sim_time)。这通常是通过在日志输出前获取并显示时间来实现的,而不是由 `uvm_info` 内置功能提供的。 如果你需要在 UVM 日志中添加时间戳,可以参考这样的示例: ```python typedef function void my_uvm_info(uvm_object obj, string msg, uvm_sequence_item item = NULL); ... my_uvm_info(caller, "Info message at: $systime", current_item); ``` 这里 `$systime` 就是模拟进程时间(SimTime)。
相关问题

用uvm_info打印时间

在 UVM 中,可以使用 `$time` 系统函数获取当前的模拟时间。然后,可以使用 `uvm_info` 函数将时间信息打印到日志中。 下面是一个示例代码片段,展示了如何使用 `uvm_info` 函数打印当前时间: ```systemverilog class my_test extends uvm_test; // ... task run_phase(uvm_phase phase); super.run_phase(phase); // ... uvm_info(get_type_name(), $sformatf("Current time is %t", $time), UVM_HIGH); // ... endtask // ... endclass ``` 在上面的示例中,`$sformatf` 函数被用来将时间信息格式化为一个字符串,然后通过 `uvm_info` 函数将其打印到日志中。`UVM_HIGH` 参数指定了日志的严重等级。你可以根据需要使用不同的严重等级。 当你运行这个测试时,日志中应该会包含类似下面的信息: ``` UVM_INFO my_test @ 100: uvm_test_top.sv(10) [Time] Current time is 100 ```

uvm_info打印数据信息

UVM (Universal Verification Methodology) 是一套广泛应用于硬件验证的标准框架,它提供了一套标准的工具和方法来组织和管理验证流程。`uvm_info` 是 UVM 中的一个内置消息函数,用于在测试环境中打印调试信息级别较低的消息,通常用于表示正常的工作状态或进度更新。 当你需要在调试过程中显示一些非错误级别的详细信息时,可以使用 `uvm_info` 函数。它的基本语法如下: ```c uvm_info(std::string tag, std::string info, uvm_object phase); ``` 这里的参数含义分别是: - `tag`:是一个字符串标识符,用于识别信息的来源,比如模块名或任务名。 - `info`:是要打印的信息内容。 - `phase`:是验证阶段的上下文对象,它可以让你知道信息是在哪个阶段产生的。 例如,在验证代码中,你可能会看到这样的用法: ```c uvm_info("my_task", "Task started", get_this()); ``` 这将打印一条来自 "my_task" 的信息,内容为 "Task started",并附带了当前对象的信息。
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请逐行注释下面的代码:class riscv_instr_base_test extends uvm_test; riscv_instr_gen_config cfg; string test_opts; string asm_file_name = "riscv_asm_test"; riscv_asm_program_gen asm_gen; string instr_seq; int start_idx; uvm_coreservice_t coreservice; uvm_factory factory; uvm_component_utils(riscv_instr_base_test) function new(string name="", uvm_component parent=null); super.new(name, parent); void'($value$plusargs("asm_file_name=%0s", asm_file_name)); void'($value$plusargs("start_idx=%0d", start_idx)); endfunction virtual function void build_phase(uvm_phase phase); super.build_phase(phase); coreservice = uvm_coreservice_t::get(); factory = coreservice.get_factory(); uvm_info(gfn, "Create configuration instance", UVM_LOW) cfg = riscv_instr_gen_config::type_id::create("cfg"); uvm_info(gfn, "Create configuration instance...done", UVM_LOW) uvm_config_db#(riscv_instr_gen_config)::set(null, "*", "instr_cfg", cfg); if(cfg.asm_test_suffix != "") asm_file_name = {asm_file_name, ".", cfg.asm_test_suffix}; // Override the default riscv instruction sequence if($value$plusargs("instr_seq=%0s", instr_seq)) begin factory.set_type_override_by_name("riscv_instr_sequence", instr_seq); end if (riscv_instr_pkg::support_debug_mode) begin factory.set_inst_override_by_name("riscv_asm_program_gen", "riscv_debug_rom_gen", {gfn, ".asm_gen.debug_rom"}); end endfunction function void report_phase(uvm_phase phase); uvm_report_server rs; int error_count; rs = uvm_report_server::get_server(); error_count = rs.get_severity_count(UVM_WARNING) + rs.get_severity_count(UVM_ERROR) + rs.get_severity_count(UVM_FATAL); if (error_count == 0) begin uvm_info("", "TEST PASSED", UVM_NONE); end else begin uvm_info("", "TEST FAILED", UVM_NONE); end uvm_info("", "TEST GENERATION DONE", UVM_NONE); super.report_phase(phase); endfunction virtual function void apply_directed_instr(); endfunction task run_phase(uvm_phase phase); int fd; for(int i = 0; i < cfg.num_of_tests; i++) begin string test_name; randomize_cfg(); riscv_instr::create_instr_list(cfg); riscv_csr_instr::create_csr_filter(cfg); asm_gen = riscv_asm_program_gen::type_id::create("asm_gen", , gfn); asm_gen.cfg = cfg; asm_gen.get_directed_instr_stream(); test_name = $sformatf("%0s_%0d.S", asm_file_name, i+start_idx); apply_directed_instr(); uvm_info(gfn, "All directed instruction is applied", UVM_LOW) asm_gen.gen_program(); asm_gen.gen_test_file(test_name); end endtask virtual function void randomize_cfg(); DV_CHECK_RANDOMIZE_FATAL(cfg); uvm_info(gfn, $sformatf("riscv_instr_gen_config is randomized:\n%0s", cfg.sprint()), UVM_LOW) endfunction endclass

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