vivado dds ip核使用

时间: 2023-08-11 16:07:28 浏览: 41
Vivado是一款由Xilinx开发的集成电路设计工具，用于设计和实现FPGA和SoC。DDS IP核是Vivado中的一个IP核，用于生成数字频率合成器。根据引用\[2\]中的代码，可以看出DDS IP核的配置是通过控制字来实现的。控制字的值决定了输出信号的频率和相位。在引用\[3\]中的tb文件中，可以看到控制字的值被设置为66和6666，这将影响DDS IP核生成的输出信号的频率。通过修改控制字的值，可以实现不同的频率输出。在Vivado中使用DDS IP核，需要将IP核添加到设计中，并根据需求配置IP核的参数，如控制字的值、时钟频率等。然后，将设计综合、实现和生成比特流文件，最后下载到目标设备中进行验证和测试。 #### 引用[.reference_title] - *1* *2* [Vivado DDS IP核使用、仿真、多相处理和相关计算验证](https://blog.csdn.net/Popplio/article/details/126711613)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^control_2,239^v3^insert_chatgpt"}} ] [.reference_item] - *3* [FPGA自学笔记--DDS ip核的使用（vivado）](https://blog.csdn.net/lgk1996/article/details/123245246)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^control_2,239^v3^insert_chatgpt"}} ] [.reference_item] [ .reference_list ]

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基于vivado DDS ip核的DDS信号发生器（可调频调相）

详细描述见博客
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VIVADO DDS IP核设置

主要讲述了VIVADO 软件中DDS IP核的设置方法和设计流程，以正弦波为例。说明了dds核频率控制字和相位控制字的计算，并利用VIVADO自带的仿真软件编写了测试向量进行了仿真，给出了仿真结果。
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DDS ip核使用（vivado）

已调通，频率可控，https://blog.csdn.net/lgk1996/article/details/123245246?spm=1001.2014.3001.5502。

vivado dds ip核参数

Vivado DDS (Direct Digital Synthesis) IP核是一种用于数字频率合成的IP核。它可以在Xilinx Vivado开发环境中使用。您可以通过设置不同的参数来配置Vivado DDS IP核。 以下是一些常见的Vivado DDS IP核参数： 1. 频率分辨率（Frequency Resolution）：指定DDS的输出频率的精度。通过设置较高的分辨率，可以获得更精确的频率控制。 2. 相位累加器宽度（Phase Accumulator Width）：指定相位累加器的位宽。较大的位宽可以提供更高的相位分辨率。 3. 数据宽度（Data Width）：指定DDS输出数据的位宽。较大的数据宽度可以提供更高的输出精度。 4. 程序化调制（Programmable Modulation）：允许配置DDS以支持各种调制功能，如频率和相位调制。 5. 时钟频率（Clock Frequency）：指定DDS内部时钟的频率。这个参数用于计算输出频率。 这些参数可以根据您的具体应用需求进行配置。您可以在Vivado IP Integrator中选择DDS IP核，并在属性窗口中设置这些参数。

vivado DDSip核

Vivado中的DDS IP核是一种用于生成数字频率合成器信号的IP核。它具有配置输出信号位宽、频率、频率分辨率和相位等参数的功能。 在配置DDS IP核时，需要设置以下几个参数： 1. fclk：这是生成DDS信号的时钟频率。 2. B：这是频率控制字的位宽，一般可以设置为32或24位。频率控制字用于控制DDS IP核生成的频率。 3. f：这是频率分辨率，用于设置DDS信号的频率分辨率。频率分辨率越小，DDS生成的频率可以更精确地调节。 DDS IP核允许用户根据需要配置输出信号的位宽、频率、频率分辨率和相位等参数，以生成所需的数字频率合成器信号。 请注意，DDS IP核的具体配置方法可能会根据Vivado版本和使用的具体IP核有所不同。因此，在详细了解和使用DDS IP核时，建议参考Vivado的相关文档和IP核的用户指南。123 #### 引用[.reference_title] - *1* *2* *3* [Vivado DDS IP配置](https://blog.csdn.net/whangtash/article/details/127090406)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_2"}}] [.reference_item style="max-width: 100%"] [ .reference_list ]

vivado dds ip核输出无符号

对于 Vivado DDS IP核，如果您想要输出无符号的数据，可以通过设置其数据类型为无符号类型来实现。 在 Vivado Design Suite 中使用 Vivado HLS 工具生成 DDS IP核时，可以通过修改数据类型参数来实现无符号输出。您可以在 Vivado HLS 中定义一个无符号的数据类型，并将其作为输出信号的数据类型。例如，使用 ap_uint<N> 类型，其中 N 是您希望的无符号位宽。 在 Vivado IP Integrator 中使用 Vivado IP Catalog 添加 DDS IP核时，可以选择其输出数据类型为无符号类型。在 IP Catalog 中找到 DDS IP核并双击打开，然后在配置选项中选择无符号数据类型。 请注意，在使用无符号数据类型时，您需要确保输入和计算过程中的数据都是正确的无符号值，以避免出现溢出和不正确的计算结果。

vivado ddsIP核怎么配置

对于 Vivado 中的 DDS (Direct Digital Synthesis) IP 核的配置，您可以按照以下步骤进行操作： 1. 打开 Vivado 工程，并在 Block Design 中添加 DDS IP 核。 2. 双击 DDS IP 核，打开其配置界面。 3. 在配置界面中，您可以设置 DDS 的频率、相位、幅度等参数。 4. 根据您的需求，选择合适的输入和输出接口以及数据宽度。 5. 在高级选项中，您可以进一步配置 DDS 的细节，如启用相位累加、启用幅度调制等。 6. 确认配置完成后，点击“OK”保存设置，并将 DDS IP 核添加到设计中。 请注意，以上步骤仅为一般配置过程的概述，实际操作可能因具体版本和IP核的不同而有所差异。建议您参考 Vivado 的文档和 IP 核的用户指南，以获取更详细的配置步骤和参数说明。

vivado dds ip核和fftip核

Vivado DDS IP核是Vivado设计工具中的一种IP核，用于生成数字信号。它可以通过配置参数来控制输出信号的频率、相位和幅度。DDS IP核主要由相位累加器、振荡器和数字控制单元组成，其中振荡器产生基础信号，相位累加器用于控制相位，数字控制单元用于配置和控制IP核的行为。 FFT IP核是一种用于快速傅里叶变换的IP核。它可以将时域信号转换为频域信号，用于信号处理、频谱分析等应用。FFT IP核可以通过配置参数来控制输入信号的长度和采样率，并可以选择不同的算法实现不同的性能和资源消耗。

vivado的ddsip核

Vivado的DDS IP核是一种数字信号处理核，用于产生特定频率和相位的信号。DDS IP核可以在Vivado设计环境中进行配置。根据引用所提供的配置方法，可以通过设置输出信号位宽、频率、频率分辨率和相位等参数来实现对DDS IP核的配置。其中，输出频率可以通过配置FTW（频率控制字）和系统工作时钟频率（fclk）来计算得到。通过调整相位累加器的位数（N），可以实现更精确的相位控制。为了详细了解Vivado中DDS IP核的配置方法，建议参考引用和中提供的CSDN网页和学习笔记。这些资源将提供详细的指导和示例，有助于您更好地理解和配置Vivado的DDS IP核。123 #### 引用[.reference_title] - *1* *3* [Vivado DDS IP核使用、仿真、多相处理和相关计算验证](https://blog.csdn.net/Popplio/article/details/126711613)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v92^chatsearchT3_1"}}] [.reference_item style="max-width: 50%"] - *2* [Vivado DDS IP配置](https://blog.csdn.net/whangtash/article/details/127090406)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v92^chatsearchT3_1"}}] [.reference_item style="max-width: 50%"] [ .reference_list ]

ddsip核的使用vivado

DDS IP核的使用可以通过以下步骤进行： 1. 首先，在Vivado中创建一个新的工程，并选择适当的目标设备。 2. 在工程中添加DDS IP核。可以通过在IP目录中搜索"DDS"来找到该IP核。 3. 双击添加的DDS IP核，进入IP配置界面。在这里，你可以设置DDS的参数，如频率、相位、幅度等。 4. 根据你的需求，配置DDS IP核的输入和输出接口。你可以设置控制字的输入接口，以及正弦波和余弦波的输出接口。 5. 配置完成后，生成IP核的例化代码。这将生成一个包含DDS IP核的Verilog或VHDL代码的文件。 6. 将生成的例化代码添加到你的设计中，并连接到其他模块。 7. 在设计中实例化DDS IP核，并根据需要设置控制字和时钟信号。 8. 运行综合、实现和生成比特流文件。 9. 将比特流文件下载到目标设备中进行验证和测试。 以上是使用Vivado进行DDS IP核的基本步骤。你可以根据具体的需求和设计要求进行进一步的配置和调整。\[1\]\[2\]\[3\] #### 引用[.reference_title] - *1* *3* [Vivado DDS IP核使用、仿真、多相处理和相关计算验证](https://blog.csdn.net/Popplio/article/details/126711613)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^insertT0,239^v3^insert_chatgpt"}} ] [.reference_item] - *2* [FPGA自学笔记--DDS ip核的使用（vivado）](https://blog.csdn.net/lgk1996/article/details/123245246)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^insertT0,239^v3^insert_chatgpt"}} ] [.reference_item] [ .reference_list ]

vivado中ddsip核详解

Vivado是一款由Xilinx开发的集成电路设计工具，用于设计和开发FPGA（可编程逻辑门阵列）和SoC（片上系统）。 DDSIP核是Vivado中的一种IP核（知识产权核），用于生成数字频率合成器（DDS）电路。DDS是一种通过相位积累和数字控制信号来生成高精度的频率和相位可变信号的技术。 DDSIP核提供了在FPGA中实现DDS功能所需的硬件模块和控制接口。它包括以下主要组件： 1. 相位累加器（Phase Accumulator）：用于累计相位增量，生成DDS输出信号的相位信息。 2. 频率控制器（Frequency Controller）：用于设置DDS输出信号的频率。 3. 幅度控制器（Amplitude Controller）：用于设置DDS输出信号的幅度。 4. 数字控制接口：通过该接口，可以使用外部控制信号来配置和控制DDSIP核的各个参数，如相位增量、频率和幅度。 在Vivado中使用DDSIP核，您可以通过图形界面或HDL代码进行配置和实例化。然后，您可以将DDSIP核与其他逻辑模块连接，并生成Bitstream文件进行FPGA的编程。 请注意，由于我们是通过文本交互的方式进行沟通，我无法提供详细的Vivado和DDSIP核的操作步骤。建议您参考Vivado的用户文档和Xilinx的相关资料，以获取更详细的信息和指导。

vivado dds ip

Vivado DDS IP 是 Vivado Design Suite 中的一个 IP（Intellectual Property）核。它是一个数字直接合成器（DDS）IP核，可用于生成各种类型的周期性信号，如正弦波、方波等。DDS IP 可以在 FPGA 设计中广泛应用，例如在通信系统中生成调制信号、在音频处理中生成音频信号等。您有关 Vivado DDS IP 的具体问题吗？

vivado的dds ip核j介绍

Vivado中的DDS IP核是一种可编程的数字频率合成器，可以用于生成高精度、高稳定度的频率信号。该IP核可以通过配置参数来生成不同的频率、相位和幅度的信号输出。下面是该IP核的主要特性： 1. 支持32位和64位的相位累加器，可以实现精细的相位调整。 2. 支持14位到18位的幅度控制，可以实现高精度的幅度调节。 3. 支持三种不同的波形输出：正弦波、方波和三角波。 4. 支持两种不同的输出模式：连续模式和单次模式。 5. 支持外部同步输入，可以实现多个DDS的同步输出。 使用DDS IP核可以方便地实现数字信号的频率合成，例如在高速数据转换器（ADC）的时钟信号、高速通信系统的频率合成器等领域应用广泛。 在Vivado中，用户可以通过IP Integrator来添加DDS IP核，然后通过配置IP核参数来生成所需的输出信号。同时，Vivado还提供了大量的文档和示例设计，帮助用户快速上手DDS IP核的使用。

vivadoip核dds

Vivado提供了DDS IP核，可以用于生成正余弦波形。配置该IP核的方法如下： 1. 打开Vivado软件，选择IP Catalog。 2. 在IP Catalog中搜索Vivado DDS Compiler（6.0）模块。 3. 参考Vivado的DDS Compiler（6.0）IP核参考手册，按照手册中的说明进行配置。 4. 创建工程时省略IP核的调用。 在配置该IP核时，可以参考Vivado DDS Compiler（6.0）IP核参考手册，该手册提供了详细的配置方法。同时，还可以参考其他相关资料来获取更多信息。 在设置IP核时，可以基于上一个实验的设置进行调整。最终输出为8位，频率字为26位。DDS的频率字可以使用VIO生成。DDS的输出为有符号数，而芯片的输入DAC CODE范围为无符号数0-255。因此，DDS数据输出后需要与0x80进行异或运算，将数据的最高位取反（相对于原始数据128）。这样可以将有符号数转换为无符号数，使之适配芯片的输入范围。 综上所述，使用Vivado的DDS IP核进行配置和设置可以实现正余弦波形的生成。123 #### 引用[.reference_title] - *1* [vivadoIP核DDS使用及注意](https://blog.csdn.net/qq_36854651/article/details/104388978)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_1"}}] [.reference_item style="max-width: 50%"] - *2* *3* [ZYNQ学习--DDSIP核](https://blog.csdn.net/qq_45389511/article/details/122742517)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_1"}}] [.reference_item style="max-width: 50%"] [ .reference_list ]

vivado rom ip核实现dds原理

Vivado中的ROM IP核可以用于实现DDS（Direct Digital Synthesis，直接数字合成）的原理。DDS是一种用数字技术直接合成信号的方法，它可以通过一个指令和一个时钟信号来生成任意波形的输出信号。 在Vivado中，你可以使用ROM IP核来存储DDS所需的波形数据。ROM IP核是一种内置的IP核，可以用来存储和生成固定数据值的存储器。 要在Vivado中实现DDS原理，你可以按照以下步骤进行操作： 1. 打开Vivado并创建一个新的工程。 2. 在Block Design视图中，点击右键并选择"Add IP"。 3. 在IP库中搜索并添加ROM IP核。 4. 配置ROM IP核以存储DDS所需的波形数据。你可以指定波形的幅度、频率和相位等参数。 5. 连接ROM IP核到DDS模块。你可以使用AXI总线接口或者其他合适的接口进行数据传输。 6. 在设计中添加时钟源，并将时钟信号连接到DDS模块中。 7. 根据需要，可以添加其他逻辑模块来处理DDS生成的波形数据。 完成上述步骤后，你需要生成并实现设计，然后下载到目标设备中进行验证。这样，你就可以实现DDS原理并生成所需的波形信号。 需要注意的是，DDS的具体实现方法可能根据你的需求和设计平台而有所不同。以上是一个基本的示例，你可以根据实际情况进行适当修改。

基于vivado的dds ip核输出三角波

基于Vivado的DDS IP核可以输出三角波。DDS是指频率直接数字合成器(Direct Digital Synthesizer)，它可以通过数字信号生成各种频率的波形。DDS IP核可以在FPGA中实现此功能，通过调整参数设置，可以输出各种不同频率和波形的信号。 要输出三角波，可以按照以下步骤操作： 1. 打开Vivado设计套件，并创建一个新工程。 2. 在新工程中添加DDS IP核。在IP核导航窗格中搜索DDS，然后将其添加到设计中。 3. 在DDS IP核的参数设置界面，设置输出波形为三角波。一般来说，DDS IP核会提供一个参数用于选择波形类型，你可以选择三角波。 4. 设置DDS IP核的频率参数。你可以设定一个合适的频率，以控制输出波形的周期。 5. 连接DDS IP核的输出端口到FPGA的输出引脚。这样设计完成后，在FPGA上生成的三角波信号就可以通过相应引脚输出。 6. 在Vivado中生成比特流，并将其下载到FPGA上运行。 通过以上步骤，基于Vivado的DDS IP核将会输出一个三角波信号。你可以根据需要调整参数，如频率和幅度等，从而得到你想要的三角波形。

vivado ila ip核 正弦波

Vivado是一款由Xilinx公司开发的FPGA设计软件，它提供了许多常用的IP核，包括信号处理相关的IP核，如FFT、CORDIC、DDS等。此外，Vivado还提供了许多其他类型的IP核，如SDRAM、AXI、FIFO、TIMER、ENET、DMA、RGMII、GMII、SERDES、VIDEO等。这些IP核可以帮助设计人员快速构建复杂的FPGA设计。而ILA（Integrated Logic Analyzer）是Vivado中的一种调试工具，可以帮助设计人员对FPGA设计进行调试和分析。 正弦波是一种周期性的波形，可以用数学函数sin(x)来表示。如果需要在FPGA中生成正弦波，可以使用Vivado提供的IP核，如DDS（Direct Digital Synthesizer）IP核。DDS IP核可以根据输入的频率和相位信息生成正弦波信号，并输出到FPGA的输出端口。此外，如果需要在FPGA中处理正弦波信号，可以使用Vivado提供的信号处理IP核，如FFT（Fast Fourier Transform）IP核。

vivado dds核如何连接ad931

### 回答1： 在Vivado设计环境中，连接Vivado DDS核和AD931的过程需要按照以下步骤进行操作。 1. 首先，打开Vivado并创建一个新的工程。 2. 在工程向导中，选择项目名和位置，然后点击下一步。 3. 在设计设置中，选择适合的目标设备并点击下一步。 4. 在添加源文件页面，选择创建一个新的IP集成并点击下一步。 5. 在第一个页面上，选择Vivado DDS核文件并点击下一步。 6. 在第二个页面上，设置需要的参数，如频率、数据位宽、相位偏移等，并点击下一步。 7. 在第三个页面上，选择输出端口的数目和位宽，然后点击下一步。 8. 在第四个页面上，选择DDS核的时钟输入和复位信号，点击下一步。 9. 在第五个页面上，选择是否生成仿真模型和示例设计，并点击完成。 10.打开生成的示例设计，并添加AD931的IP核。 11. 在IP Integrator中，选择DDS核和AD931核。 12. 双击AD931核，配置其参数，如输入与输出数据位宽、时钟频率、通信协议等。 13. 配置完毕后，将AD931核连接到DDS核的输出端口。 14. 在示例设计中，添加需要的外设或调整其输入输出端口。 15. 进行逻辑综合、布局布线和生成比特流文件。 16. 导出比特流文件到目标设备，并完成硬件配置。 17. 进行验证和测试，确保Vivado DDS核和AD931的连接工作正常。 以上是一个大致的步骤流程，具体的操作可能会因具体的Vivado版本和使用的设备而略有不同。在实际操作中，还需要根据实际需求进行调整和定制，确保连接的正确性和稳定性。 ### 回答2： 在Vivado设计工具中，要将DDS（直接数字合成器）核连接到AD931（模数转换器）上，需要完成以下几个步骤： 1. 打开Vivado并创建一个新的工程。选择目标设备，接下来选择RTL工程并命名工程。 2. 在项目导航栏中，右键单击Design Sources并选择Add Sources。选择你的DDS核的源代码文件，并添加到工程中。 3. 在项目导航栏中，右键单击Design Sources并再次选择Add Sources。选择AD931开发板电路图和约束文件，并添加到工程中。 4. 在项目导航栏中，右键单击Constraints并选择Add Constraints。选择AD931的约束文件，这将告诉Vivado如何将DDS核连接到AD931。 5. 在设计视图中，找到你的DDS核实例，并将其拖动到AD931实例上。这将创建连接线来连接两个实例。 6. 确保连接线正确地连接了DDS核的输出信号到AD931的输入信号。 7. 编译工程并生成比特流（bitstream）文件。 8. 将比特流文件下载到开发板上，并运行测试以验证DDS核是否正确连接到AD931。 通过完成上述步骤，你就可以成功地将Vivado DDS核连接到AD931模数转换器上，可以使用DDS核来生成数字信号，并通过AD931将其转换为模拟输入信号。这样，你可以在设计中使用DDS核的功能，并将其与其他外设（如AD931）进行连接。 ### 回答3： 在Vivado设计工具中，连接DDS核与AD931可以通过以下步骤完成。 首先，打开Vivado并创建一个新的工程。在工程目录中，右键单击“设计资源管理器”窗口中的“源”文件夹，然后选择“添加源（Add Sources）”。在弹出的对话框中，选择DDS核的源文件，点击“完成”以将源文件添加到项目中。 接下来，右键单击“设计资源管理器”窗口中的“IP”文件夹，然后选择“添加IP（Add IP）”。在弹出的对话框中，选择AD931 IP核，点击“完成”以将IP核添加到项目中。 现在，将AD931 IP核与DDS核连接起来。在“设计资源管理器”窗口中，展开“IP”文件夹以显示AD931 IP核，然后右键单击该IP核，选择“连接（Connect）”。 在弹出的“连接界面（Connection Interface）”对话框中，选择DDS核作为连接的源，然后选择AD931 IP核作为连接的目标。根据需要进行端口连接，确保正确连接了时钟、重置、数据输入和输出等信号。 完成连接后，单击“完成（Finish）”以保存连接并关闭对话框。 最后，生成比特流文件并完成Xilinx FPGA设计。在“工具栏”中，选择“生成比特流（Generate Bitstream）”以生成比特流文件。完成后，可以将比特流文件下载到相应的Xilinx FPGA板上进行验证和测试。 以上步骤详细描述了如何在Vivado中连接DDS核与AD931 IP核。通过在设计资源管理器中添加源和IP核，然后根据连接界面进行连接设置，可以将两者正确地连接在一起，以便在FPGA中实现所需的功能。

vivado DDS

DDS是指直接数字频率合成器（Direct Digital Synthesizer），用于产生连续可变频率的信号。在Vivado中，使用DDS IP核可以方便地实现DDS功能。DDS IP核的调用和配置是实现DDS功能的关键步骤之一。 为了使用DDS IP核，首先需要熟悉FPGA硬件开发平台和Vivado的操作流程。其次，需要学习DDS IP核的调用和配置。最后，掌握Verilog HDL的基本语言逻辑，以便对DDS IP核进行适当的配置和使用。 在具体的设计过程中，可以按照以下步骤进行： 1. 创建一个新的工程，根据芯片选型进行配置。 2. 配置DDS IP核，包括输入时钟的设置和频率分辨率的配置等。 3. 编写各个模块的程序，比如频率控制字改变代码，实现频率的变化。 需要注意的是，DDS的基本原理是根据傅立叶变换定理，将周期信号分解为一系列正弦或余弦信号之和。通过改变频率控制字的大小，可以实现频率的连续变化。

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0HAL编号：tel-038172580https://theses.hal.science/tel-038172580提交日期：2022年10月17日0HAL是一个多学科开放获取档案库，用于存储和传播科学研究文档，无论其是否发表。这些文档可以来自法国或国外的教育和研究机构，也可以来自公共或私人研究中心。0HAL多学科开放获取档案库旨在存储和传播法国或国外的教育和研究机构、公共或私人实验室发表或未发表的研究文档。0代理重加密和认证委托的贡献0Anass Sbai0引用此版本：0Anass Sbai. 代理重加密和认证委托的贡献. 离散数学[cs.DM]. 皮卡第朱尔大学, 2021. 法语. �NNT:2021AMIE0032�. �tel-03817258�0博士学位论文0专业“计算机科学”0提交给科技与健康学院博士学位学校0皮卡第朱尔大学0由0Anass SBAI0获得皮卡第朱尔大学博士学位0代理重加密和认证委托的贡献0于2021年7月5日，在评审人的意见后，面向考试委员会进行

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