pcie 2.0 中文标准

时间: 2024-01-05 16:00:49 浏览: 521
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pcie2.0规范

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PCIe 2.0是指第二代PCI Express(Peripheral Component Interconnect Express)的标准。PCI Express是一种高速串行总线标准,用于在计算机系统之间传输数据和信号。PCIe 2.0标准是PCI-SIG(PCI Special Interest Group)组织制定的,作为对PCIe 1.0标准的改进和升级版本。 PCIe 2.0标准于2007年发布,其最大的改进是将原来的每个通道数据传输速率从2.5 GT/s(Giga Transfers per second)提升至5 GT/s,每个通道的带宽提升一倍,同时还增加了更多的编码和解码技术,提高了数据传输的效率和质量。 PCIe 2.0标准在物理接口、传输协议和电气规范等方面都有所改进,可以实现更快的数据传输速率和更高的带宽。同时,PCIe 2.0还向后兼容PCIe 1.0设备,能够与之前的设备和插槽兼容使用。 PCIe 2.0标准在计算机系统、服务器、网络设备等领域得到了广泛的应用,为数据传输提供了更快速、更可靠的解决方案。同时,PCIe 2.0标准还为未来的升级版本——PCIe 3.0和PCIe 4.0奠定了基础,成为了当前计算机系统中最为常见的总线标准之一。
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CPCI 规范目录(中文) 1 概述 - 1 - 1.1 CPCI 目标 - 1 - 1.2 背景和术语 - 1 - 1.3 预期读者 - 1 - 1.4 CPCI 特性 - 1 - 1.5 应用文献 - 1 - 1.6 管理 - 1 - 1.7 名字和标志的用法 - 1 - 2 特性设置 - 2 - 2.1 外形特征 - 2 - 2.2 连接器 - 3 - 2.3 模块化 - 4 - 2.4 热插拔功能 - 4 - 3 电气需求 - 4 - 3.1 适配器设计准则 - 4 - 3.1.1 退耦需求 - 4 - 3.1.2 CPCI附加信号 - 5 - 3.1.3 CPCI端接终端 - 5 - 3.1.4 外围适配器信号端接长度 - 5 - 3.1.5 阻抗特性 - 6 - 3.1.6 系统槽适配器信号端接长度 - 6 - 3.1.7 外围适配器PCI时钟信号长度 - 6 - 3.1.8 上拉定位 - 6 - 3.1.9 适配板连接器屏蔽需求 - 7 - 3.2 背板设计准则 - 7 - 3.2.1 阻抗特性 - 7 - 3.2.2 8插槽背板终端 - 7 - 3.2.3 信号环境 - 8 - 3.2.4 IDSEL板选信号分配 - 8 - 3.2.5 REQ#/GNT#信号线分配 - 8 - 3.2.6 PCI中断绑定 - 9 - 3.2.7 CPCI附加信号 - 10 - 3.2.8 电源分配 - 12 - 3.2.9 电源去耦 - 13 - 3.2.10 健全(Healthy#) - 13 - 3.3 33MHzPCI时钟分配 - 13 - 3.3.1 背板时钟线路设计准则 - 14 - 3.3.2 系统槽适配板时钟线路设计准则 - 14 - 3.4 64位设计准则 - 14 - 3.5 66MHz电气需求 - 15 - 3.5.1 66MHz适配板设计准则 - 15 - 3.5.2 66MHz系统槽适配板设计准则 - 16 - 3.5.3 66MHz背板设计准则 - 16 - 3.5.4 66MHzPCI时钟分配 - 16 - 3.5.5 66MHz系统槽适配板时钟线设计准则 - 16 - 3.5.6 66MHz热插拔 - 17 - 3.6 系统和适配板接地 - 17 - 3.6.1 适配器前面板接地需求 - 17 - 3.6.2 背板接地需求 - 17 - 3.7 CPCI缓冲器模型 - 17 - 4 机械需求 - 17 - 4.1 适配板需求 - 17 - 4.1.1 3U板卡 - 18 - 4.1.2 6U板卡 - 18 - 4.1.3 后面板I/O板卡 - 18 - 4.1.4 ESD静电导出条 - 18 - 4.1.5 ESD接线柱 - 19 - 4.1.6 剖视图 - 19 - 4.1.7 构件略图和翘曲(Component outline and warpage) - 19 - 4.1.8 焊料侧盖 - 19 - 4.1.9 前面板 - 28 - 4.1.10 系统槽识别 - 28 - 4.2 后面板I/O适配器需求 - 28 - 4.2.1 机械部件 - 28 - 4.2.2 电源 - 31 - 4.2.3 后面板按键 - 31 - 4.3 背板需求 - 31 - 4.3.1 连接器位置 - 31 - 4.3.2 槽间距 - 31 - 4.3.3 插槽标号 - 32 - 4.3.4 总线段 - 32 - 4.3.5 背板尺寸 - 32 - 5 连接器实现 - 35 - 5.1 概述 - 35 - 5.1.1 连接器位置 - 35 - 5.1.2 构架类型 - 35 - 5.1.3 连接器末端长 - 36 - 5.1.4 背板/板卡可选数量 - 36 - 5.2 J1(32位PCI信号) - 36 - 5.3 J2连接器 - 36 - 5.3.1 外围槽64位PCI - 36 - 5.3.2 外围槽后面I/O - 36 - 5.3.3 系统槽64位PCI - 36 - 5.3.4 系统槽后面I/O - 37 - 5.4 预留的通信引脚 - 37 - 5.5 预留的非通信引脚 - 37 - 5.6 电源引脚 - 37 - 5.7 5V/3.3V PCI按键 - 37 - 5.8 引脚分配 - 38 - CPCI手册的修订史 - 42 - 附录 - 42 -

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