用中规模集成电路 74LS160设计一个六十进制计数器，画出设计图

首先，我们需要了解74LS160的功能。74LS160是一个同步4位二进制计数器，它可以计数0到15。我们可以使用两个74LS160芯片来实现六十进制计数器。

以下是六十进制计数器的设计图：


其中，左侧的74LS160芯片用于计数0到5，右侧的74LS160芯片用于计数0到9。

输入时钟信号应连接到两个芯片的CP（时钟输入）引脚。每当收到一个时钟脉冲，计数器会增加1。输出从Q0到Q5共6位，分别对应六十进制数的个位到十万位。

需要注意的是，每当右侧的74LS160芯片计数到9时，它会向左侧的74LS160芯片进位。因此，在左侧芯片的D0到D3引脚中需要先预设好5个六十进制数，分别是0、10、20、30、40和50。当右侧芯片计数到9时，会向左侧芯片进位，此时左侧芯片会输出下一个六十进制数。

以上是一个简单的六十进制计数器的设计图，具体实现还需要根据具体需求进行调整。

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用十进制计数器集成芯片74390设计一个64进制计数器。画出设计的电路图。

要用74390设计一个64进制计数器，需要将其两个计数器级联，每个计数器负责计数32进制，然后将它们的输出合并起来。具体设计电路图如下：


其中，U1和U2是两个74390芯片，它们的CLK和RST引脚通过一个逻辑门（这里使用AND门）连接。每个计数器的QA、QB、QC和QD引脚连接到一个4-16译码器（这里使用两个74LS154），译码器的输出连接到一个MUX（这里使用74LS157），MUX的输出即为64进制计数器的输出。

需要注意的是，由于74390芯片是双4位计数器，因此每个计数器的最大计数值是15（二进制1111），而我们需要计数到32进制，因此需要将每个计数器的计数值乘以2，即将译码器的输入从0-15改为0-31。

分别采用反馈清零法和反馈置数法，利用集成计数器 74LS161 设计一个十二进制计数器，画出逻辑电路‍图。

首先需要了解反馈清零法和反馈置数法的原理。

反馈清零法：在计数器计数到最大值时，通过一个与非门将计数器的输出反馈到计数器的清零端，使计数器清零，从而实现循环计数。

反馈置数法：在计数器计数到最大值时，通过一个与非门将计数器的输出反馈到计数器的置数端，使计数器加一，从而实现循环计数。

接下来，根据题目要求，设计一个十二进制计数器。

首先，需要使用四个74LS161集成计数器，每个计数器的最大计数为十六进制的F，即十进制的15，因此需要使用两个74154译码器将四个计数器的输出转换为七段数码管的控制信号。

然后，根据反馈清零法和反馈置数法的原理，设计出计数器的逻辑电路图如下：


其中，四个74LS161集成计数器的输出Q0-Q3分别接入两个74154译码器的输入端A0-A3，通过译码器输出控制信号控制七段数码管的显示。

反馈清零信号由与非门U1实现，当最高位计数器Q3和次高位计数器Q2都为1时，输出反馈清零信号，使得计数器清零。

反馈置数信号由与非门U2实现，当最高位计数器Q3和次高位计数器Q2都为1时，输出反馈置数信号，使得计数器加1。

注意：因为74LS161集成计数器的计数是同步的，因此需要将四个计数器的时钟输入同时连接，以保证计数的同步性。