博锐思公司FPGA中频信号处理源代码详解与参考

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博锐思公司软件无线电FPGA中频信号处理源代码参考RMIPS_FPGA文档提供了一个针对无线电监测应用的高级硬件设计示例。该代码主要集中在FPGA（Field-Programmable Gate Array）中的信号处理部分，用于实现中频信号的处理功能。FPGA是可编程逻辑器件，通过它，工程师可以灵活地设计和实现复杂的数字信号处理算法。在设计中，关键模块包括： 1. **ADC（Analog-to-Digital Converter）**：接收模拟信号并将其转换为数字信号，输入接口包括100MHz时钟（ADC_CLK）以及16位数据（ADC_DIN）。同时，代码还关注了过载检测（ADC_Over）以确保信号质量。 2. **AGC（Automatic Gain Control）**：自动增益控制电路分别处理两个通道（ChA和ChB），输入有多个控制信号如AGC_OverA和AGC_OverB，以及电流锁定信号（ICLKA）来维持适当的信号强度。 3. **DSP（Digital Signal Processing）**：FPGA上的数字信号处理器，工作在100MHz时钟下，具有复位（DSP_nRSt）、片选（DSP_nCS2, DSP_nCS4, DSP_nCS5）以及读写控制信号。数据输入和输出通过地址线（DSP_ADDR）和数据总线（DSP_DATA），中断信号（DSP_INT）用于通知外部系统处理完成，FPGA_LOAD信号用于加载或更新DSP程序。 4. **AD9265/AD9521/AD9954**：这些是数字模拟转换器和编解码器，与FPGA通信通过片选信号（nCS）、时钟（SCLK）和串行数据接口（SDIO）。此外，它们还有电源管理信号（PDWN）以控制功耗。整个设计使用了CCS3.3开发工具，并且是V1.0版本，体现了博锐思公司在FPGA中频信号处理方面的技术实力。这份源代码对于理解FPGA在无线电监测设备中的具体实现、调试和优化具有很高的参考价值，适合于从事类似项目的研究人员和工程师深入学习和参考。

无线电监测中频信号处理软件 v1.0 页码,11/90

//--fpga internal cmd

.CmdCtrlReg ( CmdCtrlReg ),

.InnDdcCtrlReg( InnDdcCtrlReg ),

.InnDdcNCOReg ( InnDdcNCOReg ),

.InnDdcSimReg ( InnDdcSimReg ),

.SwPreCtrlReg ( SwPreCtrlReg ),

.SwFirCoefReg ( SwFirCoefReg ),

.RfLowDataReg ( RfLowDataReg ),

.RfHighDataReg( RfHighDataReg ),

.StausInfo ( StausInfo )

);

//CmdCtrlReg

assign LedCtrl = CmdCtrlReg[0]; //'0':led on; '1':led off

assign TrigSelc = CmdCtrlReg[1]; //'0':inner trig; '1':ext trig

assign AdcOverClr = CmdCtrlReg[2]; //'1':clear over flag

assign AdcSelcCh1 = CmdCtrlReg[8]; //ADC input channal selct

assign RemRoveDcByps = CmdCtrlReg[16];

assign RemLpByps = CmdCtrlReg[17];

assign RemLpBwSelc = CmdCtrlReg[20 : 18];

assign fft_start_plus = CmdCtrlReg[24];

assign DspHardRest = CmdCtrlReg[30];

assign SoftRst = CmdCtrlReg[31];

//InnDdcCtrlReg

assign DdcEnA = InnDdcCtrlReg[0]; //ddc enable

assign adc_Gain = InnDdcCtrlReg[3 : 1];

assign DemHighBit = InnDdcCtrlReg[7 : 4];

assign DemModSelc = InnDdcCtrlReg[9 : 8];

assign FifoInSelc = InnDdcCtrlReg[11 : 10]; //"00":IQ, "01":dem; "10":fft; "11":testing

assign WindowsSelc = InnDdcCtrlReg[13 : 12]; //"00":blackman, "01":hanning, "10":hanming,

"11":recatal

assign WinBypass = InnDdcCtrlReg[14];

assign ddc_Rst = InnDdcCtrlReg[15];//after cfg ddc's para, this bit must active a time

assign bw_slec = InnDdcCtrlReg[20 : 16]; //BW selct

assign DdcOutHigh2bit = InnDdcCtrlReg[24]; //select :ddc output hight 16bit,equn value low

assign FirPach = InnDdcCtrlReg[27 : 25];

assign ddc_BpSwitch = InnDdcCtrlReg[28];

assign Nosie_Gain = InnDdcCtrlReg[30 : 29];

assign nco_inv = InnDdcCtrlReg[31];

//InnDdcNCOReg

assign ddc_NCO = InnDdcNCOReg[31 : 0];

//InnDdcSimReg

assign ddc_SimEn = InnDdcSimReg[0];

assign ddc_SimFM = InnDdcSimReg[1];

assign ddc_SimFreq = InnDdcSimReg[31 : 16];

//SwPreCtrlReg

assign DdcOffsetI = SwPreCtrlReg[7 : 0];

assign DdcOffsetQ = SwPreCtrlReg[15 : 8];

//SwFirCoefReg

assign SwPreCoef = SwFirCoefReg[15 : 0];

//GPIO

//assign RF_GPO[31 : 0] = RfLowDataReg[31 : 0];

//assign RF_GPO[47 : 32] = RfHighDataReg[15 : 0];

assign StausInfo[3 : 0] = 4'b0001; //fpga software version

assign StausInfo[7 : 4] = 4'b0001; //hardware version

//StausInfo

assign StausInfo[8] = ad9521_rdy;

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