TI DP83TG720S-Q1：1000BASE-T1 Automotive Ethernet PHY with Advanc...
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更新于2024-06-28
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TI-DP83TG720S-Q1是一款专为汽车电子应用设计的以太网物理层(PHY)收发器，它符合1000BASE-T1标准，支持IEEE 802.3bp规范。这款产品具有高度的互操作性和电磁兼容性，通过Open Alliance TC12标准，确保了与符合IEEE标准的PHY设备的兼容性，并达到Class-IV UTP(无屏蔽双绞线)的EMC标准。
DP83TG720S-Q1的关键特性包括：
1. **1000BASE-T1兼容性**：它专为1000兆比特每秒的以太网标准设计，支持在汽车环境中稳定的数据传输。
2. **开放接口**：提供RGMII和SGMII两种MAC接口，方便与不同的系统总线集成。
3. **供电选项**：支持3.3V、2.5V和1.8V的输入电压，为不同应用场景提供了灵活性。
4. **兼容性**：虽然针脚与TI的100BASE-T1 PHY兼容，但仅需少量BOM变更即可实现1000BASE-T1的单板设计。
5. **节能功能**：包括待机和睡眠模式，以及本地和远程唤醒功能，有助于降低功耗。
6. **诊断工具**：内置一套全面的诊断工具，如精确温度监控、电压监测、ESD事件检测、数据吞吐量计算、链路质量分析、电缆故障识别等，便于故障排除和性能优化。
7. **其他特性**：支持25MHz时钟输出，采用VQFN湿焊边封装，以及AEC-Q100认证，确保在严苛的汽车环境中的可靠性和稳定性。
8. **ESD防护**：内置ESD保护，符合IEC 61000-4-2标准，能承受高达±8-kV的接触放电，确保设备在静电敏感环境中安全。
9. **温度等级**：该器件工作温度范围宽广，从-40°C到+125°C，满足各种极端条件下的应用需求。
10. **应用领域**：DP83TG720S-Q1适用于汽车通信中的Telematics控制系统，通过其强大的功能和可靠性，能够有效地支持车辆网络的高效通信。
TI-DP83TG720S-Q1是一款适用于汽车电子应用的高性能以太网PHY，它结合了高数据速率、低功耗、强大的诊断工具以及严格的工业级耐受性，为汽车网络设计提供了关键组件。
(1)
PARAMETER
TEST
CONDITIONS
MIN NOM MAX UNIT
SGMII TRANSMITTER AC TIMING
Clock signal duty cycle at 625 MHz 48 52 %
T
rise
Vod Rise Time 100 200 ps
T
fall
Vod Fall Time 100 200 ps
Jitter Output jitter 200 320
(7)
ps
25 MHz CRYSTAL REQUIREMENTS
Frequency 25 MHz
Frequency Tolerance and Stability Over temperature and aging –100 100 ppm
Equivalent Series Resistance 50 Ω
OUTPUT CLOCK TIMING (CLKOUT)
Frequency 25 MHz
Duty Cycle ( With crystal attached) 45 55 %
Rise / Fall Time (10% - 90%) 2.5 ns
Jitter (RMS) (Slave Mode, MAC Iinterface : SGMII) 5 ps
Jitter (RMS) (Master Mode, MAC Iinterface : SGMII) 2.4 ps
Jitter (RMS) (Slave Mode, MAC Interface : RGMII) 11 ps
Jitter (RMS) (Master Mode, MAC Interface : RGMII) 15 ps
Sleep Entry and Wake-Up
WAKE LOW to Sleep Entry; INH Transition LOW
Normal Mode,
MDI_Energy =
FALSE sleep_en =
TRUE
64 85 us
sleep_en = True to Sleep Entry; INH Transition LOW (master
mode)
Normal Mode,
WAKE = LOW,
MDI_Energy =
FALSE
5 85 us
sleep_en = True to Sleep Entry; INH Transition LOW (slave
mode)
Normal Mode,
WAKE = LOW,
MDI_Energy =
FALSE
5000 us
MDI Energy Loss to Sleep Entry; INH Transition LOW
Normal Mode,
WAKE = LOW,
sleep_en = TRUE
5 ms
Local Wake-Up Pulse Duration (on Wake pin)
Sleep Mode, WAKE
pin
80 µs
Send-S/Send-T pattern duration for wake up from MDI Sleep Mode, Slave 1.25 ms
Local Wake-Up; INH Transition HIGH
Sleep Mode, rising
edge of WAKE pin
to rising edge of
INH
85 us
Tolerable differential noise level on MDI for PHY to stay in sleep
mode
Sleep Mode 200 mV pk-pk
Link-partner's VOD for valid wake-up (for 5m cable) Sleep Mode 840 mV pk-pk
(1) Ensured by production test or characterization or design.
(2) No supply sequencing constraint across power rails
(3) In case OSC clock is delayed, additional reset is needed post Osc clock stablisation
(4) Refer register[0x0430] for programmability of RX and TX delay codes
(5) PHY provides internal delays on TX_CLK to TX_D[3:0] to add additional skew upto 2 ns. Refer to register[0x0430] for programmability
(6) Max rise/fall time of 8ns is supported for duty cycle of 40% to 55%. Max rise/fall time will be 6 ns for duty cycle of 40% to 60%
DP83TG720S-Q1
SNLS604D – SEPTEMBER 2020 – REVISED MARCH 2021
www.ti.com
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