基于IRST的并行时序模式挖掘算法提升效率

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本文主要探讨了一种在集群式高性能计算机平台上实现的并行时序模式挖掘算法,其核心是基于互关联后继树(IRST)。该算法的主要创新在于将数据处理过程分解为三个关键步骤:数据线段化、互关联后继树的构建以及频繁模式的发现,这三个步骤在多处理器上进行并行操作,显著提高了算法的执行效率。 首先,数据线段化是将原始的时间序列数据分割成一系列独立的小片段,这样可以充分利用多核处理器的并发能力,每个处理器负责处理一部分数据,降低了单个处理器的负载压力。这一步旨在减少数据传输时间和提高计算的并行度。 其次,互关联后继树是一种特殊的数据结构,它用于表示时间序列中的频繁模式。在并行环境中,通过并行构建多个互关联后继树,每个树代表数据的一个子集,这样可以同时搜索不同部分的潜在模式,进一步提升了算法的性能。 最后,模式发现阶段,即寻找频繁模式的过程,也被分配到不同的处理器上,通过分布式并行计算找出各个子集中的频繁模式,然后合并这些局部结果,形成全局的频繁模式列表。这种并行处理方式极大地减少了总的计算时间,使得算法在大规模数据集上表现出较高的执行效率。 研究者通过对算法的实验验证,结果显示相比于传统的串行算法,基于IRST的并行时序模式挖掘算法在处理大规模时间序列数据时,能够显著提升处理速度和执行效率。这项工作对于实际应用,特别是在地震科学、金融交易分析、网络行为分析等领域,具有重要的理论和实践价值。 这篇论文为时序数据挖掘领域提供了一种有效的并行解决方案,展示了如何通过分布式计算技术优化传统算法,提高数据处理的性能,对于推动高性能计算在数据密集型任务中的应用具有重要意义。

写出此代码module VGAsig (Clk40M,iRst_n,VGA_HS, VGA_VS ,H_Loc, V_Loc,VGA_BLANK_N,VGA_SYNC_N); input Clk40M; input iRst_n; output reg VGA_HS; output reg VGA_VS; output wire VGA_SYNC_N; output reg VGA_BLANK_N; output wire[10:0]H_Loc; output wire [9:0]V_Loc; reg [10:0] h_cnt; //行计数器,作为行坐标 reg [9:0] v_cnt; //列计数器,作为列坐标 parameter H_SYNCTIME =128, H_BACK =88, H_PIXELS =800, H_FRONT =40, H_PERIOD =1056; parameter V_SYNCTIME =4, V_BACK =23, V_LINES =600, V_FRONT =1, V_PERIOD =628;//------------------- 行场的计数------------------- always @(posedge Clk40M or negedge iRst_n) begin if(iRst_n==1'b0) h_cnt<=1'b0; else if(h_cnt == H_PERIOD-1) h_cnt<=1'b0; else h_cnt<=h_cnt+1; end always @(posedge Clk40M or negedge iRst_n) begin if(iRst_n==1'b0) v_cnt<=1'b0; else if(v_cnt==V_PERIOD-1) v_cnt<=1'b0; else if ( h_cnt==H_PERIOD-1 ) v_cnt<=v_cnt+1; end//-------------------同步信号产生------------------- always @(posedge Clk40M or negedge iRst_n) begin if(iRst_n==1'b0) VGA_HS<=1'b1; else if(h_cnt>=( H_PIXELS + H_FRONT)&& h_cnt <=( H_PIXELS + H_FRONT + H_SYNCTIME -1) ) VGA_HS <=1'b0; //--此处 840~967 为行同步区 else VGA_HS <=1'b1; end always @(posedge Clk40M or negedge iRst_n) begin if(iRst_n==1'b0) VGA_VS<=1'b1; else if(v_cnt>=( V_LINES + V_FRONT)&& v_cnt <=( V_LINES + V_FRONT + V_SYNCTIME -1) ) VGA_VS <=1'b0; //此处 601~604 为场同步区 else VGA_VS <=1'b1; end always @(posedge Clk40M )//产生送入 ADV7123 的复合消隐信号 VGA_BLANK_N,当不在有效显示区时,VGA_BLANK_N 输出低电平;反之,输出高电平; begin if (h_cnt >= H_PIXELS | v_cnt >= V_LINES) VGA_BLANK_N <= 1'b0; // H_PIXELS 为 800,V_LINES 为 600 else VGA_BLANK_N <= 1'b1; end//------------------- 行场像素位置输出------------------- assign H_Loc=h_cnt; assign V_Loc=v_cnt; assign VGA_SYNC_N=(VGA_VS & VGA_HS); endmodule的激励文件

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对代码module VGAsig (Clk40M,iRst_n,VGA_HS, VGA_VS ,H_Loc, V_Loc,VGA_BLANK_N,VGA_SYNC_N); input Clk40M; input iRst_n; output reg VGA_HS; output reg VGA_VS; output wire VGA_SYNC_N; output reg VGA_BLANK_N; output wire[10:0]H_Loc; output wire [9:0]V_Loc; reg [10:0] h_cnt; //行计数器,作为行坐标 reg [9:0] v_cnt; //列计数器,作为列坐标 parameter H_SYNCTIME =128, H_BACK =88, H_PIXELS =800, H_FRONT =40, H_PERIOD =1056; parameter V_SYNCTIME =4, V_BACK =23, V_LINES =600, V_FRONT =1, V_PERIOD =628;//------------------- 行场的计数------------------- always @(posedge Clk40M or negedge iRst_n) begin if(iRst_n==1'b0) h_cnt<=1'b0; else if(h_cnt == H_PERIOD-1) h_cnt<=1'b0; else h_cnt<=h_cnt+1; end always @(posedge Clk40M or negedge iRst_n) begin if(iRst_n==1'b0) v_cnt<=1'b0; else if(v_cnt==V_PERIOD-1) v_cnt<=1'b0; else if ( h_cnt==H_PERIOD-1 ) v_cnt<=v_cnt+1; end//-------------------同步信号产生------------------- always @(posedge Clk40M or negedge iRst_n) begin if(iRst_n==1'b0) VGA_HS<=1'b1; else if(h_cnt>=( H_PIXELS + H_FRONT)&& h_cnt <=( H_PIXELS + H_FRONT + H_SYNCTIME -1) ) VGA_HS <=1'b0; //--此处 840~967 为行同步区 else VGA_HS <=1'b1; end always @(posedge Clk40M or negedge iRst_n) begin if(iRst_n==1'b0) VGA_VS<=1'b1; else if(v_cnt>=( V_LINES + V_FRONT)&& v_cnt <=( V_LINES + V_FRONT + V_SYNCTIME -1) ) VGA_VS <=1'b0; //此处 601~604 为场同步区 else VGA_VS <=1'b1; end always @(posedge Clk40M )//产生送入 ADV7123 的复合消隐信号 VGA_BLANK_N,当不在有效显示区时,VGA_BLANK_N 输出低电平;反之,输出高电平; begin if (h_cnt >= H_PIXELS | v_cnt >= V_LINES) VGA_BLANK_N <= 1'b0; // H_PIXELS 为 800,V_LINES 为 600 else VGA_BLANK_N <= 1'b1; end//------------------- 行场像素位置输出------------------- assign H_Loc=h_cnt; assign V_Loc=v_cnt; assign VGA_SYNC_N=(VGA_VS & VGA_HS); endmodule进行仿真并分析

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