6.4-Gbps LPDDR5 接口:带宽提升技术实现
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更新于2024-07-17
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"本文介绍了在DesignCon2019会议上发表的研究成果,主要关注如何通过带宽改进技术实现6.4-Gbps引脚速率的LPDDR5接口。该研究由三星电子的Billy Koo、Jinho Choi、Kwanyeob Chae和Juyoung Kim共同完成,展示了新一代移动DRAM技术——LPDDR5在功率效率和内存性能上的显著提升。
LPDDR5(低功耗双倍数据速率5)是针对人工智能、自动驾驶汽车、高性能计算和嵌入式视觉等应用的严格要求而发展出的内存技术。与上一代LPDDR4相比,LPDDR5提供了更大幅度的功率节省和更高的带宽。文章详细阐述了多种带宽优化技术,这些技术使得世界首个6.4-Gbps/pin的LPDDR5接口成为可能。
在6.4-Gbps的数据速率下,论文中提到的读取(READ)和写入(WRITE)有效窗口余量(Valid Window Margin,VWM)分别为0.36 UI和0.4 UI,这表明了系统在高速操作下的稳定性。此外,WCK时钟的占空比在3.2 GHz频率下保持在43%至57%之间,包括工艺变化,并且峰值到峰值的周期性抖动小于20ps,这进一步证明了设计的精度和可靠性。
作者们还分享了各种测量结果,这些结果可作为其他LPDDR5接口设计者的参考依据,帮助他们在设计过程中优化性能和稳定性。通过深入理解这些带宽改进技术,设计师可以更好地应对高速内存接口的挑战,满足不断增长的数据传输需求,同时确保低功耗和高效率。
Billy (Kyounghoi) Koo是该研究的主要作者,他在三星电子工作,专注于内存接口技术。他的同事Jinho Choi、Kwanyeob Chae和Juyoung Kim也在内存技术领域有着深厚的背景和实践经验,他们的合作成果对推动LPDDR5技术的发展起到了重要作用。"
2022-08-04 上传
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drjiachen
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