CH7034B：高清/VGALVDS编码器技术规格

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"CH7034B是一款专为便携式系统设计的高清电视（HDTV）、VGA和LVDS编码器，旨在满足制造商的产品显示需求，降低开发成本和上市时间。" Chrontel CH7034B是集成电路领域的核心组件，其主要功能和特点包括： 1. **多输出显示格式支持**：CH7034B能够支持多种显示格式，包括分量YPrPb（HDTV）、LVDS和模拟RGB（VGA），确保了在不同类型的显示器上的兼容性。 2. **高分辨率输出**：对于HDTV输出，CH7034B可支持高达1080p的分辨率，而在模拟RGB（VGA）接口上，最高可达1920x1080分辨率，满足高清视频的需求。 3. **LVDS输出**：单通道18位LVDS发射器可支持输入分辨率最大至1366x768，适用于低功耗显示设备。 4. **同步视频流输出**：该芯片能同时通过VGA、HDTV和LVDS接口输出缩放或未经缩放的视频流，提高系统的灵活性。 5. **面板保护与电源管理**：支持面板保护、电源序列控制以及背光开/关。PWM（脉宽调制）可用于调节LCD的亮度，优化显示效果。 6. **TV/显示器连接检测**：内部寄存器编程可实现对DAC的开关控制，根据连接的设备类型自动调整。 7. **片上SDRAM帧缓冲**：内建的SDRAM帧缓冲器用于支持帧率转换，使不同帧率的视频源能够顺利播放。 8. **自适应去闪烁滤波器**：提供可编程的自适应去闪烁滤波功能，提升视频质量，减少闪烁现象。 9. **广泛输入接口支持**：支持8/12/16/18/24位并行接口输入，适用于RGB或YCbCr格式（遵循ITU-R BT.656或ITU-R BT.601标准）。此外，还支持80/86 MPU接口和DE（数据有效）仅模式。 10. **广泛的输入分辨率范围**：可处理高达1366x768的输入分辨率，如720x480等，适应不同的视频源。 CH7034B是面向高清显示应用的理想选择，其丰富的特性使得它在便携式设备的显示解决方案中占据一席之地，简化了设计流程，并提高了产品的市场竞争力。

CHRONTEL

CH7034B

209-1000-031 Rev1.23 11/19/2013 5

FIGURES AND TABLES

LIST OF FIGURES

Figure 1: Functional Block Diagram ............................................................................................................................. 3

Figure 2: 88 pin QFN Package (Top View) ................................................................................................................... 6

Figure 3: Clock and Data Input Timing in 3x Multiplexed Mode ............................................................................... 10

Figure 4: SDR and DDR Input Data Formats .............................................................................................................. 10

Figure 5: Horizontal Input Timing............................................................................................................................... 11

Figure 6: Vertical Input Timing ................................................................................................................................... 11

Figure 7: 80/86 MPU Interface Timing ....................................................................................................................... 11

Figure 8: 18 bits single pixel format ............................................................................................................................ 14

Figure 9: Power Sequencing ........................................................................................................................................ 15

Figure 10: AC Timing for LVDS Outputs ................................................................................................................... 20

Figure 11: 88 Pin QFN Package (10 x 10 mm) ........................................................................................................... 21

LIST OF TABLES

Table 1: Pin Name Descriptions .................................................................................................................................... 7

Table 2: Input data format .......................................................................................................................................... 12

Table 3: Supported HDTV standards........................................................................................................................... 13

Table 4: Video DAC Configurations for CH7034B .................................................................................................... 13

Table 5: Power Sequencing ......................................................................................................................................... 15

Table 6: Test Pattern Selection .................................................................................................................................... 15

Table 7: AC Timing for LVDS Outputs ...................................................................................................................... 20

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