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Contents RM0365
16/1086 RM0365 Rev 8
21.3.8 Output compare mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 577
21.3.9 PWM mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 578
21.3.10 Asymmetric PWM mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 581
21.3.11 Combined PWM mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 582
21.3.12 Clearing the OCxREF signal on an external event . . . . . . . . . . . . . . . 583
21.3.13 One-pulse mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 585
21.3.14 Retriggerable one pulse mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 586
21.3.15 Encoder interface mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 587
21.3.16 UIF bit remapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 589
21.3.17 Timer input XOR function . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 589
21.3.18 Timers and external trigger synchronization . . . . . . . . . . . . . . . . . . . . 590
21.3.19 Timer synchronization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 593
21.3.20 DMA burst mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 598
21.3.21 Debug mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 599
21.4 TIM2/TIM3/TIM4 registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 600
21.4.1 TIMx control register 1 (TIMx_CR1)(x = 2 to 4) . . . . . . . . . . . . . . . . . . 600
21.4.2 TIMx control register 2 (TIMx_CR2)(x = 2 to 4) . . . . . . . . . . . . . . . . . . 601
21.4.3 TIMx slave mode control register (TIMx_SMCR)(x = 2 to 4) . . . . . . . . 603
21.4.4 TIMx DMA/Interrupt enable register (TIMx_DIER)(x = 2 to 4) . . . . . . . 606
21.4.5 TIMx status register (TIMx_SR)(x = 2 to 4) . . . . . . . . . . . . . . . . . . . . . 607
21.4.6 TIMx event generation register (TIMx_EGR)(x = 2 to 4) . . . . . . . . . . . 608
21.4.7 TIMx capture/compare mode register 1 [alternate] (TIMx_CCMR1)
(x = 2 to 4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 609
21.4.8 TIMx capture/compare mode register 1 [alternate] (TIMx_CCMR1)
(x = 2 to 4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 611
21.4.9 TIMx capture/compare mode register 2 [alternate] (TIMx_CCMR2)
(x = 2 to 4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 613
21.4.10 TIMx capture/compare mode register 2 [alternate] (TIMx_CCMR2)
(x = 2 to 4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 614
21.4.11 TIMx capture/compare enable register
(TIMx_CCER)(x = 2 to 4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 615
21.4.12 TIMx counter [alternate] (TIMx_CNT)(x = 2 to 4) . . . . . . . . . . . . . . . . . 616
21.4.13 TIMx counter [alternate] (TIMx_CNT)(x = 2 to 4) . . . . . . . . . . . . . . . . . 617
21.4.14 TIMx prescaler (TIMx_PSC)(x = 2 to 4) . . . . . . . . . . . . . . . . . . . . . . . . 617
21.4.15 TIMx auto-reload register (TIMx_ARR)(x = 2 to 4) . . . . . . . . . . . . . . . 618
21.4.16 TIMx capture/compare register 1 (TIMx_CCR1)(x = 2 to 4) . . . . . . . . 618
21.4.17 TIMx capture/compare register 2 (TIMx_CCR2)(x = 2 to 4) . . . . . . . . 619
21.4.18 TIMx capture/compare register 3 (TIMx_CCR3)(x = 2 to 4) . . . . . . . . 619