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Static_Timing_Analysis(STA经典).pdf

静态时序分析

sta入门

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Static Timing Analysis

amey.hegde@wipro.com

Agenda

PRE-REQUISTES:

Knowledge of Digital Design

TOPICS COVERED :

- Basic STA concepts

- Basic Primetime Commands, Interpretaion of

Primetime reports

- Advanced STA (Mutliple clocks, Latches, OCV)

- Setting up Primetime (Appendix 1)

What is Static timing Analysis?

• What is static Timing Analysis (STA) ?

It is a method to determine if a circuit meets timing constraints

without simulation.

• Why Static Timing Analysis ?

– 100 % path coverage is possible because no design specific

pattern is required

– All paths are assumed critical

– Process variation across die can be modeled

– constraints and reports are concise and easy to interpret

Place of STA in the ASIC Flow

Back annotation

( SDF)

Conventional Front End

Back End Divide

Parasitic

Extraction

(SPEF)

• Phases of STA:

Basic STA concepts

Pre-Layout STA Post-Layout STA

Clock skews Ideal clock

assumed with

estimated skew

Actual clock delays

(Propagated clock)

Net Delays Wire load model Parasitics

(SPEF or SDF)

Use To verify the flow,

for estimation

Final Sign off

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琵琶子

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