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模拟高清AHD转VGA/HDMI/CVBS方案设计原理图
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更新于2023-03-03
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基于CV2880和NVP6124B开发的模拟高清AHD信号转换方案,通过此方案可以将AHD信号转成VGA信号或者HDMI信号或者CVBS信号,无信号时系统自动输出彩条。
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2
2
1
1
D D
C C
B B
A A
PVDD
AVDD33 V12
DV12
AVDD33
AVDD33
DV12
DV33
PVDD
DV33
XTI
2
RESETB
2,3,4
VDO1_[7..0]
2
VCLK1
2
SCL
2,3,4
SDA
2,3,4
Title
Size Document Number Rev
Date: Sheet
of
<Doc> <RevCode>
<Title>
C
1 4Thursday, October 11, 2018
Title
Size Document Number Rev
Date: Sheet of
<Doc> <RevCode>
<Title>
C
1 4Thursday, October 11, 2018
Title
Size Document Number Rev
Date: Sheet of
<Doc> <RevCode>
<Title>
C
1 4Thursday, October 11, 2018
C19100nF
C9100nF
C82 100nF
C8100nF
C1 100nF
RP2 22R
1
3
5
7 8
6
4
2
C11100nF
C13100nF
C83 4u7F
C10100nF
D1
5VPORT
1 2
FB2 90@100MHz
C17100nF
3.3V
1.2V
VIDEO OUT
AUDIO I/F
DAC
VIDEO IN
AUDIO IN
N.C.
GND
REF
INTERRUPT
SYS CLOCK
I2C
U1
NVP6124B
VSSA
1
VIN1
2
VDD3A
3
VIN2
4
VSSA
5
VIN3
6
VDD3A
7
VIN4
8
N.C
9
N.C
10
N.C
11
N.C
12
VDD3A
13
AIN1
14
AIN2
15
AIN3
16
AIN4
17
AIN5
18
AIN6
19
AIN7
20
AIN8
21
VDD3A
22
MICIN
23
REXT
24
COMP
25
AOUT
26
N.C
27
VDD3A
28
VDD3A
29
VDD1D
30
XTALI
31
N.C
32
VDD3D
33
ACLK_PB
34
ASYNC_PB
35
ADATA_PB
36
ADATA_CASI
37
ACLK_REC
38
ASYNC_REC
39
ADATA_REC
40
SCL
41
ADATA_SP
42
IRQ
43
SA1
44
SA0
45
SDA
46
VDD1D
47
ADATA_CASO
48
RSTB
49
TEST
50
VDD1D
51
MPP1
52
VCLK1
53
VDO1_0
54
VDO1_1
55
VDO1_2
56
VDO1_3
57
VDD3D
58
VDO1_4
59
VDO1_5
60
VDO1_6
61
VDO1_7
62
MPP2
63
MPP3
64
VCLK2
65
VDO2_0
66
VDO2_1
67
VDO2_2
68
VDO2_3
69
VDO2_4
70
VDO2_5
71
VDO2_6
72
VDO2_7
73
VDD3D
74
MPP4
75
VDD1D
76
PGND
77
C20100nF
C3 100nF/NC
+
C7
22uF/10V
+
C12
22uF/10V
FB3 90@100MHz
TP1
1
P1
BNC
1
3
2
4
C14100nF
+
C16
22uF/10V
C18100nF
R1 75R/NC
FB1 90@100MHz
C15100nF
R2 75R
R3 22R
RP1 22R
1
3
5
7 8
6
4
2
R4 5K6
VD_IN1
VDO1_[7..0]
VDO1_5
VDO1_4
VDO1_2
VDO1_0
VDO1_3
VDO1_1
VDO1_7
VDO1_6
VD_IN1
芯视音李工
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