基于vhdL语言数字基带传输系统

hdb3

、基带传输、课程设计

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基于

verilog

语言数字基带传输系统

摘要

简单说，基带传输系统是指不使用调制和解调装置而直接传输数字基带信号

的系统。即在发端，首先将源符号进行信源编码；之后根据信道状况，选用一

定码型及波形代表各编码符号，构成数字基带码流；最后进入基带信道进行数

字传输。

基带传输又叫数字传输，是指把要传输的数据转换为数字信号，使用

固定的频率在信道上传输。例如计算机网络中的信号就是基带传输的。和基

带相对的是频带传输，又叫模拟传输，是指信号在电话线等这样的普通线路

上，以正弦波形式传播的方式。我们现有的电话、模拟电视信号等，都是属

于频带传输

在数字传输系统中，其传输对象通常是二进制数字信息，它可能来自计

算机、网络或其它数字设备的各种数字代码。也可能来自数字电话终端的脉

冲编码信号，设计数字传输系统的基本考虑是选择一组有限的离散的波形来

表示数字信息。这些离散波形可以是未经调制的不同电平信号，也可以是调

制后的信号形式。由于未经调制的脉冲电信号所占据的频带通常从直流和低

频开始。因而称为数字基带信号。在某些有线信道中，特别是传输距离不大

远的情况下，数字基带信号可以直接传送，我们称之为数字信号的基带传输。

【关键词】基带传输数字信号

Abstract

In brief, base-band transmission system refers to the non-use

of modulation and demodulation devices and direct digital base-

band signal transmission system. In the beginning, rst of all,

the source symbols source coding; after the channel in

accordance with the situation, choosing a certain type and form

code on behalf of the encoded symbols, which constitute the

digital base-band bit stream; the last to enter the base-band

digital transmission channel.

Base-band transmission is also called the digital transmission

is to transfer the data into a digital signal, using a xed

frequency in the transmission channel. Such as computer

network is the base-band signal transmission. And base-band

frequency band transmission is relative, known as analog

transmission, the signal means such as telephone lines in such

设计要求：

（1）数字基带信号是 P=31 的 m 序列；

（2）采用 HDB3 码传输；

（3）传码率为 64Kbps；

（4）利用 VHDL 语言编写数字基带通信系统的应用程序

第一章绪论

1.1 HDB3 码简述

HDB3 码的全称是三阶高密度双极性码。HDB3 码的特点：除了保持 AMI 码的优点外，

还使连 0 串不超过 3 个，而不管信息源的统计特性如何，这对于定时信号的恢复十分有利。

HDB3 码是 ITU-T 推荐使用的码型之一。

1.2 CPLD 简介

CPLD(Complex Programmable Logic Device)复杂可编程逻辑器件，是从 PAL 和

GAL 器件发展出来的器件，相对而言规模大，结构复杂，属于大规模集成电路范围。

是一种用户根据各自需要而自行构造逻辑功能的数字集成电路。其基本设计方法是借助

集成开发软件平台，用原理图、硬件描述语言等方法，生成相应的目标文件，通过下载

电缆（“在系统”编程）将代码传送到目标芯片中，实现设计的数字系统。

CPLD 主要是由可编程逻辑宏单元(MC，Macro Cell)围绕中心的可编程互连矩阵单

元组成。其中 MC 结构较复杂，并具有复杂的 I/O 单元互连结构，可由用户根据需要生

成特定的电路结构，完成一定的功能。由于 CPLD 内部采用固定长度的金属线进行各逻

辑块的互连，所以设计的逻辑电路具有时间可预测性，避免了分段式互连结构时序不完

全预测的缺点。

1.3 Verilog HDL 简介

Verilog HDL 是一种硬件描述语言，用于从算法级、门级到开关级的多种抽象设计层

次的数字系统建模。被建模的数字系统对象的复杂性可以介于简单的门和完整的电子数字

系统之间。数字系统能够按层次描述，并可在相同描述中显式地进行时序建模。 Verilog

HDL 语言具有下述描述能力：设计的行为特性、设计的数据流特性、设计的结构组成以

及包含响应监控和设计验证方面的时延和波形产生机制。所有这些都使用同一种建模语言。

此外，Verilog HDL 语言提供了编程语言接口，通过该接口可以在模拟、验证期间从设计

外部访问设计，包括模拟的具体控制和运行。 Verilog HDL 语言不仅定义了语法，而且对

每个语法结构都定义了清晰的模拟、仿真语义。因此，用这种语言编写的模型能够使用

Ve r i l o g 仿真器进行验证。语言从 C 编程语言中继承了多种操作符和结构。Verilog HDL

提供了扩展的建模能力，其中许多扩展最初很难理解。但是， Verilog HDL 语言的核心子

集非常易于学习和使用，这对大多数建模应用来说已经足够。当然, 完整的硬件描述语言

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d_kyle

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