msp430时钟设置流程 - CSDN文库

时钟设置流程

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MSP430 时钟：

1、在 MSP430 单片机中一共有三个时钟源：

一个 LFXT1CLK ，为低速 / 高速晶振源，通常接 32.768khz ，也可以接（ 400khz ～

8Mhz）；

一个为 XT2CLK,外接标准高速晶振，通常是接 8Mhz，也可以接（400khz～8Mhz）；

还有一个叫 DCOCLK，为内部晶振，有 RC 震荡回路构成。

2、在 MSP430 单片机内部一共有三个时钟系统：

一个为 ACLK，通常由 LFXT1CLK 作为时钟源，可以通过软件控制改时钟的分频系数树；

一个为 MCLK(Main CLK)一听就知道是主时钟单元，为系统内核提供时钟，它可以通过软

件从三个时钟源选择；

还有一个为 SMCLK,称作辅助主时钟，也是可以由软件选择时钟源。

Basic Clock Module Registers(基础时钟寄存器)

DCO control register DCOCTL

Basic clock system control 1 BCSCTL1

Basic clock system control 2 BCSCTL2

Basic clock system control 3 BCSCTL3

SFR interrupt enable register 1 IE1

SFR interrupt flag register 1 IFG1

3、MSP430 的时钟设置包括 3 个寄存器，DCOCTL、BCSCTL1、BCSCTL2、BCSCTL3

DCOCTL，DCO 控制寄存器，地址为 56H，初始值为 60H

DCO0~DCO2: DCO Select Bit,定义了 8 种频率之一，而频率由注入直流发生器的电流定义。

MOD0~MOD4: Modulation Bit,频率的微调。

一般不需要 DCO 的场合保持默认初始值就行了。

BCSCTL1，Basic Clock System Control 1，地址为 57H，初始值为 84H

RSEL0~RSEL2: 选择某个内部电阻以决定标称频率.0 最低，7 最高。

XT5V: 1.

DIVA0~DIVA1:选择 ACLK 的分频系数。DIVA=0,1,2,3,ACLK 的分频系数分别是 1,2,4,8;

XTS: 选择 LFXT1 工作在低频晶体模式(XTS=0)还是高频晶体模式(XTS=1)。

XT2OFF: 控制 XT2 振荡器的开启(XT2OFF=0)与关闭(XT2OFF=1)。

正常情况下把 XT2OFF 复位就可以了.

BCSCTL2，Basic Clock System Control 2，地址为 58H，初始值为 00H

DCOR: Enable External Resistor. 0,选择内部电阻；1,选择外部电阻

DIVS0~DIVS1: DIVS=0,1,2,3 对应 SMCLK 的分频因子为 1,2,4,8

SELS: 选择 SMCLK 的时钟源, 0:DCOCLK; 1:XT2CLK/LFXTCLK.

DIVM0~1: 选择 MCLK 的分频因子, DIVM=0,1,2,3 对应分频因子为 1,2,4,8.

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评论2

wwn868

2013-06-28

很有用的资料

知秋_一叶

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