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AXI总线中文详解讲解学习.pdf
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更新于2023-05-30
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AXI总线中文详解讲解学习文档详细介绍了AXI协议,在某些关键部分做了标注。文档中大部分为英文手册的翻译,仅供学习交流使用,如有侵权请联系删除。
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AXI 总 线 中 文 详 解

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AXI 总线协议资料整理
第一部分:
1、AXI 简介: AXI (Advanced eXtensible Interface)是一种总线协议,该协议
是 ARM 公司提出的 AMBA (Advanced Microcontroller Bus Architecture )3.0 协
议中最重要的部分,是一种面向高性能、高带宽、低延迟的片内总线。它的地
址/控制和数据相位是分离的,支持不对齐的数据传输,同时在突发传输中,只
需要首地址,同时分离的读写数据通道、并支持显著传输访问和乱序访问,并
更加容易就行时序收敛。 AXI 是 AMBA 中一个新的高性能协议。 AXI 技术丰富
了现有的 AMBA 标准内容,满足超高性能和复杂的片上系统( SoC)设计的需
求。
2、 AXI 特点: 单向通道体系结构。信息流只以单方向传输,简化时钟域间的
桥接,减少门数量。当信号经过复杂的片上系统时,减少延时。
支持多项数据交换。通过并行执行猝发操作,极大地提高了数据吞吐能力,
可在更短的时间内完成任务,在满足高性能要求的同时,又减少了功耗。
独立的地址和数据通道。地址和数据通道分开,能对每一个通道进行单独
优化,可以根据需要控制时序通道,将时钟频率提到最高,并将延时降到最
低。
第二部分:
本部分对 AXI1.0 协议的各章进行整理。
第一章
本章主要介绍 AXI 协议和 AXI 协议定义的基础事务。

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1、 AXI 总线共有 5 个通道分别是 read address channel
、 write address channel 、 read data channel 、 write data channel、 write response
channel。每一个 AXI 传输通道都是单方向的。
2、 每一个事务都有地址和控制信息在地址通道( address channel)中,用来描
述被传输数据的性质。
3、 读事务的结构图如下:
4、 写事务的结构图如下:

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5、 这 5 条独立的通道都包含一个信息信号和一个双路的 VALD 、READY 握手
机制。
6、 信息源通过 VALID 信号来指示通道中的数据和控制信息什么时候有效。目
地源用 READY 信号来表示何时能够接收数据。读数据和写数据通道都包括一
个 LAST 信号,用来指明一个事物传输的最后一个数据。
7、 读和写事务都有他们自己的地址通道,这地址通道携带着传输事务所必须
的地址和信息。
8、 读数据通道传送着从设备到主机的读数据和读响应信息。读响应信息指明
读事务的完成状态。
9、 写数据通路传送着主机向设备的写数据。每八个数据都会有一个 byte
lane ,用来指明数据总线上面的哪些 byte有效。写响应通道提供了设备响应写
事务的一种方式。这完成信号每一次突发式读写会产生一个。
10、 主机和设备的接口和互联图如下:

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11、 传输地址信息和数据都是在 VALID 和 READY 同时为高时有效。
12、 突发式读的时序图如下:
当地址出现在地址总线后,传输的数据将出现在读数据通道上。设备保持
VALID 为低直到读数据有效。为了表明一次突发式读写的完成,设备用
RLAST 信号来表示最后一个被传输的数据。
13、 重叠突发式读时序图如下:
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