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全局时钟资源和时钟多路复用器(BUFGMUX)
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更新于2023-03-16
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在Spartan-3器件内部提供了全局时钟资源,其中包括专用时钟输入引脚、缓冲器和布线资源,其时钟分配树结构如图1所示。主要时钟连接路径为从专用时钟输入引脚的全局时钟,在驱动全局时钟缓冲器后经由全局布线资源到达触发器或其他时钟触发的单元,DCM介于全局时钟引脚和全局缓冲器之间便于定制时钟的充分利用。 图1 Spartan-3器件中的时钟分配树结构 这种时钟结构贯穿整个FPGA具有低容值和低偏移互连特性非常适合走高频率信号,这些资源保证了DOM模块的时钟输出具有最小的传输延迟,可提供灵活时钟分配,并且保证时钟信号到达各个目标逻辑单元的延时基本相同。 在Spartan-3器件
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全局时钟资源和时钟多路复用器(全局时钟资源和时钟多路复用器(BUFGMUX))
在Spartan-3器件内部提供了全局时钟资源,其中包括专用时钟输入引脚、缓冲器和布线资源,其时钟分配树结
构如图1所示。主要时钟连接路径为从专用时钟输入引脚的全局时钟,在驱动全局时钟缓冲器后经由全局布线资
源到达触发器或其他时钟触发的单元,DCM介于全局时钟引脚和全局缓冲器之间便于定制时钟的充分利用。
图1 Spartan-3器件中的时钟分配树结构 这种时钟结构贯穿整个FPGA具有低容值和低偏移互连特性非常
适合走高频率信号,这些资源保证了DOM模块的时钟输出具有最小的传输延迟,可提供灵活时钟分配,并且保
证时钟信号到达各个目标逻辑单元的延时基本相同。 在Spartan-3器件
在Spartan-3器件内部提供了全局时钟资源,其中包括专用时钟输入引脚、缓冲器和布线资源,其时钟分配树结构如图1所
示。主要时钟连接路径为从专用时钟输入引脚的全局时钟,在驱动全局时钟缓冲器后经由全局布线资源到达触发器或其他时钟
触发的单元,DCM介于全局时钟引脚和全局缓冲器之间便于定制时钟的充分利用。
图1 Spartan-3器件中的时钟分配树结构
这种时钟结构贯穿整个FPGA具有低容值和低偏移互连特性非常适合走高频率信号,这些资源保证了DOM模块的时钟输
出具有最小的传输延迟,可提供灵活时钟分配,并且保证时钟信号到达各个目标逻辑单元的延时基本相同。
在Spartan-3器件中,尽管16个全局时钟信号可以通过时钟多路复用器分配到4个象限,但每个象限最多只能提供8个全局
时钟网络,即8个时钟输入通道。为了使16个时钟信号能够分配到各个象限中,该器件采用了共享时钟网络的方式实现,如图
2所示,从而可充分地发挥器件中时钟网络资源的利用率。从图中大致看出,同一对时钟网络(如GCLKl0和GCLK6)不能同时进
入同一象限。
图2 共享时钟网络的方式实现
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