vivadoFFT9.0版本AXIS总线IP使用及仿真_axis总线 - CSDN文库

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项目需求，最近使用了 Vivado2013.4 做开发，设计中使用到 FFT（9.0）的 IP，该 IP 接

口采用 AXIS 总线格式，相比 ISE14.7 中 FFT（8.0）以及 Vivado 中 FFT（LTE）输入信号格

式大变，不过只要熟悉 AXIS 总线信号格式就没得问题，不要怕麻烦！！！（刚开始使用就是

怕麻烦，有些握手信号没用，event 状态信号也没注意，浪费了不少时间）

一、设计参数配置，及 IP 生成

下面开始介绍配置界面：

第一页，Configuration，主要是 FFT 变换长度以及结构选择。

Number of Channels:FFT 变换通道，可以选择多通道，实现多帧数据同时进行 FFT 运算；

Transfrom Length:FFT 变换长度；如果下面选择了“Run Time Configuration Transform

Length”，则该参数为 FFT 变换最大长度。

时钟选择根据自己设计需求，只能是 1—550 之间的整数，不小于自己需求时钟就可以了。

Architecture Choice

：

实现架构选择，根据设计需求、板子资源情况，本设计中选择变换处

理时间最短、消耗资源最大的并行流水结构；其他结构以此降低了变化速率但是节省了资源，

这个在 PG109-xfft 中有详细介绍。

Run Time Configuration Transform Length:勾选该项，则在变换过程中可以改变 FFT 变换的

长度，通过 s_axis_config_ tdata 中 NFFT 字段进行配置。

第二页，Implementation 介绍。

Data Format:输入数据格式，定点和浮点两种，根据自己设计需求选择了定点；

Scaling Options:Block Float Point、Scaled、Unscaled 三种可选。Block Float Point 不管输入格

式如何，FFT 变换内部采用浮点，会根据每一级变换数据情况自动缩放，使得数据不出现溢

出，在 m_axis_data_tuser 中会有 5 个比特表示每一级缩放情况（本设计中是[20:16]）； Scaled

选择后，在 s_axis_config_tdata 中有相应字段配置缩放因子，这个在 pg109-xfft 中有详细介

绍，每一级包含 2 个 stage，2 个比特表示一级的缩放，一般 0-3 可选，变换长度 NFFT，如

果 log2(NFFT)不是 2 的倍数，则最高一级的缩放只能 0-1 可选；Unscaled 全精度，不用担心

变换过程中会出现溢出，但是输入 32bit，变换后的输出是 64bit 跟自己的设计不符合，截位

误差更大。

Precision Options:本设计保持默认设置，可以尝试修改下。

Control Signals:ACLEN 时钟使能信号可以不选，复位信号 ARESETn 还是建议选上（至少

保持 2 个时钟的低电平）。

Output Ordering Options:Natural Order,Bit/Digita Reserved Order 两种，Natural Order 就是变

换后的输出已经调整了顺序，按照索引 xk_index 的自然序列输出变换结果，Bit/Digita

Reserved Order 就是按照变换后的结果输出，索引 xk_index 不是自然序列，可能需要自己缓

存再按索引值顺序输出。Cyclic Prefix Insertion，CP 添加，勾选上，在进行 IFFT 后可以根

据 s_axis_config_tdata 中的 CP 长度配置自动添加 CP。

Optional Output Fields

：

XK_INDEX 是 FFT 变换结果索引，在 m_axis_data_tuser 中有相应

的字段。OVFLO 是变换中溢出指示信号，对应 event_fft_overflow。建议这两个还是勾选，

对于设计有帮助。

Throttle Scheme

：

没做研究，保持默认配置。猜想应该是 fft 变换过程中配置参数修改是立

即生效，还是完成该帧处理下一帧生效。

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评论1

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2019-01-23

一般一般把

VagueCheung

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