任意波形的函数发生器的设计
杨阳 赵星 刘超
本文采用的是一个三位的多路选择器来控制输出波形即输入端口 selo,分别是 0 的时候输出
的是递增波形，1 的时候输出是递减波形，2 的时候输出是三角波输出，3 的时候是阶梯波，
4 的时候是输出正弦波，5 的时候输出的是阶梯波。其整体的框架图（综合的寄存器级传输
逻辑）如下图所示
整体框架图
Clk0 是时钟控制端，reset0 复位控制端。
U2 是递增模块
library ieee ;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity zeng is 实体定义
port (clk,reset:in std_logic;
Q:out std_logic_vector (7 downto 0));
end zeng;
architecture zeng_arc of zeng is 结构体定义
begin
process(clk,reset)
variable tem: std_logic_vector (7 downto 0);
begin
if reset='0'then 复位
tem:=(others=>'0');
yangrobin
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