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USB_SlaveFIFO开发记录
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更新于2023-03-16
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基于USB2.0芯片CY7C68013A与FPGA的SLAVE FIFO 模式开发过程记录,以及关键位置和注意事项
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基于 Cypress 公司 USB2.0 芯片 CY7C68013A 的速传接口开发(供开发人员参考)
配置模式:SLAVE-FIFO
开发环境搭建:安装 cy3681_ez_usb_fx2_development_kit_15 开发包,
或者 cy3684_ez_usb_fx2lp_development_kit_15 开发包
一、硬件电路
关键注意点:
1. CY7C68013A 芯片的 PA0~PA7 这 8 个 IO 脚为开漏配置,最好在使用时接上 10K 电阻
上拉;
2. CY7C68013A 芯片系统时钟为外接 24MHz 时钟,也可以由 FPGA 提供,片上 51 内
核内置 PLL 倍频,此时的系统内部工作时钟为 48MHz;
3. 芯片通信时钟 IFCLK 可选择由内部自身提供,也可外部提供,一般选择 48MHz,
突出 USB2.0 的高速通信速率,最好选择外部提供,保证与外部控制器 FPGA 的时序同步;
4. 芯 片 内 部 没 有 存 储 RAM , 需 要 外 接 一 片 EPPROM 与 芯 片 的 IIC 接 口 进 行
Programme,此时固件也必须生成 .iic 的文件;(具体见附件)
二、电脑 USB 驱动文件 .SYS \.INF 开发
当连接好的硬件电路首次接入电脑,会出现未识别硬件的提示,解决识别问题操作步
骤如下:
1. 通过右键“我的电脑”进入设备管理器,查看通用串行总线控制器找到带有感叹号
的未识别硬件;
2. 右键未识别硬件,选择属性,再进入属性中的详细信息,在属性选择栏中选择“硬
件 ID”,则会弹出类似如下图:
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