常用时序分析SDC 命令参考

常用时序分析 SDC 命令参考 （一）

1. Define design environment

1.1. Set_operating_conditions

1.2. Set_wire_load_model

1.3. Set_driving_cell

1.4. Set_load

1.5. Set_fanout_load

1.6. Set_min_library

2.2.1. create_clock

2.2.2. create_generated_clock

2.2.3. Set_clock_latency

2.2.4. Set_propagated_clock

2.2.5. Set_clock_uncertainty

2.2.6. Set_input_delay

2.2.7. Set_output_delay

2.2.8. Set_max_area

3. Other commands

3.1. set_clock_groups

1.3. set_wire_load_model

1.4. set_ideal_*

2. Must be placed in timing fix SDC file:

2.1. Set_clock_uncertainty,

2.2. set_max_transition

2.3. set_propagated_clock

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set_operating_conditions：定义当前设计的控制条件

语法：

Int set_operating_conditions

[-analysis_type bc_wc | on_chip_variation]

[-min min_condition]

[-max max_condition]

[-min_library min_lib]

[-max_library max_lib]

[-min_phys min_proc]

max_conditon 列表

objects 列表

condition 列表

参数：

-analysis_type bc_wc | on_chip_variation

设定分析的类型。两个选项只能选择其中一个。使用 bc_wc 或 on_chip_variation 切换设计到

min_max 模式。bc_wc 值设定最小（快）最大（慢）控制条件是两个极端的控制条件。在 bc_wc

分析，用最大的控制条件分析 SETUP，用最小控制条件分析 HOLD。on_chip_variation 分析分

别有最小和最大控制条件表示片上最大偏差的上下限。对所有最大延迟的路径运用最大控制条件 ，

对所有最小延迟的路径运用最小控制条件。

-min min_condition

指定用于最小延迟分析的控制条件。如果没有指定，工具默认使用最大控制条件。 -min 必须

-max max_condition

合，工具将选择集合中首个满足条件的库。

指定工艺 资 源 名称搜索 相 匹 配的电阻 和 电 容值，用 于 最 小延迟分 析 。 该选项必 须 与 -

max_phys 一起使用。

-max_phys max_proc

指定工艺资源名称搜索相匹配的电阻和电容值，用于最大延迟分析。该选项必须与-min_phys

一起使用。

-library lib

指定包含控制条件定义的库，用于最小和最大延迟分析。可以是一个库的名称或集合。如果

是集合，工具将选择集合中首个包含控制条件的库。

-object_list objects

指定要设置控制条件的单元或端口。如果没有指定，默认为整个设计。该选项支持子单元或

指定有环境特征定义的条件，在最小最大延迟分析时使用。

link_library

如果没有为设计设定控制条件，compile 命令寻找链接库中首个库的控制条件作为初始值。如

果库中没有控制条件定义，控制条件将不会被使用。

使用-object_list 选项将取代来自于设计或更高层次设计上的设定。

使用 report_design 命令可以查看当前设计控制条件设定和链接库信息。使用 report_lib 命令可以

查看指定库控制条件设定。

多条件多模式支持：该命令仅使用当前方案的信息

voltage : 5.25 ;

tree_type : “best_case_tree” ;

}

控制条件的名称是 BCCOM，参数定义为：

process

浮点数代表半导体工艺特征

temperature

浮点数代表环境设定的温度

voltage

浮点数定义环境设定中电压范围的上限，下限为 0.0

local_link_library 设定。my_lib.db 的库为 my_lib_core。

控制条件’WCIND’在库”my_lib_core”中查找。

使用 other_lib_core.db 库中 BCIND 值 用 于 最小 延 迟分 析 ， WCIND 用 于 最大 延 迟分 析 。

删除当前控制条件设定

set_operating_conditions

更多：

compile, report_lib, reset_design, set_local_link_library, link_library

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set_wire_load_model

status set_wire_load_model

-name model_name

[-library lib]

数据类型：

model_name 字符

指定连线负载模型的名称。该模型必须是已定义的。这个选项必须使用。

-library lib

指定包含模型的库。可以是一个库的名称或集合。如果是集合，工具将选择集合中首个满足

条件的库。

-min

指定仅用于最小延迟分析的模型。你不能用-min 选项设定一个不同的模型或最小模块尺寸。

因为对于这些参数，无论最大最小延迟分析都使用相同的值。

-max

指定仅用于最大延迟分析的模型。任何用于最小延迟分析的模型集都没有影响。

object_list

指定将被设定连线负载模型的端口、设计或单元的列表。连线负载模型默认设定给当前设计。

将 自 动 搜 索 与 wire_load_selection 表 相 匹 配 的 连 线 模 型 。 如 果 库 有 不 只 一个 表， 将 设 置

default_wire_selecting_group 属 性 将 其 中 一 个 表 设 定 为 初 始 表 。 你 也 可 以 通 过

set_wrie_load_selection_group 进行手工设定。 如果你没有使用 set_wire_load_min_block_size

设定模块大小，当合适的连线被选用，设计单元面积被假设为至少与这个值一样大。如果没有

会被使用。

当 auto_wire_load_selection 属性被设为 false，并且没有指定 model_name，也同样没有连

线模型会被使用。

report_design 命令显示当前设计的连线模型和模式，以及相关联的库。report_wire_load 命

令可提供更多连线模型信息。

report_lib 命令显示指定库中定义的连线模型及选择表。你可以使用 report_port 显示设计端口

连线模型。

模型不会被改变。如果对子设计设定连线模型，你需要确保顶层设计连线模型不是 top，否则下

层模块的连线模型的选择会被忽略。如果为设计指定连线模式，工具在 compile 时，会搜索首个

使用-min 选项，你可以使用 set_wire_load_model 指定一个不同的连线模型用于最小延迟分析 。

除非明确的指定，最大最小延迟分析使用相同的连线模型。你可以设定不同的连线模型指定给设

计或端口。你不可以指定不同的连线模型或模块尺寸仅用于最小延迟分析。对于这种情况，最大

最小分析使用相同的值。

布线面积总是使用与最大延迟分析的相同连线负载来计算。连线负载模型包含 compile 估计

连线延迟所需要的所有信息。下面是一个连线负载模型的例子。

fanout_length(1 , 1.9 );

fanout_length(2, 2.8 );

fanout_length(3, 4.7 );

}

模型名称 90x90，模型字段定义为：

resistance

互连线单位长度电阻

capacitance

互连线单位长度电容

area

互连线单位长度连线面积

fanout_length (fanout1, length1)

在顶层设计设定布线负载模型，没有 local_link_library 设定前提下：

…

Wire Loading Model:

NameLibrary ResCap Area Slope Fanout Length　　

05x05tech_lib0.00001.00000.00000.1860100.3900　　

10x10tech_lib0.00001.00000.00000.3110 10.5300　　

…

link_library = {tech_lib.db}

set_wire_load_model –name “10x10”

以下范例使用-library 选项指定库 my_lib.db 中的连线负载模型 10x10

set_wire_load_model –name “10x10” –library my_lib.db