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低功耗串行外设接口(LPSPI)
46.1 芯片专用LPSPI信息
46.1.1 实例化信息
下表总结了该模块在产品系列中每个芯片的实现。
每个模块的芯片选择的确切数量取决于封装。 并非所有芯片选择都可用于不同的封装。 LPSPI2不支持
任何TRGMUX相关功能,例如TRGMUX的HREQ源或TRGMUX的任何触发器。
器件上的所有LPSPI实例都有所有记录的LPSPI寄存器。
该设备不支持低泄漏和等待模式。 有关可用功率模式的详细信息,请参见在可用低功率模式下的模块操
作。
46.2 介绍
46.2.1 总览
LPSPI是一种低功耗串行外围设备接口(SPI)模块,它支持作为主设备和/或从设备的SPI总线的有效接
口。 LPSPI可以在停止模式下继续运行,只要有适当的时钟可用,并且可以通过FIFO寄存器访问的DMA
卸载来降低CPU开销。
46.2.2 特征
LPSPI支持以下功能:
字大小= 32位
命令/发送4个字的FIFO
接收4个字的FIFO
主机请求输入可用于控制SPI总线传输的开始时间
46.2.3 框图

Signal Description I/O
SCK 串行时钟。 在从模式下输入,在主模式下输出。 I/O
PCS[0] 外围芯片选择。 在从模式下输入,在主模式下输出。 I/O
PCS[1] /
HREQ
外围芯片选择或主机请求。 当HREN = 1和HRSEL = 0时,选择主机请求引
脚。 在从机模式下输入或用作主机请求时,在主机模式下输出。
I/O
PCS[2] /
DATA[2]
四数据传输期间,外围芯片选择或数据引脚2。 在从模式下输入,在主模式
下输出,在四数据接收传输中输入,在四数据传输传输中输出。
I/O
PCS[3] /
DATA[3]
四数据传输期间,外围芯片选择或数据引脚3。 在从模式下输入,在主模式
下输出,在四数据接收传输中输入,在四数据传输传输中输出。
I/O
SOUT /
DATA[0]
串行数据输出。 可以配置为串行数据输入信号。 在四数据和双数据传输中用
作数据引脚0。
I/O
SIN /
DATA[1]
串行数据输入。 可以配置为串行数据输出信号。 在四数据和双数据传输中用
作数据引脚1。
I/O
46.3 内存映射和寄存器
46.3.1 LPSPI寄存器说明
46.3.1.1 LPSPI内存映射
LPSPI0 base address: 4002_C000h
LPSPI1 base address: 4002_D000h
LPSPI2 base address: 4002_E000h
46.3.1.2 版本ID寄存器(VERID)
46.3.1.2.1 偏移
46.3.1.2.2 图表

位域 功能
31-24
MA JOR
主要版本号;该只读字段返回模块规范的主要版本号。
23-16
MINOR
次版本号;该只读字段返回模块规范的次要版本号。
15-0
FEATURE
模块识别号;该只读字段返回功能集编号。 0000000000000100b-支持32位移位寄
存器的标准功能集。
位域 功能
31 - 16 保留
15 - 8 RXFIFO 接收FIFO大小;设置接收FIFO中的最大字数,即2^RXFIFO。
7 - 0 TXFIFO 发送FIFO大小;设置发送FIFO中的最大字数,即2^TXFIFO。
46.3.1.2.3 位域
46.3.1.3 参数寄存器(PARAM)
46.3.1.3.1 偏移
46.3.1.3.2 图表
46.3.1.3.2 位域
46.3.1.4 控制寄存器(CR)
46.3.1.4.1 偏移
46.3.1.4.2 图表
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katcoo
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