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FPGA关于Verilog语法教程的相关书籍
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FPGA
静态时序分析
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更新于2023-05-29
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该文档主要描述了在FPGA逻辑开发中Verilog语法教程的相关内容。详细讲解了verilog中的各种函数，数据类型相关的内容。
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1
:
版权所有
北京航空航天大
学
夏
宇闻
21/8
/8
数字系统设计教程
(
V
erilog 1364-2001)
--
建模、仿真、综合、验
证和实现
--
北京航空航天大学 夏宇闻
北京航空航天大学 夏宇闻
200
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8
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年版
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课时安排和学习方法
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十次讲课每次
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2
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小时；
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五次实验每次
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小时；
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一次上机实验考核加面
试共
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小时；
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课堂
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20+20
+4=44
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小时，自己看书
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小
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时共计
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小时；
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理论与实践结合的学习
方法；
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考核方法：认真听课
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20%
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；下课复习
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%
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；实验课操作
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；最后考核
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讲课的主要内容
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复杂数字系统与信号处
理的关系
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为什么要研究复杂的数
字逻辑系统
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设计数字系统的基本方
法
设计数字系统的基本方
法
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设计复杂数字系统的工
具和手段
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数字系统的基本结构
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Verilog
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语言的特点和基本语法
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讲课的主要内容
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Verilog
Verilog
模块和电路结构的关
系
模块和电路结构的关
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两种不同的
两种不同的
Verilog
Verilog
模块
模块
•
可综合模块的风格
可综合模块的风格
•
测试用模块的编写要点
测试用模块的编写要点
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语法要点
语法要点
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设计示例分析
设计示例分析
讲课的目的
讲课的目的
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提醒书本上容
易忽略的内容；
提醒书本上容
易忽略的内容；
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指出重点和关
键点；
指出重点和关
键点；
•
帮助同学理解
书本上的难点；
帮助同学理解
书本上的难点；
•
自己看书、上
机练习为主；
自己看书、上
机练习为主；
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互相认识，以
便交流。
互相认识，以
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