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MF CV520器件规格书
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更新于2023-05-22
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MF CV520器件规格书 CV520 是应用于13.56MHz 非接触式通信中高集成度读写卡系列芯片中的一员,支持ISO/IEC 14443 TypeA 和MIFARE®通信协议。 其内部发送器部分可驱动读写器天线与ISO 14443A/MIFARE®卡及应答器的通信,无需其 它的电路。接收器部分提供一个稳定高效的解调和解码电路, 用于处理ISO14443A 兼容的应答器信号。数字部分处理ISO14443A 帧和错误检测(奇偶&CRC)。 MF CV520 支持MF1xxS20,MF1xxS70 和MF1xxS50 等系列产品。MF CV520 支持MIFARE®更高速的非接触式通信,双向数据传输速率高达828kbit/s。
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CV520
非接触式 IC 卡读写芯片
华视/莫宗华
13421323510
1. 介绍
这份文件描述的是非接触式 IC 卡读写芯片 CV520 的功能和电气规格。
注意: CV520 支持 MIFARE 的所有变体:MIFARE Mini , MIFARE 1K, MIFARE 4K,
MIFARE Ultralight, MIFARE DESFire EV1 和带有射频识别的 MIFARE。在本文件中为了通
俗易懂, MIFARE Mini, MIFARE 1K, MIFARE 4K, MIFARE Ultralight, MIFARE DESFire
EV1 和 MIFARE PLUS 系列产品,统称为 MIFARE.
2. 概述
CV520 是应用于 13.56MHz 非接触式通信中高集成度读写卡系列芯片中的一员,支持
ISO/IEC 14443 TypeA 和 MIFARE®通信协议。
其内部发送器部分可驱动读写器天线与 ISO 14443A/MIFARE®卡 及应答器的通信,无需其
它的电路。接收器部分提供一个稳定高效的解调和解码电路, 用于处理 ISO14443A 兼容
的应答器信号。数字部分处理 ISO14443A 帧和错误检测(奇偶&CRC)。
MF CV520 支持 MF1xxS20,MF1xxS70 和 MF1xxS50 等系列产品。MF CV520 支持
MIFARE®更高速的非接触式通信,双向数据传输速率高达 828kbit/s。
支持以下主机接口:
• 串行外设接口 (SPI)
3. 功能特性
u 高集成度的调制解调电路;
u 采用少量外部器件,即可将输出驱动级接至天线;
u 支持 ISO/IEC 14443 TypeA 和 MIFARE®通信协议;
u 达到100mm的读写距离,读写距离取决于天线的大小和调制;
u 支持MF1xxS20,MF1xxS70和MF1xxS50的读写加密;
u 支持 ISO 14443A 高达848kbit/s传输速率的通信;
u 支持MFIN/MFOUT;
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CV
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NXP
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Semiconductors
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© NXP&HUASHI B.V. 2011. All rights reserved.
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u 支持的主机接口:
-最高到10Mbit/s 的 SPI 接口;
u 64 字节的发送和接收 FIFO 缓冲区;
u 灵活的中断模式;
u 低功耗下硬件复位;
u 具备软件掉电模式;
u 可编程定时器;
u 内部振荡器,连接 27.12MHz 的晶体;
u 2.5~3.6V 的低电压低功耗设计;
u 具备 CRC 和奇偶校验功能;
u 可编程的I/O管脚;
u 内部自检;
4. 快速参考数据
Table 1.
快速参考数据
符号 参数 条件 最小
典型
最大
单位
V
DDA
模 拟 电 源 电 压 V
DD(PVDD)
≤ V
DDA
= V
DDD
= V
DD(TVDD)
;
[1][2]
2.5 3.3 3.6 V
V
DDD
数字电源电压
V
SSA
=
V
SSD
=
V
SS(PVSS)
=
V
SS(TVSS)
=0V
2.5 3.3 3.6 V
V
DD(TVDD)
发送器电源电压
2.5 3.3 3.6 V
V
DD(PVDD)
管脚电源电压
[3]
1.6 1.8 3.6 V
V
DD(SVDD)
SVDD 电源电压
V
SSA
= V
SSD
= V
SS(PVSS)
= V
SS(TVSS)
= 0 V
1.6 - 3.6 V
I
pd
掉电电流
V
DDA
=
V
DDD
=
V
DD(TVDD)
=
V
DD(PVDD)
=3V
hard power-down; pin NRSTPD set LOW
[4]
- - 5 ìA
soft power-down; RF level detector on
[4]
- - 10 ìA
I
DDD
数字电源电流
pin DVDD;
V
DDD
=3V - 6.5 9 mA
I
DDA
模拟电源电流
pin AVDD; V
DDA
= 3 V, CommandReg register’s
RcvOff bit = 0
- 7 10 mA
pin AVDD; receiver switched off; V
DDA
=3 V,
CommandReg register’s RcvOff bit = 1
- 3 5 mA
1.电源电压在 3V 以下会降低器件的性能(如,能达到的最远操作距离)。
2.VDDA, VDDD 和 VDD((TVDD) 一定要保持相同的电压。
3.VDD(PVDD) 一定要等于或低于 VDDD。
4. IPD 是所有电源的总电流。
5. IDD(PVDD)取决于数字管脚的总负载。
6.IDD(TVDD) 取决于 VDD(TVDD) 和连接到 TX1 和 TX2 的外部电路。
7. 典型电路工作期间消耗的总电流在 100mA 以下。
8. 使用互补驱动器时在 13.56MHz 的频率下匹配到 TX1 和 TX2 之上的 40Ù 的天线时的典型值。
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5. 订购信息
Table 2. 订购信息
封装 芯片种类
名称 描述 版本
MF CV52001HN1/TRAYBM
[1]
HVQFN32 热特性较强且厚度非常薄的扁平四方形;无引线;32 个引脚;
芯
片尺寸为 5×5×0.85mm
SOT617-1
[1] 5个工作日内交货
6. 功能框图
模拟通讯接口用于模拟信号的调制与解调。
无线传输异步接收器接收和处理主机发送的信号。先进先出的数据缓存器使得数据在主机与 UART 之
间进行快速顺畅的双向传输。
可以根据客户的需要提供不同的与主机通讯的接口。.
REGISTER BANK
ANTENNA
ANALOG
INTERFACE
CONTACTLESS
UART
FIFO
BUFFER
SPI
HOST
001aaj627_1
Fig 1. MF CV520 简图
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NSS/RX
24
D2
D1
25 26
D4
D3
27 28
D5
SCK
29
D6
MOSI
30
D7
MISO
31
PVDD
2
PVSS
5
VOLTAGE
MONITOR
3
DVDD
4
DVSS
FIFO CONTROL
SPI, UART INTERFACE CONTROL
STATE MACHINE
AND
POWER ON
DETECT
15
AVDD
18
AVSS
64-BYTE FIFO
BUFFER
COMMAND REGISTER
RESET
CONTROL
CONTROL REGISTER
BANK
PROGRAMABLE TIMER
INTERRUPT CONTROL
POWER-DOWN
CONTROL
6
NRSTPD
23
IRQ
MIFARE CLASSIC UNIT
CRC16
GENERATION AND CHECK
RANDOM NUMBER
GENERATOR
PARALLEL/SERIAL
CONVERTER
BIT COUNTER
PARITY GENERATION AND CHECK
FRAME GENERATION AND CHECK
BIT DECODING BIT ENCODING
SERIAL DATA SWITCH
7
MFIN
8
MFOUT
9
SVDD
AMPLITUDE
RATING
REFERENCE
VOLTAGE
ANALOG TEST
ANALOG TO DIGITAL
CONVERTER
CLOCK
GENERATION,
FILTERING AND
DISTRIBUTION
Q-CLOCK
GENERATION
21
OSCILLATOR
22
TEMPERATURE
SENSOR
OSCIN
OSCOUT
MULTIPLEXOR
AND
DIGITAL TO
ANALOG
CONVERTER
I-CHANNEL
AMPLIFIER
I-CHANNEL
DEMODULATOR
Q-CHANNEL
AMPLIFIER
Q-CHANNEL
DEMODULATOR
TRANSMITTER CONTROL
16 19 20 17 10, 14 11 13 12
VMID AUX1 AUX2 RX TVSS TX1 TX2 TVDD
001aak602_1
Fig 2. MF CV520 详图
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SVDD
TVSS
TX1
TVDD
TX2
TVSS
AVDD
VMID
9
10
11
12
13
14
15
16
32
31
30
29
28
27
26
25
n.c.
D7/MISO
D6/MOSI
D5/SCK
D4
D3
D2
D1
Contactless reader
IC
7. 引脚信息
n.c.
PVDD
DVDD
DVSS
PVSS
NRSTPD
MFIN
MFOUT
1 24
2 23
3 22
4 21
MF CV520
5 20
6 19
7 18
8 17
NSS
IRQ
OSCOUT
OSCIN
AUX2
AUX1
AVSS
RX
001aaj819_1
Transparent top view
Fig 3. HVQFN32 (SOT617-1)引脚配置
7.1 引脚描述
Table 3. 引脚描述
Pin
符号
Typ
e
[1]
描述
1 n.c.
不连接
2 PVDD P
引脚电源电压
3 DVDD P
数字部分电源电压
4 DVSS G
数字地
[3]
5 PVSS G
引脚电源地
6 NRSTPD I
复位与掉电输入:
掉电:低电平触发;内部灌电流关闭,晶体振荡器停振,输入引脚从外部总线上断开。
复位:上升沿触发。
7 MFIN
I
MIFARE 信号输入
8 MFOUT
O
MIFARE 信号输出
9 SVDD
P
MFIN 和 MFOUT 引脚电源
10 TVSS
G
发送器电源地
11 TX1
O
天线驱动器
12 TVDD
P
发送器电源电压
13 TX2
O
天线驱动器
14 TVSS
G
发送器电源地
15 AVDD
P
模拟部分电源电压
16 VMID
P
内部参考电压
17 RX
I
RF 信号输入
18 AVSS
G
模拟部分电源地
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