MIPI DSI转FLATLINK LVDS单/双链路高速接口转换器

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SN65DSI84是一款高性能的MIPI® DSI桥接器，专为将单通道DSI信号转换为FLATLINK™ LVDS双链路设计。该器件具备以下关键特性： 1. **物理层支持**：它兼容MIPI® D-PHY 1.00.00和1.02.00标准，能够处理高速数据传输，每通道最高可达1Gbps。 2. **多通道配置**：单通道DSI接收器可以灵活配置，支持1、2、3或4条D-PHY数据信道，适应不同分辨率和色彩深度的显示需求。支持的格式包括RGB666和RGB888，适用于18bpp和24bpp的视频数据包。 3. **高分辨率与帧率**：这款产品适用于60fps的WUXGA（1920 x 1200）和1366 x 768分辨率，支持18bpp和24bpp的彩色显示。 4. **FLATLINK™输出**：提供单链路和双链路LVDS的输出选项，允许灵活的系统设计。 5. **时钟选项**：LVDS输出时钟范围宽广，可以从25MHz到154MHz，同时支持自由运行持续D-PHY时钟或外部基准时钟。 6. **低功耗特性**：包含关断模式、低电压摆幅、共模和MIPI超低功耗状态（ULPS），有助于降低功耗。 7. **简化PCB设计**：LVDS通道交换功能（SWAP）和引脚顺序反转特性，方便PCB布线。 8. **ESD保护**：器件具有±2kV的人体放电模式（HBM）静电放电保护，确保设备在环境敏感的应用中安全。 9. **封装与尺寸**：采用64引脚5mm x 5mm BGA(ZQE)封装，紧凑的设计适合小型化应用。 10. **工作温度范围**：SN65DSI84能够在-40°C至85°C的宽温范围内稳定工作。这款IC主要应用于平板电脑、笔记本电脑等移动设备，特别是需要高性能图像传输和低功耗设计的场合，如高清显示屏连接。它的设计和性能特点使其成为现代电子设备中连接DSI和LVDS信号链的重要组件。

SN65DSI84

www.ti.com.cn

ZHCSAU2G –SEPTEMBER 2012–REVISED JUNE 2018

Electrical Characteristics (continued)

over operating free-air temperature range (unless otherwise noted)

PARAMETER TEST CONDITIONS MIN TYP

(1)

MAX UNIT

(3) Tested at V

= 1.8 V , T

= –40°C for MIN, T

= 25°C for TYP, T

= 85°C for MAX.

FLATLINK LVDS OUTPUT

Steady-state differential output voltage for

A_Y x P/N and B_Y x P/N

CSR 0x19.3:2=00 and, or CSR

0x19.1:0=00;

100 Ω near end termination

180 245 313

CSR 0x19.3:2=01 and/or CSR

0x19.1:0=01;

100 Ω near end termination

215 293 372

CSR 0x19.3:2=10 and, or CSR

0x19.1:0=10;

100 Ω near end termination

250 341 430

CSR 0x19.3:2=11 and/or CSR

0x19.1:0=11;

100 Ω near end termination

290 389 488

CSR 0x19.3:2=00 and, or CSR

0x19.1:0=00;

200 Ω near end termination

150 204 261

CSR 0x19.3:2=01 and, or CSR

0x19.1:0=01;

200 Ω near end termination

200 271 346

CSR 0x19.3:2=10 and, or CSR

0x19.1:0=10;

200 Ω near end termination

250 337 428

CSR 0x19.3:2=11 and, or CSR

0x19.1:0=11;

200 Ω near end termination

300 402 511

Steady-state differential output voltage for

A_CLKP/N and B_CLKP/N

CSR 0x19.3:2=00 and, or CSR

0x19.1:0=00

100 Ω near end termination

140 191 244

CSR 0x19.3:2=01 and, or CSR

0x19.1:0=01

100 Ω near end termination

168 229 290

CSR 0x19.3:2=10 and, or CSR

0x19.1:0=10

100 Ω near end termination

195 266 335

CSR 0x19.3:2=11 and, or CSR

0x19.1:0=11

100 Ω near end termination

226 303 381

CSR 0x19.3:2=00 and, or CSR

0x19.1:0=00

200 Ω near end termination

117 159 204

CSR 0x19.3:2=01 and, or CSR

0x19.1:0=01

200 Ω near end termination

156 211 270

CSR 0x19.3:2=10 and, or CSR

0x19.1:0=10

200 Ω near end termination

195 263 334

CSR 0x19.3:2=11 and, or CSR

0x19.1:0=11

200 Ω near end termination

234 314 399

Δ|V

Change in steady-state differential output

voltage between opposite binary states

RL = 100 Ω 35 mV

OC(SS)

Steady state common-mode output

voltage

(3)

CSR 0x19.6 = 1 and CSR 0x1B.6 = 1;

and, or CSR 0x19.4 = 1 and

CSR 0x1B.4 = 1; see Figure 2

0.8 0.9 1

CSR 0x19.6 = 0 and, or CSR 0x19.4 = 0;

see Figure 2

1.15 1.25 1.35

OC(PP)

Peak-to-peak common-mode output

voltage

see Figure 2 35 mV

LVDS_DIS

Pull-down resistance for disabled LVDS

outputs

1 kΩ

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MIPI转双路LVDS方案TC358775XBG规格书

mipi_dsi_specification_v1-2013

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