中国电子竞赛获奖论文：DM54155/DM74155双线到四线解码/多路复用器设计详解
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更新于2024-08-03
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"74155.pdf" 文件主要关注的是关于中国电子设计竞赛中的一篇获奖论文，该论文着重介绍了DM54155/DM74155系列的双线到四线解码器/多路复用器的设计与应用。这些电路是低功耗的TTL（晶体管-晶体管逻辑）器件，它们具有独特的设计，包括两个独立的1线到4线解码器/多路复用器部分，每个部分都有单独的触发信号和共用的二进制地址输入。这些解码器/多路复用器在一个16引脚封装中集成，提供了灵活性和效率。
当两个部分同时由触发信号激活时，共同的地址输入会按顺序选择并路由相应的输入数据到各个部分的适当输出。单个触发信号允许用户选择性地激活或抑制4位的每一个部分。特别值得注意的是，对于输入C1的数据，其输出被反相，而输入C2的数据则是直通的。这使得该器件可以作为一个3到8线解码器或者1到8线多路复用器使用，无需额外的外部控制。
为了减少传输线的影响并简化系统设计，电路中集成了输入钳位二极管。这些特性使得74155/DM74155成为多路选择系统中的理想选择，适用于各种应用场合，例如数据通信、信号处理和接口电路中。论文作者可能在竞赛中展示了如何巧妙地利用这些特性来设计高效、紧凑的解决方案，并可能探讨了它们在解决实际问题中的性能优势和设计策略。
这篇论文不仅提供了技术细节，还可能包含了设计过程、仿真结果以及对其他参赛者或工程师的实用指导，是研究和学习TTL逻辑设计，特别是双线到多线转换电路的理想参考资料。对于参与电子设计的学生和专业人士来说，它无疑是一个值得深入学习和借鉴的资源。"
TL/F/6549
DM54155/DM74155 Dual 2-Line to 4-Line Decoders/Demultiplexers
February 1993
DM54155/DM74155 Dual 2-Line to 4-Line
Decoders/Demultiplexers
General Description
These TTL circuits feature dual 1-line-to-4-line demultiplex-
ers with individual strobes and common binary-address in-
puts in a single 16-pin package. When both sections are
enabled by the strobes, the common address inputs se-
quentially select and route associated input data to the ap-
propriate output of each section. The individual strobes per-
mit activating or inhibiting each of the 4-bit sections as de-
sired. Data applied to input C1 is inverted at its outputs and
data applied at C2 is true through its outputs. The inverter
following the C1 data input permits use as a 3-to-8-line de-
coder, or 1-to-8-line demultiplexer, without external gating.
Input clamping diodes are provided on these circuits to mini-
mize transmission-line effects and simplify system design.
Features
Y
Applications:
Dual 2-to-4-line decoder
Dual 1-to-4-line demultiplexer
3-to-8-line decoder
1-to-8-line demultiplexer
Y
Individual strobes simplify cascading for decoding or
demultiplexing larger words
Y
Input clamping diodes simplify system design
Connection Diagram and Function Tables
Dual-In-Line Package
TL/F/6549–1
Order Number DM54155J, DM54155W or DM74155N
See NS Package Number J16A, N16A or W16A
²
C
e
inputs C1 and C2 connected together
³
G
e
inputs G1 and G2 connected together
H
e
high level, L
e
low level, X
e
don’t care
2-Line-to-4-Line Decoder or
1-Line-to-4-Line Demultiplexer
Inputs Outputs
Select Strobe Data
B A G1 C1 1Y0 1Y1 1Y2 1Y3
XX H X HHHH
LL L H LHHH
LH L HHLHH
HL L H HHLH
HH L H HHHL
XX X L HHHH
Inputs Outputs
Select Strobe Data
B A G2 C2 2Y0 2Y1 2Y2 2Y3
XX H X HHHH
LL L L LHHH
LH L L HLHH
HL L L HHLH
HH L L HHHL
XX X H HHHH
3-Line-to-8-Line Decoder or
1-Line-to-8-Line Demultiplexer
Inputs Outputs
Select
Strobe
(0) (1) (2) (3) (4) (5) (6) (7)
Or Data
C
²
BA G
³
2Y0 2Y1 2Y2 2Y3 1Y0 1Y1 1Y2 1Y3
XXX H HHHHHHHH
LLL L LHHHHHHH
LLH L HLHHHHHH
LHL L HHLHHHHH
LHH L HHHLHHHH
HLL L HHHHLHHH
HLH L HHHHHLHH
HHL L HHHHHHLH
HHH L HHHHHHHL
C
1995 National Semiconductor Corporation RRD-B30M105/Printed in U. S. A.
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