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兰州交通大学毕业设计（论文）
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Candence 公司是一家著名的 EDA 公司，财力雄厚。该公司的 Verilog HDL 于 1983
年由 Gate Way Design Automatic 公司的 Phil Moorby 首创。他在 1984-1985 年间成功设
计了 Verilog-XL 仿真器，于 1986 年提出了快速门级仿真的 XL 算法，使 Verilog HDL
语言变得更加丰富和完善，从而受到了 EDA 工具设计公司的青睐。1989 年 Candence 公
司购买了 GDA 公司，Verilog HDL 语言从此变为 Candence 公司的“私有财产”成为
Candence 公司的 EDA 设计环境上的硬件描述语言。经过 Candence 公司的努力，
Verilog HDL 于 1995 年成为 IEEE 标准，也是民间公司第一个硬件描述语言标准，即
Verilog HDL 1364-1995。由于 Verilog HDL 语言从 C 语言发展来，所以有 C 语言基础的
设计人员能够较快入门。
ALTERA 公司是一家半导体器件公司，其 CPLD 器件在世界市场上占主导地位。
这家公司不仅是硬件生产厂商，也是 EDA 工具开发商，它的 EDA 工具 MAX+plus II、
Quartus 由于人机界面友好、易于使用、性能优良，而受到 FPGA、CPLD 器件设计人员
的欢迎。运行在 MAX+plus II 环境下的 VHDL 语言具有 C 语言设计风格，好学好用，
因此被众多用户使用。
HDL 语言来自不同地方，由不同语言演变而来，为了各平台之间相互转换，又推
出了 EDIF (Electronic Design Interchange Format)。它不是一种语言，而是用于不同数据
格式的 EDA 工具之间的交换设计数据。
2.1.2 VHDL 语言的优点
传统的硬件电路设计方法是采用自下而上的设计方法，即根据系统对硬件的要求，
详细编制技术规格书，并画出系统控制流图；然后根据技术规格书和系统控制流图，对
系统的功能进行细化，合理地划分功能模块，并画出系统的功能框图；接着就进行各功
能模块的细化和电路设计；各功能模块电路设计、调试完成后，将各功能模块的硬件电
路连接起来再进行系统的调试，最后完成整个系统的硬件设计。采用传统方法设计数字
系统，特别是当电路系统非常庞大时，设计者必须具备较好的设计经验，而且繁杂多样
的原理图的阅读和修改也给设计者带来诸多的不便。为了提高开发的效率，增加已有开
发成果的可继承性以及缩短开发周期，各 ASIC 研制和生产厂家相继开发了具有自己特
色的电路硬件描述语言(Hardware Description Language，简称 HDL)。但这些硬件描述
语言差异很大，各自只能在自己的特定设计环境中使用，这给设计者之间的相互交流带
来了极大的困难。因此，开发一种强大的、标准化的硬件描述语言作为可相互交流的设
计环境已势在必行。于是，美国于 1981 年提出了一种新的、标准化的 HDL，称之为
VHSIC（Very High Speed Integrated Circuit）Hardware Description Language，简称 VHDL。
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