TMS320VC55x DSP McBSP参考指南

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"TMS320VC5501/5502/5503/5507/5509/5510 DSP 多通道缓冲串行端口（McBSP）参考指南" 这篇文档是关于TMS320VC5501、5502、5503、5507、5509以及5510系列数字信号处理器（DSP）的多通道缓冲串行端口（Multichannel Buffered Serial Port，简称McBSP）的详细参考指南。McBSP是一种在TMS320C55x DSP上常见的串行接口，它允许处理器与其他系统中的设备进行直接的串行通信。这个接口对于各种实时音频、视频和其他串行数据传输应用非常有用。在每个特定的TMS320C55x设备上，McBSP的数量可能会有所不同，具体的配置信息需要查阅对应的设备特定数据手册。例如，TMS320VC5509不仅指代5509系列设备，也包括5509A系列设备。文档中采用了特定的表示法来帮助读者理解。比如，十六进制数字通常会以后缀"h"表示，如40h代表十进制的64。同样，二进制数字常以后缀"b"表示，例如0100b即为十进制的4。此外，信号或引脚如果是低电平有效，则会标有横线，例如"RESET"信号在低电平时为有效状态。相关的德州仪器（Texas Instruments）文档可能还包括其他与TMS320C55x系列DSP开发和应用相关的技术资料。这些文档可能涵盖硬件设计、编程模型、外围接口、调试工具等多个方面，是深入理解和利用这些DSP芯片的关键资源。 McBSP的功能特性通常包括可配置的数据帧格式、时钟源选择、同步模式、数据速率设定、流控选项等。用户可以通过配置McBSP的寄存器来适应不同应用的需求，例如音频编解码、传感器接口、总线通信等。同时，McBSP还支持多种通信协议，如I2S、SPI和PCM等，这使得它成为嵌入式系统中连接不同模块的理想选择。在实际应用中，开发者需要了解McBSP的工作原理，包括其输入/输出时钟（XCLK, FSR, FSRCLK）、数据线（DIN, DOUT）、帧同步信号（FSX, FSR）以及控制信号（CLR, XFR, SCLK）。此外，正确设置McBSP的寄存器以匹配连接设备的参数也是至关重要的，例如采样率、位深度、数据格式等。本参考指南将详细阐述McBSP的架构、操作模式、配置选项以及编程接口，提供实例代码和故障排查指南，帮助工程师有效地利用这一强大的串行通信接口。对于那些需要在TMS320C55x平台上开发高效串行通信解决方案的开发者来说，这是一份不可或缺的参考资料。

Tables

xviiContents

7−22 Register Bits Used to Set the SRG Frame-Sync Period and Pulse Width 7-29. . . . . . . . . . . .

7−23 Register Bits Used to Set the Receive Clock Mode 7-31. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7−24 Select Sources to Provide the Receive Clock Signal and the Effect on the

CLKR Pin 7-33. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7−25 Register Bit Used to Set Receive Clock Polarity 7-34. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7−26 Register Bits Used to Set the Sample Rate Generator (SRG) Clock

Divide-Down Value 7-37. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

7−27 Register Bit Used to Set the SRG Clock Synchronization Mode 7-39. . . . . . . . . . . . . . . . . . . .

7−28 Register Bits Used to Set the SRG Clock Mode (Choose an Input Clock) 7-40. . . . . . . . . . . .

7−29 Register Bits Used to Set the SRG Input Clock Polarity 7-41. . . . . . . . . . . . . . . . . . . . . . . . . . .

8−1 Register Bits Used to Place Transmitter in Reset 8-4. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8−2 Reset State of Each McBSP Pin 8-5. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8−3 Register Bit Used to Set Transmitter Pins to Operate as McBSP Pins 8-6. . . . . . . . . . . . . . . .

8−4 Register Bit Used to Enable/Disable the Digital Loopback Mode 8-7. . . . . . . . . . . . . . . . . . . . .

8−5 Receive Signals Connected to Transmit Signals in Digital Loopback Mode 8-7. . . . . . . . . . . .

8−6 Register Bits Used to Enable/Disable the Clock Stop Mode 8-8. . . . . . . . . . . . . . . . . . . . . . . . .

8−7 Register Bits Used to Enable/Disable Transmit Multichannel Selection 8-9. . . . . . . . . . . . . . .

8−8 Register Bit Used to Choose One or Two Phases for the Transmit Frame 8-10. . . . . . . . . . . .

8−9 Register Bits Used to Set the Transmit Word Length(s) 8-11. . . . . . . . . . . . . . . . . . . . . . . . . . .

8−10 Register Bits Used to Set the Transmit Frame Length 8-13. . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8−11 How to Calculate Frame Length 8-14. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8−12 Register Bit Used to Enable/Disable the Transmit Frame-Sync Ignore Function 8-15. . . . . .

8−13 Register Bits Used to Set the Transmit Companding Mode 8-16. . . . . . . . . . . . . . . . . . . . . . . .

8−14 Register Bits Used to Set the Transmit Data Delay 8-17. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8−15 Register Bit Used to Set the Transmit DXENA (DX Delay Enabler) Mode 8-20. . . . . . . . . . . .

8−16 Register Bits Used to Set the Transmit Interrupt Mode 8-21. . . . . . . . . . . . . . . . . . . . . . . . . . . .

−17 Register Bits Used to Set the Transmit Frame-Sync Mode 8-22. . . . . . . . . . . . . . . . . . . . . . . . .

8−18 How FSXM and FSGM Select the Source of Transmit Frame-Sync Pulses 8-23. . . . . . . . . . .

8−19 Register Bit Used to Set Transmit Frame-Sync Polarity 8-24. . . . . . . . . . . . . . . . . . . . . . . . . . .

8−20 Register Bits Used to Set the SRG Frame-Sync Period and Pulse Width 8-27. . . . . . . . . . . .

8−21 Register Bit Used to Set the Transmit Clock Mode 8-29. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8−22 How the CLKXM Bit Selects the Transmit Clock and the Corresponding Status

of the CLKX Pin 8-29. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8−23 Register Bit Used to Set Transmit Clock Polarity 8-31. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8−24 Register Bits Used to Set the Sample Rate Generator (SRG) Clock

Divide-Down Value 8-34. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

8−25 Register Bit Used to Set the SRG Clock Synchronization Mode 8-36. . . . . . . . . . . . . . . . . . . .

8−26 Register Bits Used to Set the SRG Clock Mode (Choose an Input Clock) 8-37. . . . . . . . . . . .

8−27 Register Bits Used to Set the SRG Input Clock Polarity 8-38. . . . . . . . . . . . . . . . . . . . . . . . . . .

9−1 How To Use McBSP Pins for General-Purpose I/O 9-3. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

10−1 McBSP Emulation Modes Selectable With the FREE and SOFT Bits of SPCR2 10-2. . . . . .

10−2 Reset State of Each McBSP Pin 10-5. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−1 SPCR1 Bit Descriptions 12-5. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−2 SPCR2 Bit Descriptions 12-9. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−3 RCR1 BIt Descriptions 12-14. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

Tables

xviii

12−4 RCR2 Bit Descriptions 12-16. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−5 XCR1 Bit Descriptions 12-20. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−6 XCR2 Bit Descriptions 12-22. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−7 SRGR1 Bit Descriptions 12-26. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−8 SRGR2 Bit Descriptions 12-28. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−9 MCR1 Bit Descriptions 12-32. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−10 MCR2 Bit Descriptions 12-35. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−11 PCR Bit Descriptions 12-39. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−12 Description For Bit x of a Receive Channel Enable Register

(x = 0, 1, 2, ..., or 15) 12-46. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−13 Use of the Receive Channel Enable Registers 12-47. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−14 Description For Bit x of a Transmit Channel Enable Register

(x = 0, 1, 2, ..., or 15) 12-50. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

12−15 Use of the Transmit Channel Enable Registers in a Transmit Multichannel

Selection Mode 12-51. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

A−1 Document Revision History A-1. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .

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