已知某S3C2440微处理器使用12MHz晶体振荡器作为输入时钟源，且寄存器CLKDIVN=0x03, MPLLCON=0x52031, 试计算FCLK、HCLK和PCLK的频率。

根据S3C2440的时钟结构，FCLK=输入时钟源频率×MPLL倍频器输出频率分频器的分频比，HCLK=FCLK÷HCLK分频比，PCLK=FCLK÷PCLK分频比。

首先计算MPLL倍频器输出频率，根据MPLLCON的设置，可以得到MPLL倍频器输出频率为：

MPLL倍频器输出频率 = 12MHz × (0x31 + 0.5) / ((0x520 >> 4) & 0x3F + 1) = 405MHz

然后计算FCLK：

FCLK = 12MHz × 405MHz / (0x03 + 1) = 1.62GHz

接下来计算HCLK和PCLK：

HCLK = FCLK ÷ (0x01 + 1) = 810MHz

PCLK = FCLK ÷ (0x03 + 1) = 405MHz

因此，经过计算得到：FCLK的频率为1.62GHz，HCLK的频率为810MHz，PCLK的频率为405MHz。

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根据寄存器 CLKDIVN=0x03，PCLK 等于 HCLK 除以 2，所以先要计算 HCLK 的频率。根据公式 HCLK = FCLK / (HCLKDIV × PCLKDIV)，其中 HCLKDIV 和 PCLKDIV 都等于 2，代入 MPLLCON=0x52031 计算可得 FCLK 等于 256MHz，所以 HCLK 等于 128MHz，PCLK 等于 64MHz。