always@（*）的时序图

always@(*)描述的是组合逻辑，它不受时钟触发（posedge clk）或复位信号（negedge rst_n）的影响，只要任何与其相关的输入信号发生变化，always@(*)块就会被激活。在给定条件下，它会根据条件执行相应的语句并更新输出信号。

对于给定的测试文件中always@(*)的代码段：

always @(*)
begin
    if(rst_n == 'b0)
    begin
        c = 'b0;
        cc = 'b0;
    end
    else
    begin
        c = 'b1;
        cc = c;
    end
end

这段代码描述了一个组合逻辑，当复位信号rst_n为低电平时，输出信号c和cc都为低电平；当复位信号为高电平时，输出信号c为高电平，并且cc等于c。

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