makefile中输出当前路径

时间: 2024-09-06 22:02:32 浏览: 44

GNU_makefile中文手册

### GNU_makefile中文手册知识点概览 #### 一、GNU Make工具概述 GNU Make是一款功能强大的自动化构建工具，主要用于组织程序和其他软件项目的编译过程。它通过读取一个名为Makefile（或类似名称的文件）来确定如何构建最终的可执行文件或其他目标文件。 ##### 1.1 概述 GNU Make的核心思想是根据文件的修改时间来决定哪些文件需要重新编译或链接。这极大地简化了大型项目中的构建流程，并提高了开发效率。Makefile文件定义了一系列规则，这些规则指定了构建过程中各个步骤之间的依赖关系和执行命令。 ##### 1.2 准备知识在深入学习GNU Make之前，建议了解以下基础知识： - **基本的命令行操作**：熟悉Unix/Linux或Windows命令行界面。 - **文本编辑器**：能够使用如vi、emacs等文本编辑器编辑Makefile文件。 - **编程语言**：了解至少一种编程语言，有助于理解Makefile中的逻辑。 #### 二、GNU Make介绍 ##### 2.1 Makefile简介 Makefile是GNU Make用来指导构建过程的主要配置文件。它通常包含了各种规则和变量定义，用于描述项目中各个文件之间的依赖关系以及如何生成这些文件所需的命令。 - **规则**：指定如何生成某个文件，包括该文件的依赖项及其生成命令。 - **变量**：用于存储路径、文件名等信息，提高Makefile的可维护性和复用性。 ##### 2.2 Makefile规则介绍规则是Makefile中最基本的组成部分，其格式如下： ``` target : prerequisites command ``` - `target`：规则的目标，通常是需要创建的文件。 - `prerequisites`：生成目标所需的依赖文件。 - `command`：当目标比依赖项旧时需要执行的命令。 ##### 2.3 简单的示例假设有一个简单的C语言项目，包含一个源文件`main.c`和头文件`header.h`，我们可以通过以下Makefile来构建项目： ```make all: main.o gcc -o main main.o main.o: main.c header.h gcc -c main.c ``` 此Makefile定义了一个规则`main.o`，它依赖于`main.c`和`header.h`，并且定义了如何生成`main.o`。另一个规则`all`则定义了如何生成最终的可执行文件`main`。 ##### 2.4 make如何工作 - **加载Makefile**：make程序首先加载并解析Makefile文件。 - **解析规则**：根据Makefile中的规则，make程序确定需要构建哪些目标文件。 - **执行命令**：对于每个需要构建的目标，make会按照定义的规则执行相应的命令。 ##### 2.5 指定变量变量是Makefile中非常重要的组成部分，可以存储各种信息，例如文件名、路径等。它们可以通过以下方式定义： - **简单赋值**：`VARIABLE = value` - **递归展开**：`VARIABLE := value` - **覆盖赋值**：`VARIABLE += value` 例如： ```make CC = gcc CFLAGS = -Wall all: main.o $(CC) -o main main.o $(CFLAGS) ``` 在此示例中，`CC`变量存储了编译器的名称，`CFLAGS`变量存储了编译选项。 ##### 2.6 自动推导规则 GNU Make支持自动推导规则，即基于文件扩展名来自动推断出构建目标的方法。例如，如果Makefile中定义了`.c.o`的规则，那么对于所有`.c`文件，make将自动应用这个规则来生成对应的`.o`文件。 ##### 2.7 另类风格的makefile 除了传统的Makefile格式外，还可以使用不同的风格来编写Makefile。例如，使用递归make方法来处理子目录下的构建任务。 ##### 2.8 清除工作目录过程文件通常还需要定义一个`clean`目标来清理生成的中间文件，以便进行下一次构建： ```make clean: rm -f *.o main ``` #### 三、Makefile总述 ##### 3.1 Makefile的内容 Makefile文件通常包含以下内容： - **变量定义**：存储常用的文件路径、编译选项等。 - **规则**：描述文件之间的依赖关系及构建命令。 - **目标**：指定最终需要构建的文件。 ##### 3.2 makefile文件的命名 Makefile文件通常命名为`Makefile`或`makefile`。此外，还可以使用其他名称，只要在调用make时指定即可： ```sh make -f mymakefile ``` ##### 3.3 包含其它makefile文件可以使用`include`指令来引入其他Makefile文件： ```make include common.mk ``` ##### 3.4 变量MAKEFILES `MAKEFILES`变量用于指定包含的Makefile文件列表，可以用于追踪包含关系。 ##### 3.5 变量MAKEFILE_LIST `MAKEFILE_LIST`变量包含了所有被make加载的Makefile文件列表。 ##### 3.6 其他特殊变量还有许多其他特殊变量可用于Makefile中，如`@`表示当前规则的目标，`$^`表示所有依赖项等。 ##### 3.7 makefile文件的重建如果Makefile文件本身发生了变化，则需要重新构建整个项目以确保所有规则得到正确更新。 ##### 3.8 重载另外一个makefile 可以通过在Makefile中使用`include`指令来重载另一个Makefile文件。 ##### 3.9 make如何解析makefile文件 - **变量取值**：根据变量定义的方式，make会在不同的阶段对变量进行展开。 - **条件语句**：允许根据条件来控制规则的执行。 - **规则的定义**：定义了目标文件的生成过程。 #### 四、Makefile的规则 ##### 4.1 一个例子通过示例来理解规则的定义和使用，如前面提到的C语言项目Makefile。 ##### 4.2 规则语法规则的一般格式如前所述，其中`target`可以是文件名或伪目标。 ##### 4.3 依赖的类型依赖项可以分为直接依赖和间接依赖。直接依赖是指在规则中明确列出的依赖项，而间接依赖则是通过自动推导规则获得的依赖。 ##### 4.4 文件名使用通配符通配符（如`*`和`?`）可以用于匹配文件名。例如，`*.o`可以匹配所有以`.o`结尾的文件。 ##### 4.5 目录搜寻通过`VPATH`变量可以指定搜索依赖文件的路径，这对于处理跨目录的依赖关系特别有用。 ##### 4.6 Makefile伪目标伪目标是指不对应于任何实际文件的目标，通常用于定义一系列命令的集合，如`all`、`clean`等。 ##### 4.7 强制目标强制目标是指没有命令或依赖的目标，它们总是被视为“过时”的，因此总是会被重新构建。 ##### 4.8 空目标文件空目标文件是指没有命令的目标，它们在Makefile中仅作为占位符存在。 ##### 4.9 Makefile的特殊目标有些目标具有特殊的含义，例如`.PHONY`用于定义伪目标，`.SUFFIXES`用于指定后缀转换规则等。 ##### 4.10 多目标一个规则可以有多个目标，这样可以方便地一次性构建多个文件。 ##### 4.11 多规则目标有时，同一个目标可能出现在多个规则中，这种情况下需要特别注意规则的优先级问题。 ##### 4.12 静态模式静态模式是一种特殊的规则形式，允许使用通配符来匹配目标和依赖项，从而简化规则的编写。 ##### 4.13 双冒号规则双冒号规则用于定义多个规则指向同一目标的情况，这有助于避免规则冲突。 ##### 4.14 自动产生依赖对于某些编译器，可以使用`-M`选项来自动生成依赖关系，然后将其写入Makefile中。 #### 五、规则的命令 ##### 5.1 命令回显在Makefile中可以使用`@echo`命令来输出信息，这有助于调试Makefile。 ##### 5.2 命令的执行 make会按照规则中的顺序执行命令，除非目标文件已经是最新的。 ##### 5.3 并发执行命令通过指定`-j`选项，可以在多个CPU核心上并行执行命令。 ##### 5.4 命令执行的错误 make会捕获命令执行时发生的错误，并停止后续的构建过程。 ##### 5.5 中断make的执行使用`-k`选项可以使make在遇到错误时继续执行其他规则。 ##### 5.6 make的递归执行通过在Makefile中调用`make`命令可以实现递归构建，这对于处理复杂项目结构很有帮助。 ##### 5.7 定义命令包可以将一组相关的命令封装成一个命令包，以便重复使用。 ##### 5.8 空命令有时候，为了满足规则的格式要求，需要在命令部分定义一个空命令。 #### 六、Makefile中的变量 ##### 6.1 变量的引用变量的引用使用`$()`或`${}`语法，例如`$(VAR)`。 ##### 6.2 两种变量定义（赋值）变量可以通过简单赋值或递归展开来定义，具体取决于使用的场景。 ##### 6.3 变量的高级用法变量可以用作其他变量的一部分，或者用于定义复杂的表达式。 ##### 6.4 变量取值变量在不同阶段的取值方式可能会有所不同，这取决于变量的定义方式。 ##### 6.5 如何设置变量变量可以通过Makefile内部定义、命令行参数等方式设置。 ##### 6.6 追加变量值可以使用`+=`运算符来追加变量的值。 ##### 6.7 override指示符使用`override`关键字可以改变变量的默认行为。 ##### 6.8 多行定义变量定义可以跨越多行，这有助于提高Makefile的可读性。 ##### 6.9 系统环境变量 Makefile可以访问系统环境变量，并将其用作变量值。 ##### 6.10 目标指定变量可以为特定的目标定义变量，使得变量的值依赖于当前构建的目标。 ##### 6.11 模式指定变量模式指定变量允许根据目标或依赖项的模式来定义变量。 #### 七、Makefile的条件执行 ##### 7.1 一个例子通过示例来理解如何在Makefile中使用条件语句。 ##### 7.2 条件判断的基本语法可以使用`ifeq`、`ifdef`等命令来进行条件判断。 ##### 7.3 标记测试的条件语句通过使用`$(shell ...)`函数可以执行外部命令并获取结果，用于复杂的条件判断。 #### 八、make的内嵌函数 ##### 8.1 函数的调用语法 make提供了多种内置函数，用于文本处理、字符串操作等。 ##### 8.2 文本处理函数 - `$(subst FROM,TO,TEXT)`：替换字符串。 - `$(patsubst PATTERN,REPLACEMENT,TEXT)`：模式替换。 - `$(strip STRINT)`：去除字符串两侧的空白字符。 - `$(findstring FIND,IN)`：查找字符串。 - `$(filter PATTERN,LIST)`：筛选字符串列表。通过以上内容，我们可以了解到GNU Make是一个功能强大且灵活的自动化构建工具，它通过Makefile文件定义构建规则和依赖关系，极大地简化了大型项目的构建流程。掌握了Makefile的基础知识后，可以更加高效地管理项目构建过程。

在Makefile中输出当前路径通常指的是获取Makefile所在的目录路径，这可以通过特殊变量`$(CURDIR)`来实现，该变量在Makefile执行时自动设置为当前工作目录的绝对路径。例如，你可以在Makefile中添加一个规则来输出当前路径： ```makefile .PHONY: show-current-dir show-current-dir: @echo "当前路径是: $(CURDIR)" ``` 上述规则定义了一个目标`show-current-dir`，当执行`make show-current-dir`时，它会使用`echo`命令输出当前的工作目录路径。这里的`@`符号用来抑制命令本身的输出，只显示命令执行的结果。如果你想获取相对路径，可以使用`$(shell pwd)`命令来执行shell中的`pwd`命令，获取当前目录的路径。 ```makefile .PHONY: show-relative-dir show-relative-dir: @echo "当前路径是: $(shell pwd)" ``` 执行`make show-relative-dir`同样会输出当前目录的路径，这个输出将是相对于文件系统根目录的绝对路径。

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