*** error 129: Trace is disabled!
时间: 2024-03-11 20:41:48 浏览: 19
*** error 129: Trace is disabled! 是一个错误消息,它在代码中禁用了跟踪功能。踪是一种用于记录程序执行程中的信息的技术,它可以帮助开发人员调试和定位问题。当出现这个错误消息时,意味着程序中跟踪功能被关闭或者未正确启。
解决这个问题,你可以尝试以下几个步骤:
1. 检代码中的跟踪设置:查看代码中是否有禁用跟踪的设置,例如在代码中搜索 "Trace is disabled" 或者类似的关键字,确认是否有相关的配置或者条件语句导致跟踪被禁用。
2. 检查编译选项:如果你是在编译代码时遇到这个错误,检查编译选项是否正确设置。有些编译器可能有特定的选项来启用或禁用跟踪功能,确保你使用了正确的选项。
3. 检查日志设置:如果你的程序有日志记录功能,确保日志记录功能已经正确启用,并且日志级别设置为允许跟踪信息的记录。
4. 检查相关文档或资源:如果以上步骤都没有解决问题,建议查阅相关文档或资源,例如程序框架或库的官方文档,以了解更多关于跟踪功能的配置和使用方法。
希望以上信息对你有帮助!如果还有其他问题,请随时提问。
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void SOSC_init_8MHz(void) { SCG->SOSCDIV = 0x00000101; /* SOSCDIV1 & SOSCDIV2 =1: divide by 1 */ SCG->SOSCCFG = 0x00000024; /* Range=2: Medium freq (SOSC between 1MHz-8MHz)*/ // SCG->SOSCCFG = 0x00000034; /* Range=3: High freq (SOSC between 8MHz-40MHz)*/ /* HGO=0: Config xtal osc for low power */ /* EREFS=1: Input is external XTAL */ while(SCG->SOSCCSR & SCG_SOSCCSR_LK_MASK); /* Ensure SOSCCSR unlocked */ SCG->SOSCCSR = 0x00000001; /* LK=0: SOSCCSR can be written */ /* SOSCCMRE=0: OSC CLK monitor IRQ if enabled */ /* SOSCCM=0: OSC CLK monitor disabled */ /* SOSCERCLKEN=0: Sys OSC 3V ERCLK output clk disabled */ /* SOSCLPEN=0: Sys OSC disabled in VLP modes */ /* SOSCSTEN=0: Sys OSC disabled in Stop modes */ /* SOSCEN=1: Enable oscillator */ while(!(SCG->SOSCCSR & SCG_SOSCCSR_SOSCVLD_MASK)); /* Wait for sys OSC clk valid */ } void SPLL_init_160MHz(void) { while(SCG->SPLLCSR & SCG_SPLLCSR_LK_MASK); /* Ensure SPLLCSR unlocked */ SCG->SPLLCSR = 0x00000000; /* SPLLEN=0: SPLL is disabled (default) */ SCG->SPLLDIV = 0x00000302; /* SPLLDIV1 divide by 2; SPLLDIV2 divide by 4 */ SCG->SPLLCFG = 0x00180000; /* PREDIV=0: Divide SOSC_CLK by 0+1=1 */ /* MULT=24: Multiply sys pll by 4+24=40 */ /* SPLL_CLK = 8MHz / 1 * 40 / 2 = 160 MHz */ while(SCG->SPLLCSR & SCG_SPLLCSR_LK_MASK); /* Ensure SPLLCSR unlocked */ SCG->SPLLCSR = 0x00000001; /* LK=0: SPLLCSR can be written */ /* SPLLCMRE=0: SPLL CLK monitor IRQ if enabled */ /* SPLLCM=0: SPLL CLK monitor disabled */ /* SPLLSTEN=0: SPLL disabled in Stop modes */ /* SPLLEN=1: Enable SPLL */ while(!(SCG->SPLLCSR & SCG_SPLLCSR_SPLLVLD_MASK)); /* Wait for SPLL valid */ }
这段代码是用来初始化系统时钟的。它使用了片上系统时钟(SOSC)和系统锁相环(SPLL)来生成一个160MHz的时钟信号。
首先,`SOSC_init_8MHz`函数初始化了片上系统时钟。通过设置`SCG->SOSCDIV`将SOSCDIV1和SOSCDIV2都设置为1,表示不进行分频。然后,通过设置`SCG->SOSCCFG`的Range字段为2,选择了中频范围(1MHz-8MHz)。接下来,解锁`SCG->SOSCCSR`,将其设置为0x00000001,使得SOSCCSR可以被写入。然后,等待`SCG->SOSCCSR`的SOSCVLD字段为1,表示系统时钟已经有效。
接下来,`SPLL_init_160MHz`函数初始化了系统锁相环。首先,解锁`SCG->SPLLCSR`,将其设置为0x00000000,将SPLLEN字段置为0,禁用SPLL。然后,设置`SCG->SPLLDIV`将SPLLDIV1设置为2,SPLLDIV2设置为4,进行分频。接着,设置`SCG->SPLLCFG`的PREDIV字段为0,将SOSC_CLK除以1。最后,再次解锁`SCG->SPLLCSR`,将其设置为0x00000001,使得SPLLCSR可以被写入。然后,等待`SCG->SPLLCSR`的SPLLVLD字段为1,表示系统锁相环已经有效。
综上所述,这段代码的作用是将片上系统时钟和系统锁相环配置为特定的频率,以生成一个160MHz的时钟信号。
** error (suppressible): (vsim-12110) all optimizations are disabled because
这个错误表示由于某种原因,VSIM仿真器已经禁用了所有优化。优化通常用于提高仿真性能和减少资源占用,但在某些情况下可能会导致错误或不正确的仿真结果。因此,当发生某些特定情况时,VSIM将禁用所有优化。
造成禁用优化的原因可能是因为代码中包含了一些特定的语法结构、功能或指令,这些部分可能会与优化技术产生冲突,导致不可预测的结果。因此,为了避免潜在的错误,VSIM选择禁用所有优化。
解决这个问题的方法通常涉及到检查代码中可能引起冲突的部分,有时可能需要根据VSIM提供的文档或支持来调整代码结构或设置。另外,还可以尝试使用其他仿真工具或更新版本的VSIM来解决这个问题。
在处理这个错误的过程中,需要特别注意确保仿真结果的准确性和稳定性,以及对影响仿真性能的因素进行适当的调整和优化。最终目标是能够正常运行仿真并得到准确的结果,同时提高仿真的效率和可靠性。