用Verilog语言设计一个1100二进制序列检测器，串行输入，从高位开始。

好的，我会按照你的要求回答问题。

以下是一个简单的Verilog代码，用于检测1100二进制序列：

module sequence_detector(input clk, input reset, input data, output reg detected);

  reg [3:0] shift_reg;

  always @(posedge clk) begin
    if(reset) begin
      shift_reg <= 4'b0000;
      detected <= 0;
    end
    else begin
      shift_reg <= {shift_reg[2:0], data};
      detected <= (shift_reg == 4'b1100);
    end
  end

endmodule

这个序列检测器有一个时钟输入 `clk`、一个异步复位输入 `reset`、一个串行数据输入 `data` 和一个输出 `detected`，用于指示输入序列中是否检测到了1100。检测器从高位开始检测，如果检测到了1100，输出 `detected` 将会被置为1。

当 `reset` 为1时，检测器会将移位寄存器清零，并将 `detected` 置为0。当 `reset` 为0时，检测器会将 `shift_reg` 向左移动一位，并将 `data` 放到最右边。然后，它会检查移位寄存器中的值是否等于 `4'b1100`，如果是，它会将 `detected` 置为1。

请注意，这只是一个简单的示例，实际的序列检测器可能需要更复杂的逻辑来处理不同的输入数据和时序。