DSP中的一种降低中的一种降低DSP芯片总线功耗的方案芯片总线功耗的方案
1 引言 近年来,人们越来越重视降低总线功耗。在DSM总线的线间电容的模型下,提出了一些编码算法
和译码器,并且通过在采用RISC体系结构处理器的芯片上试验取得了较好的效果,其中比较有代表性的有
Bus2Invert Code译码器、T0 Code译码器等。 (1)Bus2Invert Code译码器 定义总线的宽度是N, b ( t)
为内核MCU计算出来的t时刻总线数据(即编码前的数据) , B ( t)是t时刻已放到总线上的数据(即编码后的数据)
, J ( t)是解码器解码后的数据, H ( t)是指b ( t)和b ( t-1)的Hamming Distance。总线传输
1 引言 引言
近年来,人们越来越重视降低总线功耗。在DSM总线的线间电容的模型下,提出了一些编码算法和译码器,并且通过在采用RISC体系结构处理器的芯
片上试验取得了较好的效果,其中比较有代表性的有Bus2Invert Code译码器、T0 Code译码器等。
(1)Bus2Invert Code译码器译码器
定义总线的宽度是N, b ( t)为内核MCU计算出来的t时刻总线数据(即编码前的数据) , B ( t)是t时刻已放到总线上的数据(即编码后的数据) , J ( t)是解
码器解码后的数据, H ( t)是指b ( t)和b ( t-1)的Hamming Distance。总线传输数据时,相邻两次读取的数据都是确定的,因此可以确定两次数据b ( t)和b (
t-1)的Hamming Distance,如果2 ×H ( t) >N ,这说明总线上有超过一半的信号需要翻转,这时如果将第二次传输的数据逐位取反再传输,就可以减少信号
翻转的次数。这种译码器适用于数据总线,可以在数据总线上传输随机数据时大幅降低的功耗,但对于随机性不强的地址总线的优化不明显。
(2) T0 Code译码器译码器
在设计中采用T0编码的译码器和解码器,可以达到最低的功耗。前提的以下这种情况,数据都是以同样的间隔的无限序列,T0 编码可以使得在总线上
传输这些数据时,总线上没有出现翻转。译码器则对于有规律性变化的地址总线的优化非常显着,而对随机性较大的数据总线的功耗降低没有什么帮助。
由于DSP处理器与通用处理器的体系结构的差异,所以决定了一些适用于通用处理器的方法并不一定适用于DSP处理器,上面的方法还未应用在DSP
处理器中。
然而DSP处理器的独特构造也为DSP处理器的低功耗总线设计提供了条件。
2 总线模型 总线模型
在芯片到达了深亚微米级时,总线功耗已经成为一个重要的问题,总线功耗的降低对于芯片整体的功耗降低已经越来越重要,所以在DSM下建立一个
合理的总线模型是首先要解决的问题。
图1是在文献中由Paul P. Sotiriadis和Anantha P. Chandrakasan提出的一个DSM总线的线间电容的模型。从图1可以看出,当达到深亚微米级时,总线
模型已经与以往的模型发生了较大的变化,我们必须细致的考虑线间的电感效应,因此,图1模型具有较好的说明性。实际中,用到的是如图2所示经过简
化的模型。
用式(1)和式(2)表示在不同时刻第i根总线上的电压:
其中T表示总线上的时钟周期,Vinew表示第i根总线上的电压(0或者是Vdd ) ,Vi ( x, t)表示t时刻上第i根总线上的电压值,而当一根总线的电压发生
变化时,其消耗的能量可以计算出为 Ei=∫T 0VddIi( x)dx,
而全部n根总线上的消耗的功耗为E = ∑Ei ,由此可以用矩阵的写法式(3)和式(4)来表示