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80-Y0619-1 Rev. J Confidential – Qualcomm Technologies, Inc. and/or its affiliated companies – May Contain Trade Secrets 16
MAY CONTAIN U.S. AND INTERNATIONAL EXPORT CONTROLLED INFORMATION
QCA8334 Four-port Gigabit Ethernet Switch Device Specification Contents
Table 5-26 PORT2_STATUS bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94
Table 5-27 PORT 3_STATUS bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95
Table 5-28 PORT 6_STATUS bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 96
Table 5-29 HEADER_CTRL bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97
Table 5-30 PORT0_HEADER_CTRL bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97
Table 5-31 PORT 2_HEADER_CTRL bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98
Table 5-32 PORT3_HEADER_CTRL bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 99
Table 5-33 PORT6_HEADER_CTRL bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 99
Table 5-34 SGMII debug 1 register bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 100
Table 5-35 SGMII_CTRL bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 100
Table 5-36 MAC_PWR_SEL bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 102
Table 5-37 EEE control register summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103
Table 5-38 EEE_CTRL bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103
Table 5-39 EEE_LOC_VALUE_2 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104
Table 5-40 EEE_REM_VALUE_2 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104
Table 5-41 EEE_RES_VALUE_2 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104
Table 5-42 EEE_LOC_VALUE_3 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104
Table 5-43 EEE_REM_VALUE_3 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105
Table 5-44 EEE_RES_VALUE_3 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105
Table 5-45 Parser register summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105
Table 5-46 NORMALIZE_CTRL0 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106
Table 5-47 NORMALIZE_CTRL1 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107
Table 5-48 NORMALIZE_LEN_CTRL bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
Table 5-49 FRAM_ACK_CTRL0 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109
Table 5-50 FRAM_ACK_CTRL1 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110
Table 5-51 WIN_RULE_CTRL0 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 111
Table 5-52 WIN_RULE_CTRL2 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
Table 5-53 WIN_RULE_CTRL3 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
Table 5-54 WIN_RULE_CTRL6 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 113
Table 5-55 WIN_RULE_CTRL7 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 113
Table 5-56 WIN_RULE_CTRL9 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 114
Table 5-57 WIN_RULE_CTRL10 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 114
Table 5-58 WIN_RULE_CTRL13 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115
Table 5-59 TRUNK_HASH_EN bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115
Table 5-60 ACL register summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115
Table 5-61 ACL_FUNC0 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116
Table 5-62 ACL_FUNC1 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116
Table 5-63 ACL_FUNC2 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117
Table 5-64 ACL_FUNC3 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117
Table 5-65 ACL_FUNC4 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117
Table 5-66 ACL_FUNC5 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117
Table 5-67 VLAN_TRANS_TEST bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 118
Table 5-68 PORT0_VLAN_CTRL0 bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 118