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DC2016新手使用教程.pdf
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更新于2023-04-28
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个人总结的新手使用教程,包括图形界面教程和dc_shell教程,不包含软件安装和破解。适用于刚接触DC的新手
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Design Compiler 2016 使用教程
1 图形界面教程
1.1 启动
(1) 进入工作目录
(2) 命令行输入 lmstat -c license 目录,该命令跟 license 的网络许可有关
(3) 命令行输入 lmgrd -c license 目录,lmgrd 管理 license
(4) 命令行输入 design vision &,后台启动 DC 用户图形界面
1.2 准备综合用的工程
随便准备一个工程:
1.3 工艺库设置
File — Setup...,在弹出的 Application Setup 弹框中设置工艺库:
(1) 在 Search path 项添加用到的工艺库的搜索路径;
(2) 在 Link library 项中设置链接库(和目标库相同);
(3) 在 Target library 项中设置目标库;
(4) 在 Symbol library 项中设置符号库。
设置完成后,点击 OK。
1.4 保存当前设计
如果当前设计无法很快完成,需要退出 DC 时,有必要对当前设计进行保存,以便下次
进入 DC 时可直接读取文件回到上一次离开的位置。
点击 File — Save As…,.ddc 格式保存当前设计。下次进入 DC 时打开该文件即可。但
是工艺库需要重新设置。(先进行工艺库设置,再打开该文件,否则会报错)
1.5 设计文件读入
读入文件有 2 中方式,read 方式和 analyze + elaborate 方式。
analyze 用以分析、翻译 RTL 代码,并将中间结果存入指定的库中。elaborate 用于为设
计建立一个结构级与工艺无关的描述。read 可一步完成 analyze + elaborate 的操作。read 比
analyze + elaborate 支持的格式更多,analyze + elaborate 仅支持 VHDL 和 Verilog 文件,但
read 不支持参数修改、VHDL 中的构造体选择等功能。
read 方式点击 File — read…,读入设计文件,顶层自动识别一般不用设置,如需修改
顶层,在工具栏中修改或在 DC 底端的 design_vision>中输入 current_design xxx 设置 xxx 为
当前设计即顶层。
analyze + elaborate 方式先点击 File — Analyze…,在弹框中选择 Verilog 或 VHDL 文件
并勾选 Create New Library if it Doesn’t Exist 选项。然后点击 File — Elaborate…,在弹框中
选择库(Analyze Design 中的设置)和设计并勾选 Reanalyse out-of-date libraries 选项。
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小_小码农
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