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16通道,1 MSPS,12位ADC,定序
器28引线TSSOP
数据表
AD7490
牧师d 文档反馈
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其中技术的方式,邮政信箱9106,马萨诸塞州诺伍德02062-9106,USA电话:781.329.4700©2002-2
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技术支援 www.analog.com
特征
快速吞吐速率:1 MSPS额定欲诉 DD 在最高吞吐量2.7 V快速吞吐速率:1 MSPS额定欲诉 DD 在最高吞吐量2.7 V快速吞吐速率:1 MSPS额定欲诉 DD 在最高吞吐量2.7 V
至5.25 V低功耗
5.4毫瓦最大在870 kSPS时采用3 V电源
12.5毫瓦最大在1 MSPS,5 V电源
16(单端)与定序器宽输入带宽的输入
69.5分贝SNR在50kHz输入频率
灵活的功耗/串行时钟速度管理无流水线延迟
高速串行接口,SPI / QSPI™/ MICROWIRE™/
DSP兼容
全关断模式:0.5μA最大28引脚TSSOP和32引脚LFCSP
封装
功能框图
REFIN
VIN0
VIN15
AGND
VDD
AD7490
输入多路复用
器
12位逐次逼近
ADC
控制
逻辑
SEQUENCER
SCLK
DOUT
DIN CS
VDRIVE
T / H
图1。
概述
的AD7490是一个12位的高速,低功耗,16通道,逐次逼近ADC。将部件从一个
单一的操作
2.7 V至5.25 V电源供电,最高吞吐量可达1 MSPS。该器件包含一个低噪声,
宽带宽采样和保持放大器,可以在1 MHz以上的处理输入频率。
转换过程和数据采集过程通过CS和串行时钟信号,使该器件能够容易地与微处
理器或DSP接口控制。在CS的下降沿对输入信号进行采样,并转换同时在此处
启动。有该器件无流水线延迟。
该AD7490采用先进的设计技术,可在高吞吐速率下实现极低的功耗。为了获
得最大的吞吐速率,AD7490功耗仅为1.8 mA的3个V电源,并与5个V电源2.5
毫安。
通过在控制寄存器中的相关位,对于其模拟输入范围可以被选择为一个0 V
至REF 在至REF 在
输入或0 V至2×REF 在 输入,可采用标准二进制或二进制补码输出编码。的AD7输入或0 V至2×REF 在 输入,可采用标准二进制或二进制补码输出编码。的AD7输入或0 V至2×REF 在 输入,可采用标准二进制或二进制补码输出编码。的AD7
490设有一个通道序列16个单端模拟输入,以允许信道的预先编程选择要被顺
序转换。转换时间由SCLK确定
频率,因为这也被用来作为主时钟,以控制转化。
的AD7490是在32引脚LFCSP和28引脚TSSOP封装。
产品聚焦
1。 该AD7490提供高达1 MSPS的吞吐率。在1。 该AD7490提供高达1 MSPS的吞吐率。在
采用3个V电源的最大吞吐量,所述AD7490功耗仅为5.4功率毫瓦。
2。 信道的序列可以被选择,通过该 2。 信道的序列可以被选择,通过该
AD7490周期和转换。
3。 的AD7490采用2.7 V至5.25 V电源供电。 3。 的AD7490采用2.7 V至5.25 V电源供电。
在V 驾驶 功能允许串行接口直接连接到3 V或5个V处理器系统独立于V的 DD。在V 驾驶 功能允许串行接口直接连接到3 V或5个V处理器系统独立于V的 DD。在V 驾驶 功能允许串行接口直接连接到3 V或5个V处理器系统独立于V的 DD。在V 驾驶 功能允许串行接口直接连接到3 V或5个V处理器系统独立于V的 DD。
4。 转换速率由串行时钟确定, 4。 转换速率由串行时钟确定,
允许所述转换时间到通过串行时钟速度增加而降低。该器件还提供各种关
断模式,可在较低吞吐量最大化电源效率。功耗为0.5μA,最大,完全关断
时。
5。 该器件具有一个标准的逐次逼近 5。 该器件具有一个标准的逐次逼近
ADC,通过CS输入和一次性转换控制采样时间的精确控制。
02691-001

AD7490 数据表
牧师d | 第2页28
目录
特征 ................................................. ............................................. 1
功能框图............................................... ............... 1
概述................................................ ......................... 1
产品亮点................................................ ........................... 1
修订记录 ................................................ ............................... 2
规格................................................. .................................... 3
时序规范................................................ .................. 5
绝对最大额定值 ............................................... ............. 6
ESD注意事项................................................ .................................. 6
引脚配置和功能描述........................... 7
典型性能特性............................................. 8
术语................................................. ................................... 10
的内部寄存器结构............................................... ............. 12
控制寄存器................................................ .......................... 12
影子寄存器................................................ ......................... 14
操作理论............................................... ....................... 16
电路信息................................................ .................... 16
转换器操作................................................ .................. 16
ADC传递函数............................................... .............. 17
典型连接图............................................... .... 18
工作模式............................................... .................... 19
串行接口................................................ ............................ 22
功耗与吞吐率............................................. .......... 23
微处理器接口................................................ 24 .......
应用提示................................................ ....................... 25
外形尺寸................................................ ....................... 26
订购指南................................................ .......................... 27
修订记录
12分之12-REV。C到牧师d
图4和表4的变化........................................... .................. 7
更新的外形尺寸(改变CP-32-2 CP-32-7)..... 26
更改订购指南.............................................. ............. 27
6月9日-REV。B到版本C
更改为我 DD 自动待机模式参数,表1 ............... 4 更改为我 DD 自动待机模式参数,表1 ............... 4 更改为我 DD 自动待机模式参数,表1 ............... 4
5月8日-REV。A到版本B
更新后的格式................................................ ..................通用更改表1 ..............
............. ................................................. 3
图12和图13的变化........................................... 14 ..
图14的变化.............................................. ........................ 15
更改参考部分.............................................. ......... 19
更新的外形尺寸............................................... ........ 26
更改订购指南.............................................. ............ 27
10月2日-REV。0 Rev. A的
除了一般的描述.............................................. ....... 1
改变时序规范注......................................... 4
更改为绝对最大额定值......................................... 5
除了订购指南.............................................. .............. 5
更改典型性能特性.......................... 8
增加了新的图9 .............................................. ............................ 8
图12和图14的变化........................................... 11 ..
图20的变化.............................................. ........................ 13
变为图20至图26 ........................................... ..... 14
除了模拟输入部分............................................. ... 14
更改图29说明............................................. ............ 18
改变图30至图32 ........................................... ...... 18
新增应用提示.............................................. ... 20
1月2日,修订0:初始版本

数据表 AD7490
牧师d | 第3页28
规格
V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。V DD = V DRIVE = 2.7 V至5.25 V,REF IN = 2.5 V,F SCLK1 = 20兆赫,T A = Ť MIN 至T MAX, 除非另有说明。温度范围(B版):-40°C到+ 85℃。
表格1。
参数 测试条件/评论 敏 典型 马克斯 单元
动态性能 F IN = 50 kHz正弦波中,f SCLK = 20 MHz的 F IN = 50 kHz正弦波中,f SCLK = 20 MHz的 F IN = 50 kHz正弦波中,f SCLK = 20 MHz的 F IN = 50 kHz正弦波中,f SCLK = 20 MHz的 F IN = 50 kHz正弦波中,f SCLK = 20 MHz的
信号对(噪声+失真)(SINAD) 2信号对(噪声+失真)(SINAD) 2 V DD = 5 V V DD = 5 V V DD = 5 V 69 70.5 D b
V DD = 3 V V DD = 3 V V DD = 3 V 68 69.5 D b
信噪比(SNR) 2信噪比(SNR) 2 69.5 D b
总谐波失真(THD) 2总谐波失真(THD) 2 V DD = 5 V V DD = 5 V V DD = 5 V -84 -74 D b
V DD = 3 V V DD = 3 V V DD = 3 V -77 -71 D b
峰值谐波或杂散噪声(SFDR) 2峰值谐波或杂散噪声(SFDR) 2 V DD = 5 V V DD = 5 V V DD = 5 V -86 -75 D b
V DD = 3 V V DD = 3 V V DD = 3 V -80 -73 D b
互调失真(IMD) 2互调失真(IMD) 2 FA = 40.1千赫,FB = 41.5千赫
二阶项 -85 D b
三阶项 -85 D b
孔径延迟 10 NS
孔径抖动 50 PS
通道到通道隔离 2通道到通道隔离 2 F IN = 400千赫 F IN = 400千赫 F IN = 400千赫 -82 D b
全功率带宽 3分贝 8.2 兆赫
0.1分贝 1.6 兆赫
DC精度 2DC精度 2
解析度 12 位
积分非线性 ±1 LSB
微分非线性 保证没有遗漏码为12位 -0.95 / + 1.5 LSB
0 V至REF 在 输入范围 0 V至REF 在 输入范围 0 V至REF 在 输入范围 直接二进制输出编码
偏移误差 ±0.6 ±8 LSB
偏移误差匹配 ±0.5 LSB
增益误差 ±2 LSB
增益误差匹配 ±0.6 LSB
0 V至2×REF 在 输入范围 0 V至2×REF 在 输入范围 0 V至2×REF 在 输入范围
-REF 在 到+ REF 在 偏置在REF 在-REF 在 到+ REF 在 偏置在REF 在-REF 在 到+ REF 在 偏置在REF 在-REF 在 到+ REF 在 偏置在REF 在-REF 在 到+ REF 在 偏置在REF 在-REF 在 到+ REF 在 偏置在REF 在
用二进制补码输出编码偏移
正增益误差 ±2 LSB
正增益误差匹配 ±0.5 LSB
零代码错误 ±0.6 ±8 LSB
零代码误差匹配 ±0.5 LSB
负增益误差 ±1 LSB
负增益误差匹配 ±0.5 LSB
模拟输入
输入电压范围 RANGE位设置为1 0 REF 在REF 在 V
RANGE位设置为0,V DD = 4.75 V至5.25 V 0 V至2×RANGE位设置为0,V DD = 4.75 V至5.25 V 0 V至2×RANGE位设置为0,V DD = 4.75 V至5.25 V 0 V至2×
REF 在REF 在
0 2×REF 在2×REF 在
V
直流漏电流 ±1 μA
输入电容 20 pF的
参考输入
REF 在 输入电压 REF 在 输入电压 REF 在 输入电压 ±1%特定性能 2.5 V
直流漏电流 ±1 μA
REF 在 输入阻抗 REF 在 输入阻抗 REF 在 输入阻抗 F 样品= 1 MSPS F 样品= 1 MSPS F 样品= 1 MSPS 36 千欧

AD7490 数据表
牧师d | 第4页共28
参数 测试条件/评论 敏 典型 马克斯 单元
逻辑输入
输入高电压,V INH输入高电压,V INH 0.7×V 驾驶0.7×V 驾驶 V
输入低电压,V INL输入低电压,V INL 0.3×V 驾驶 V 0.3×V 驾驶 V 0.3×V 驾驶 V
输入电流,我 在输入电流,我 在 V IN = 0 v或v 驾驶V IN = 0 v或v 驾驶V IN = 0 v或v 驾驶V IN = 0 v或v 驾驶 ±0.01 ±1 μA
输入电容,C IN + 3输入电容,C IN + 3 10 pF的
逻辑输出
输出高电压,V 哦输出高电压,V 哦 一世 SOURCE = 200μA; V DD = 2.7 V至5.25 V 一世 SOURCE = 200μA; V DD = 2.7 V至5.25 V 一世 SOURCE = 200μA; V DD = 2.7 V至5.25 V 一世 SOURCE = 200μA; V DD = 2.7 V至5.25 V 一世 SOURCE = 200μA; V DD = 2.7 V至5.25 V V 驾驶 - 0.2 V 驾驶 - 0.2 V 驾驶 - 0.2 V
输出低电压,V OL输出低电压,V OL 一世 SINK = 200μA 一世 SINK = 200μA 一世 SINK = 200μA 0.4 V
浮态泄漏电流
弱/三位设置为0
±10 μA
浮态输出电容 3浮态输出电容 3
弱/三位设置为0
10 pF的
输出编码 代码位设置为1 直(自然)二进制
代码位设置为0 TW OS补 TW OS补
兑换率
转换时间 16个SCLK周期,SCLK = 20兆赫 800 NS
跟踪和保持采集时间: 2跟踪和保持采集时间: 2 正弦波输入 300 NS
满量程输入步 300 NS
吞吐率
V DD = 5 V(参见串行接口部分) V DD = 5 V(参见串行接口部分) V DD = 5 V(参见串行接口部分)
1 MSPS
电源要求
V DDV DD 2.7 5.25 V
V 驾驶V 驾驶 2.7 5.25 V
一世 DD4一世 DD4 数字输入= 0V或V 驾驶数字输入= 0V或V 驾驶
正常模式(静态) V DD = 2.7 V至5.25 V,SCLK或关闭 V DD = 2.7 V至5.25 V,SCLK或关闭 V DD = 2.7 V至5.25 V,SCLK或关闭 600 μA
普通模式(行动) V DD = 4.75 V至5.25 V,F SCLK = 20 MHz的 V DD = 4.75 V至5.25 V,F SCLK = 20 MHz的 V DD = 4.75 V至5.25 V,F SCLK = 20 MHz的 V DD = 4.75 V至5.25 V,F SCLK = 20 MHz的 V DD = 4.75 V至5.25 V,F SCLK = 20 MHz的 2.5毫安
(F S = 最大吞吐量) (F S = 最大吞吐量) (F S = 最大吞吐量) V DD = 2.7 V至3.6 V,F SCLK = 20 MHz的 V DD = 2.7 V至3.6 V,F SCLK = 20 MHz的 V DD = 2.7 V至3.6 V,F SCLK = 20 MHz的 V DD = 2.7 V至3.6 V,F SCLK = 20 MHz的 V DD = 2.7 V至3.6 V,F SCLK = 20 MHz的 1.8毫安
自动待机模式 F 样品= 500 kSPS的 F 样品= 500 kSPS的 F 样品= 500 kSPS的 1.55 嘛
静态的 100 μA
自动关机模式 F 样品= 250 kSPS时 F 样品= 250 kSPS时 F 样品= 250 kSPS时 960 μA
静态的 0.5μA
完全关断模式 SCLK开启或关闭 0.02 0.5μA
功耗 4功耗 4
普通模式(行动) V DD = 5 V,F SCLK = 20 MHz的 V DD = 5 V,F SCLK = 20 MHz的 V DD = 5 V,F SCLK = 20 MHz的 V DD = 5 V,F SCLK = 20 MHz的 V DD = 5 V,F SCLK = 20 MHz的 12.5毫瓦
V DD = 3 V,F SCLK = 20 MHz的 V DD = 3 V,F SCLK = 20 MHz的 V DD = 3 V,F SCLK = 20 MHz的 V DD = 3 V,F SCLK = 20 MHz的 V DD = 3 V,F SCLK = 20 MHz的 5.4毫瓦
自动待机模式(静态) V DD = 5 V V DD = 5 V V DD = 5 V 460 μW
V DD = 3 V V DD = 3 V V DD = 3 V 276 μW
自动关机模式(静态) V DD = 5 V V DD = 5 V V DD = 5 V 2.5μW
V DD = 3 V V DD = 3 V V DD = 3 V 1.5μW
完全关断模式 V DD = 5 V V DD = 5 V V DD = 5 V 2.5μW
V DD = 3 V V DD = 3 V V DD = 3 V 1.5μW
1 规范适用于F SCLK 高达20MHz。然而,对于串行接口的要求,请参见时序规格部分。1 规范适用于F SCLK 高达20MHz。然而,对于串行接口的要求,请参见时序规格部分。1 规范适用于F SCLK 高达20MHz。然而,对于串行接口的要求,请参见时序规格部分。1 规范适用于F SCLK 高达20MHz。然而,对于串行接口的要求,请参见时序规格部分。
2 参见术语部分。 2 参见术语部分。
3 通过特性保证。 3 通过特性保证。
4 见功率与吞吐速率部分。 4 见功率与吞吐速率部分。

数据表 AD7490
牧师d | 第5页28
时序规范
V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。 V DD = 2.7 V至5.25 V,V 驾驶 ≤V DD, REF IN = 2.5 V; Ť A = Ť MIN 至T MAX, 除非另有说明。
表2.钛 明规格 1表2.钛 明规格 1表2.钛 明规格 1
限制在T MIN, Ť MAX限制在T MIN, Ť MAX限制在T MIN, Ť MAX限制在T MIN, Ť MAX
参数V DD = 3 V V DD = 5 V 参数V DD = 3 V V DD = 5 V 参数V DD = 3 V V DD = 5 V 参数V DD = 3 V V DD = 5 V 参数V DD = 3 V V DD = 5 V 参数V DD = 3 V V DD = 5 V 单元 描述
F SCLK2F SCLK2 10 10 千赫分钟
16 20 最高1.5MHz
Ť 兑换Ť 兑换 16×吨 SCLK16×吨 SCLK 16×吨 SCLK16×吨 SCLK
Ť 安静Ť 安静 50 50 ns(最小值) 总线释放和未来转换的开始之间最少需要安静的时间
Ť 2Ť 2 12 10 ns(最小值)
CS到SCLK建立时间
Ť 33Ť 33 20 14 ns(最大值)
延迟从CS到DOUT三态禁用
Ť 3 b 4Ť 3 b 4Ť 3 b 4Ť 3 b 4 三十 20 ns(最大值)
延迟从CS到DOUT有效
Ť 43Ť 43 60 40 ns(最大值) SCLK的下降沿后的数据访问时间
Ť 五Ť 五 0.4×吨 SCLK0.4×吨 SCLK 0.4×吨 SCLK0.4×吨 SCLK ns(最小值) SCLK低脉冲宽度
Ť 6Ť 6 0.4×吨 SCLK0.4×吨 SCLK 0.4×吨 SCLK0.4×吨 SCLK ns(最小值) SCLK高脉冲宽度
Ť 7Ť 7 15 15 ns(最小值) SCLK到DOUT有效保持时间
Ť 85Ť 85 15/50 15/50 ns(最小值)/最大 SCLK的下降沿到DOUT高阻抗
Ť 9Ť 9 20 20 ns(最小值) 到SCLK下降沿DIN建立时间之前
Ť 10Ť 10 五 五 ns(最小值) DIN保持时间SCLK的下降沿后
Ť 11Ť 11 20 20 ns(最小值)
16 日 SCLK的下降沿到CS高 16 日 SCLK的下降沿到CS高 16 日 SCLK的下降沿到CS高
Ť 12Ť 12 1 1 微秒最大 从完全掉电/自动关机/自动待机模式上电时间
1 通过特性保证。所有输入信号均具有t指定 R = Ť F = 5个纳秒(10%至90%V的 DD) 和从1.6伏的电压电平的定时(参照图2)。3 V工作范围跨越从2.7 V至3.6 V的5 V的工作范围从4.75 V跨越至5.25 V.1 通过特性保证。所有输入信号均具有t指定 R = Ť F = 5个纳秒(10%至90%V的 DD) 和从1.6伏的电压电平的定时(参照图2)。3 V工作范围跨越从2.7 V至3.6 V的5 V的工作范围从4.75 V跨越至5.25 V.1 通过特性保证。所有输入信号均具有t指定 R = Ť F = 5个纳秒(10%至90%V的 DD) 和从1.6伏的电压电平的定时(参照图2)。3 V工作范围跨越从2.7 V至3.6 V的5 V的工作范围从4.75 V跨越至5.25 V.1 通过特性保证。所有输入信号均具有t指定 R = Ť F = 5个纳秒(10%至90%V的 DD) 和从1.6伏的电压电平的定时(参照图2)。3 V工作范围跨越从2.7 V至3.6 V的5 V的工作范围从4.75 V跨越至5.25 V.1 通过特性保证。所有输入信号均具有t指定 R = Ť F = 5个纳秒(10%至90%V的 DD) 和从1.6伏的电压电平的定时(参照图2)。3 V工作范围跨越从2.7 V至3.6 V的5 V的工作范围从4.75 V跨越至5.25 V.1 通过特性保证。所有输入信号均具有t指定 R = Ť F = 5个纳秒(10%至90%V的 DD) 和从1.6伏的电压电平的定时(参照图2)。3 V工作范围跨越从2.7 V至3.6 V的5 V的工作范围从4.75 V跨越至5.25 V.1 通过特性保证。所有输入信号均具有t指定 R = Ť F = 5个纳秒(10%至90%V的 DD) 和从1.6伏的电压电平的定时(参照图2)。3 V工作范围跨越从2.7 V至3.6 V的5 V的工作范围从4.75 V跨越至5.25 V.1 通过特性保证。所有输入信号均具有t指定 R = Ť F = 5个纳秒(10%至90%V的 DD) 和从1.6伏的电压电平的定时(参照图2)。3 V工作范围跨越从2.7 V至3.6 V的5 V的工作范围从4.75 V跨越至5.25 V.
2 为SCLK输入标志/空间比是40/60至60/40。最大SCLK频率为16兆赫为V DD = 3 V,得到吞吐量870 kSPS时。必须注意的接口,以考虑数据存取时间时,应考虑,T 4, 并需要为用户的处理器的设置时间。这两个时2 为SCLK输入标志/空间比是40/60至60/40。最大SCLK频率为16兆赫为V DD = 3 V,得到吞吐量870 kSPS时。必须注意的接口,以考虑数据存取时间时,应考虑,T 4, 并需要为用户的处理器的设置时间。这两个时2 为SCLK输入标志/空间比是40/60至60/40。最大SCLK频率为16兆赫为V DD = 3 V,得到吞吐量870 kSPS时。必须注意的接口,以考虑数据存取时间时,应考虑,T 4, 并需要为用户的处理器的设置时间。这两个时2 为SCLK输入标志/空间比是40/60至60/40。最大SCLK频率为16兆赫为V DD = 3 V,得到吞吐量870 kSPS时。必须注意的接口,以考虑数据存取时间时,应考虑,T 4, 并需要为用户的处理器的设置时间。这两个时2 为SCLK输入标志/空间比是40/60至60/40。最大SCLK频率为16兆赫为V DD = 3 V,得到吞吐量870 kSPS时。必须注意的接口,以考虑数据存取时间时,应考虑,T 4, 并需要为用户的处理器的设置时间。这两个时2 为SCLK输入标志/空间比是40/60至60/40。最大SCLK频率为16兆赫为V DD = 3 V,得到吞吐量870 kSPS时。必须注意的接口,以考虑数据存取时间时,应考虑,T 4, 并需要为用户的处理器的设置时间。这两个时
间确定与用户的系统可以操作(见串行接口部分)的最大SCLK频率。
3 测定与图2的负载电路并且被定义为跨越0.4 V或0.7伏用于输出所需的时间 驾驶 。4 Ť 3 b表示为具有ADD3上DOUT线可用最坏情况的图,也就是,如果AD7490就返回到三态在一个转换结束和其他一些设备需要转换之间3 测定与图2的负载电路并且被定义为跨越0.4 V或0.7伏用于输出所需的时间 驾驶 。4 Ť 3 b表示为具有ADD3上DOUT线可用最坏情况的图,也就是,如果AD7490就返回到三态在一个转换结束和其他一些设备需要转换之间3 测定与图2的负载电路并且被定义为跨越0.4 V或0.7伏用于输出所需的时间 驾驶 。4 Ť 3 b表示为具有ADD3上DOUT线可用最坏情况的图,也就是,如果AD7490就返回到三态在一个转换结束和其他一些设备需要转换之间3 测定与图2的负载电路并且被定义为跨越0.4 V或0.7伏用于输出所需的时间 驾驶 。4 Ť 3 b表示为具有ADD3上DOUT线可用最坏情况的图,也就是,如果AD7490就返回到三态在一个转换结束和其他一些设备需要转换之间3 测定与图2的负载电路并且被定义为跨越0.4 V或0.7伏用于输出所需的时间 驾驶 。4 Ť 3 b表示为具有ADD3上DOUT线可用最坏情况的图,也就是,如果AD7490就返回到三态在一个转换结束和其他一些设备需要转换之间3 测定与图2的负载电路并且被定义为跨越0.4 V或0.7伏用于输出所需的时间 驾驶 。4 Ť 3 b表示为具有ADD3上DOUT线可用最坏情况的图,也就是,如果AD7490就返回到三态在一个转换结束和其他一些设备需要转换之间
的总线的控制下,用户必须等待t的最大时间 3 b。具有ADD3上DOUT线有效之前。如果DOUT线被转换之间弱驱动到ADD3,用户通常具有看到ADD3上DOUT有效之前等待在3 V 17纳秒,在5 V 12纳秒的CS下降沿的总线的控制下,用户必须等待t的最大时间 3 b。具有ADD3上DOUT线有效之前。如果DOUT线被转换之间弱驱动到ADD3,用户通常具有看到ADD3上DOUT有效之前等待在3 V 17纳秒,在5 V 12纳秒的CS下降沿的总线的控制下,用户必须等待t的最大时间 3 b。具有ADD3上DOUT线有效之前。如果DOUT线被转换之间弱驱动到ADD3,用户通常具有看到ADD3上DOUT有效之前等待在3 V 17纳秒,在5 V 12纳秒的CS下降沿
之后。
五 Ť 8 从当与图2的电路然后将测得数外推回除去的充电或放电25 pF电容的影响加载来改变0.5 V截取由所述数据输出测量出的时间导出的。这意味着时间t 8, 在时序特性引用,是该部分的真正的总线释放时间,并且独五 Ť 8 从当与图2的电路然后将测得数外推回除去的充电或放电25 pF电容的影响加载来改变0.5 V截取由所述数据输出测量出的时间导出的。这意味着时间t 8, 在时序特性引用,是该部分的真正的总线释放时间,并且独五 Ť 8 从当与图2的电路然后将测得数外推回除去的充电或放电25 pF电容的影响加载来改变0.5 V截取由所述数据输出测量出的时间导出的。这意味着时间t 8, 在时序特性引用,是该部分的真正的总线释放时间,并且独五 Ť 8 从当与图2的电路然后将测得数外推回除去的充电或放电25 pF电容的影响加载来改变0.5 V截取由所述数据输出测量出的时间导出的。这意味着时间t 8, 在时序特性引用,是该部分的真正的总线释放时间,并且独五 Ť 8 从当与图2的电路然后将测得数外推回除去的充电或放电25 pF电容的影响加载来改变0.5 V截取由所述数据输出测量出的时间导出的。这意味着时间t 8, 在时序特性引用,是该部分的真正的总线释放时间,并且独五 Ť 8 从当与图2的电路然后将测得数外推回除去的充电或放电25 pF电容的影响加载来改变0.5 V截取由所述数据输出测量出的时间导出的。这意味着时间t 8, 在时序特性引用,是该部分的真正的总线释放时间,并且独
立于总线负载的。
200μA IOL
200μA IOH
1.6V
TO OUTPUT
PIN CL
为25pF
图数字输出时序规格2.负载电路
02691-002
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