在 NB 电路的架构框图中,我们可以看到 PCH 和 EC 之间通过 LPC 总线连接,
在 MB 板上也会看到 EC 芯片旁边有一个 JDEBUG 的 connector,其也与 LPC 总线
相连,用于主板诊断。下面将对 LPC 总线做一些简单介绍,希望能够帮助大家
了解 LPC 的工作原理:
1、 LPC 总线
LPC(Low Pin Count)是基于 Intel 标准的 33 MHz 4 bit 并行总线协议(但目
前 NB 系统中 LPC 的时钟频率为 24MHz,可能是由于 CPU 平台的不断发展导致
的,后面会具体分析),用于代替以前的 ISA 总线协议,但两者性能相似,都
用于连接南桥和 Super I/O 芯片、FLASH BIOS、EC 等设备(由于目前 EC 芯片中整
合了 Super I/O 功能,所以我们在 NB 系统中看不到 LPC 总线上挂有 Super I/O 芯
片了)。
传统 ISA BUS 速率大约在 7.159~8.33MHz,提供的理论尖峰传输值为
16MB/s,但是 ISA BUS 与传统的 PCI BUS 的电气特性、信号定义方式迥异,使得
南桥芯片、Super I/O 芯片浪费很多针脚来做处理,主板的线路设计也显得复杂。
为此,Intel 定义了 LPC 接口,将以往 ISA BUS 的地址/数据分离译码,改成类似
PCI 的地址/数据信号线共享的译码方式,信号线数量大幅降低,工作速率由 PCI
总线速率同步驱动(时钟同为 33MHz),虽然改良过的 LPC 接口一样维持最大
传输值 16MB/s,但信号管脚却大幅减少了 25~30 个,以 LPC 接口设计的 Super
I/O 芯片、Flash 芯片都能享有脚位数减少、体积微缩的好处,主板的设计也可
以简化,这也是取名 LPC——Low Pin Count 的原因。
2、LPC 总线的接口管脚
LPC 总线由 7 个必选信号和 6 个可选信号组成,具体如下表所示:
表 3-2 LPC 总线可选信号列表
信号 外设 Host 设备 信号描述
LDRQ# O I
外设进行 DMA or bus mastering 操作的总线请求
信号,一对一,外设之间不能共享同一个
LDRQ#
SERIRQ I/O I/O
中断请求信号
CLKRUN# OD I/OD
外设进行 DMA or bus mastering 操作才会需要该
信号,用于停止 PIC bus,同 PCI CLKRUN 信号