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Cadence 版图设计--Virtuoso a Custom Designer (VCD) Product No 3700

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CADENCE CONFIDENTIAL

Design Solutions

2001

CADENCE CONFIDENTIAL

Virtuoso Custom Designer (VCD)

Product No. 3700

CADENCE CONFIDENTIAL

Custom IC Design Problem

•

Custom IC physical design is a bottleneck

•

Too many design iterations

•

Need productivity gains in custom IC physical design

–

Availability of Design Library or Design Kit

–

Human transfer of design information from schematic or design

package, prone to error

–

Intensive and tedious manual layout of polygons

–

Design iterations due to manual errors and ECOs

CADENCE CONFIDENTIAL

AMS Market Dynamics :

Design capture

(IC Design Engineer )

Custom Manual

Physical layout

(Layout

Designer)

Custom design

Physical Handoff

Traditional

slow

Circuit Design

Schematic

Polygon Layout

GDSII

Physical Verification

Manual

Many loops

Automated

Custom

Physical

Design

New

Faster

Design capture

(IC Design Engineer )

Correct

Construction

(Introduced

in 1999)

Smaller

bigger

NOW!!!

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Old Manual methodology - tool flow

CMOS Process

And Library with

Pcells.

Virtuoso® Layout Editor

And Pcells

Diva DRC,LVS

TAT for Block Creation typically 7 days

TAT for Chip Assembly typically 6 weeks

Many DRC/LVS loops

to fix errors

No connectivity

No constraints or

automated routing

Physical Handoff

Composer Schematic

Capture

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