AT89C51RB2/RC2 datasheet: 8051兼容高速处理器详解
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更新于2024-07-21
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AT89C51RB2RC2是一款高度兼容8051架构的单片机，具备一系列强大的功能，适合各种嵌入式系统设计。这款芯片的主要特点包括：
1. **兼容性**：80C52兼容性确保了它与标准8051指令集和引脚的完美对接，这对于开发者来说是至关重要的，因为这意味着现有针对8051的软件和硬件设计可以直接应用。
2. **I/O端口**：四个独立的8位输入/输出端口（P0-P3）提供了丰富的外设连接选项，支持多种通信接口和扩展模块的连接。
3. **定时器/计数器**：内置三个16位定时器/计数器，可以用于精确的时间测量、脉冲处理等高级控制任务。
4. **内存**：带有256字节的可编程只读存储器（Flash）和256字节的 ScratchPad RAM，满足程序存储和数据缓冲的需求。其中，Flash支持字节或页面（128字节）的擦写和编程，具有高达100,000次的写操作循环。
5. **编程和启动**：集成的In-system Programming (ISP) 功能允许在系统运行过程中进行程序更新，使用标准电源电压。此外，它的Boot ROM包含低级Flash编程程序和一个默认的串行加载器，便于应用程序的初始化。
6. **性能**：AT89C51RB2RC2支持高速架构，标准模式下工作频率可达48 MHz，在外部代码执行时为40 MHz；而在X2模式下，内部代码执行速度为24 MHz（外部代码20 MHz），这显著提升了处理速度。
7. **内存扩展**：内建的1024字节扩展随机存取存储器（XRAM），其大小可通过软件配置，支持0到1024字节的选择，以适应不同的应用需求，且默认情况下，为了保持与TS87C51RB2/RC2的兼容性，选择256字节。
8. **中断管理**：拥有9个中断源和4级优先级，支持键盘中断接口（P1口）以及灵活的中断管理，提高了系统的实时响应能力。
9. **通信接口**：集成SPI接口，支持主/从模式，便于与外部设备如传感器、显示器等进行数据交换。
10. **其他特性**：如8位时钟分频器、改进的X2模式（独立选择CPU和外设）、5通道的可编程计数器阵列，提供了高精度计时和PWM信号生成等功能。
AT89C51RB2RC2是一款功能强大、灵活性高的单片机，适用于需要高性能、高兼容性和多种功能集成的应用场合，尤其适合嵌入式系统设计者使用。
16
AT89C51RB2/RC2
4180B–8051–04/03
Table 15. CKCON0 Register
CKCON0 - Clock Control Register (8Fh)
Reset Value = 0000 000’HSB. X2’b (see Table 65 “Hardware Security Byte”)
Not bit addressable
76543210
- WDX2 PCAX2 SIX2 T2X2 T1X2 T0X2 X2
Bit
Number
Bit
Mnemonic Description
7 Reserved
6WDX2
Watchdog Clock
(This control bit is validated when the CPU clock X2 is set; when X2 is low, this bit
has no effect).
Cleared to select 6 clock periods per peripheral clock cycle.
Set to select 12 clock periods per peripheral clock cycle.
5PCAX2
Programmable Counter Array Clock
(This control bit is validated when the CPU clock X2 is set; when X2 is low, this bit
has no effect).
Cleared to select 6 clock periods per peripheral clock cycle. Set to select 12 clock
periods per peripheral clock cycle.
4SIX2
Enhanced UART Clock (Mode 0 and 2)
(This control bit is validated when the CPU clock X2 is set; when X2 is low, this bit
has no effect).
Cleared to select 6 clock periods per peripheral clock cycle. Set to select 12 clock
periods per peripheral clock cycle.
3T2X2
Timer 2 Clock
(This control bit is validated when the CPU clock X2 is set; when X2 is low, this bit
has no effect).
Cleared to select 6 clock periods per peripheral clock cycle.
Set to select 12 clock periods per peripheral clock cycle.
2T1X2
Timer 1 Clock
(This control bit is validated when the CPU clock X2 is set; when X2 is low, this bit
has no effect).
Cleared to select 6 clock periods per peripheral clock cycle. Set to select 12 clock
periods per peripheral clock cycle.
1T0X2
Timer0 Clock
(This control bit is validated when the CPU clock X2 is set; when X2 is low, this bit
has no effect).
Cleared to select 6 clock periods per peripheral clock cycle. Set to select 12 clock
periods per peripheral clock cycle.
0X2
CPU Clock
Cleared to select 12 clock periods per machine cycle (STD, X1 mode) for CPU
and all the peripherals. Set to select 6 clock periods per machine cycle (X2
mode) and to enable the individual peripherals’X2’ bits. Programmed by
hardware after Power-up regarding Hardware Security Byte (HSB), Default
setting, X2 is cleared.
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