瑞萨RX13T MCU硬件用户手册：2021年最新版
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更新于2024-07-06
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瑞萨RX13T用户手册是一份详尽的技术文档，专为Renesas RX13T这款32位微控制器（MCU）设计，属于RX系列中的RX100系列。该手册发布日期为2021年3月，版本为1.10，旨在提供产品及其规格的最新信息。请注意，所有内容均基于发布时的状态，Renesas Electronics Corp.保留在无通知情况下更新产品的权利。
手册的主要内容涵盖硬件设计和操作，为开发人员提供了RX13T芯片的详细描述、功能特性和接口说明，以及可能的应用示例。在使用过程中，用户应自行负责将手册中的电路、软件和相关信息应用于其产品或系统设计，因为这涉及到特定的应用环境和潜在风险。
文档中的描述和电路图仅作为示例用途，旨在帮助理解半导体产品的功能，而不是用于实际生产环境中的直接复制。用户在使用这些信息时必须承担全部责任，因为Renesas Electronics Corp.对其产生的任何损失或损害概不负责。
另外，手册还强调了版权问题，声明所有权利归Renesas Electronics Corporation所有，并提醒读者在使用前务必查阅Renesas Electronics Corp.网站（http://www.renesas.com）获取最新的产品信息和公告，以确保设计和应用的准确性和合规性。
瑞萨RX13T用户手册是开发人员在设计、集成和优化基于RX13T的解决方案时不可或缺的参考资料，它提供了深入的技术细节，但使用者必须理解和接受其中的责任条款，并始终关注最新的技术更新。
19. Multi-Function Timer Pulse Unit 3 (MTU3c) ................................................................................. 328
19.1 Overview ...........................................................................................................................................328
19.2 Register Descriptions .........................................................................................................................333
19.2.1 Timer Control Register (TCR) .................................................................................................333
19.2.2 Timer Control Register 2 (TCR2) ............................................................................................335
19.2.3 Timer Mode Register 1 (TMDR1) ............................................................................................339
19.2.4 Timer Mode Register 2 (TMDR2A) .........................................................................................341
19.2.5 Timer Mode Register 3 (TMDR3) ............................................................................................342
19.2.6 Timer I/O Control Register (TIOR) ..........................................................................................343
19.2.7 Timer Compare Match Clear Register (TCNTCMPCLR) .......................................................354
19.2.8 Timer Interrupt Enable Register (TIER) ..................................................................................355
19.2.9 Timer Status Register (TSR) ....................................................................................................358
19.2.10 Timer Buffer Operation Transfer Mode Register (TBTM) ......................................................359
19.2.11 Timer Input Capture Control Register (TICCR) ......................................................................360
19.2.12 Timer Counter (TCNT) ............................................................................................................361
19.2.13 Timer Longword Counter (TCNTLW) .....................................................................................361
19.2.14 Timer General Register (TGR) .................................................................................................362
19.2.15 Timer Longword General Registers (TGRALW, TGRBLW) ..................................................362
19.2.16 Timer Start Registers (TSTRA, TSTR) ....................................................................................363
19.2.17 Timer Synchronous Register (TSYRA) ...................................................................................365
19.2.18 Timer Counter Synchronous Start Register (TCSYSTR) .........................................................366
19.2.19 Timer Read/Write Enable Register (TRWERA) ......................................................................367
19.2.20 Timer Output Master Enable Register (TOERA) .....................................................................368
19.2.21 Timer Output Control Register 1 (TOCR1A) ...........................................................................369
19.2.22 Timer Output Control Register 2 (TOCR2A) ...........................................................................371
19.2.23 Timer Output Level Buffer Register (TOLBRA) .....................................................................374
19.2.24 Timer Gate Control Register A (TGCRA) ...............................................................................375
19.2.25 Timer Subcounter (TCNTSA) ..................................................................................................376
19.2.26 Timer Period Data Register (TCDRA) .....................................................................................376
19.2.27 Timer Period Buffer Register (TCBRA) ..................................................................................377
19.2.28 Timer Dead Time Data Register (TDDRA) .............................................................................377
19.2.29 Timer Dead Time Enable Register (TDERA) ..........................................................................378
19.2.30 Timer Buffer Transfer Set Register (TBTERA) .......................................................................379
19.2.31 Timer Waveform Control Register (TWCRA) .........................................................................380
19.2.32 Noise Filter Control Register n (NFCRn) (n = 0 to 4, C) .........................................................381
19.2.33 Noise Filter Control Register 5 (NFCR5) .................................................................................383
19.2.34 Timer A/D Conversion Start Request Control Register (TADCR) ..........................................384
19.2.35 Timer A/D Conversion Start Request Cycle Set Registers (TADCORA, TADCORB) ..........386
19.2.36 Timer A/D Conversion Start Request Cycle Set Buffer Registers
(TADCOBRA, TADCOBRB) ..................................................................................................386
19.2.37 Timer Interrupt Skipping Mode Register (TITMRA) ..............................................................387
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