ICS9LPRS355 PLL集成电路技术规格与应用
需积分: 10 35 浏览量
更新于2024-08-01
收藏 393KB PDF 举报
"ICS9LPRS355是一款由Integrated Circuit Systems, Inc.(ICS)生产的高性能锁相环(PLL)集成电路,主要用于生成多种频率的时钟信号,如CPU、SRC、PCI、PCI_F、USB和REF等。该器件集成了电压调节器和内部串联电阻,具有低功耗差分输出,适用于CK505兼容的应用。"
**集成电路概述**
ICS9LPRS355是集成电路中的一种,它是一个先进的锁相环(PLL)解决方案,专为满足现代数字系统中的时钟需求而设计。PLL是一种电子电路,通过锁定到输入参考信号来生成稳定且精确的输出频率,它广泛应用于通信、计算机和各种嵌入式系统中。
**输出特性**
该芯片提供多种输出配置,包括两个CPU差分低功耗推挽对、九个SRC差分低功耗推挽对、一个CPU/SRC可选差分推挽对以及一个SRC/DOT可选差分推挽对。这些输出能够支持不同的系统时钟标准,例如5个PCI(33MHz)、一个PCI_F(33MHz自由运行)、一个USB(48MHz)和一个REF(14.318MHz)。
**技术规格**
- CPU输出的周期-周期抖动小于85ps,确保了高精度的时钟信号。
- SRC输出的周期-周期抖动小于125ps,同样保证了良好的时钟质量。
- PCI输出的周期-周期抖动小于250ps,适合PCI总线的要求。
- CPU和SRC时钟的频率精度在±100ppm之内,提供了可靠的时钟同步。
**特性与优势**
- ICS9LPRS355无需外部传递晶体管即可进行电压调节,简化了系统设计。
- 差分输出端口内置30欧姆串联电阻,其阻抗为50欧姆,有利于信号完整性。
- 支持频谱展宽调制,默认下降低频偏移为0.5%,有助于减少电磁干扰。
- 使用外部14.318MHz晶体,通过外部晶体负载电容进行频率调整,以适应不同的工作频率。
- 可选择一个SRC差分推挽输出,提供了灵活的系统配置选项。
**应用领域**
这款芯片适用于需要高精度时钟信号的各种应用,包括但不限于服务器、工作站、个人电脑、网络设备、工业控制和消费电子产品等。由于其集成度高、性能优异,可以有效地简化系统设计,降低功耗,同时提高系统的时钟质量和可靠性。
2024-07-20 上传
2024-07-24 上传
2024-07-23 上传
2023-11-09 上传
2024-07-22 上传
2024-07-19 上传
2024-07-19 上传
yesichao
- 粉丝: 0
- 资源: 1
最新资源
- Hadoop生态系统与MapReduce详解
- MDS系列三相整流桥模块技术规格与特性
- MFC编程:指针与句柄获取全面解析
- LM06:多模4G高速数据模块,支持GSM至TD-LTE
- 使用Gradle与Nexus构建私有仓库
- JAVA编程规范指南:命名规则与文件样式
- EMC VNX5500 存储系统日常维护指南
- 大数据驱动的互联网用户体验深度管理策略
- 改进型Booth算法:32位浮点阵列乘法器的高速设计与算法比较
- H3CNE网络认证重点知识整理
- Linux环境下MongoDB的详细安装教程
- 压缩文法的等价变换与多余规则删除
- BRMS入门指南:JBOSS安装与基础操作详解
- Win7环境下Android开发环境配置全攻略
- SHT10 C语言程序与LCD1602显示实例及精度校准
- 反垃圾邮件技术:现状与前景