of_clk_get_by_name

时间: 2023-05-09 08:01:06 浏览: 101
of_clk_get_by_name是一个用于在设备树中查找和获取指定名称的时钟的函数。设备树是一种硬件描述语言,用于描述系统中所有硬件设备的结构和属性。在许多嵌入式系统中,时钟是一个非常重要的组件,它们负责管理计时、同步和数据传输等功能。 of_clk_get_by_name函数可以通过在设备树中查找一个具有指定名称的时钟节点,并返回对应的Linux时钟对象。该函数通常由驱动程序使用,以便访问特定的时钟。Linux时钟对象具有包括时钟名称、时钟频率、时钟使能状态和时钟控制器等属性。驱动程序可以使用这些属性来操作和管理时钟。 对于多个时钟节点具有相同名称的情况,还可以使用of_clk_get_by_name_arg函数来获取一个具有指定属性值的时钟对象。这些属性值可以在设备树中进行配置和修改,以适应不同的硬件需求。因此,of_clk_get_by_name函数是Linux内核中一个非常重要的函数,它为驱动程序提供了一种方便、灵活和可扩展的方式来管理和控制硬件时钟。
相关问题

create_generated_clock -name ldpc_clk -source [get_pins design_1_wrapper_i/design_1_i/clk_wiz_1/clk_in1] -divide_by 3 -multiply_by 2 [get_pins design_1_wrapper_i/design_1_i/clk_wiz_1/ldpc_clk]

你似乎在询问一个命令,这是一个时钟生成命令,用于创建一个新的时钟信号。该命令的作用是创建一个名为 ldpc_clk 的时钟信号,其源时钟为 design_1_wrapper_i/design_1_i/clk_wiz_1/clk_in1,将其分频系数设置为 3,倍频系数设置为 2,并将其输出到 design_1_wrapper_i/design_1_i/clk_wiz_1/ldpc_clk 这个引脚上。

foreach clk_gate_name $all_crm_gates { set clk_source_crg_col [all_fanin -to ${clk_gate_name}/cp -flat -only_cells -startpoints_only ] set clk_source_crg [get_object_name $clk_source_crg_col] set clk_source [get_object_name [remove_from_collection -intersect [all_fanin -to ${clk_source_crg}/CP -flat -startpoints_only] $clk_ports_list]] create_gennerated_clock [get_pins $clk_gate_name/hand_latch/Q] -source ${clk_source_crg}/Q -divide_by 1 if {$clk_source == "core_clk"} { set_all_core_clks [add_to_collection $all_core_clks [get_clock ${clk_gate_name}/hand_latch/Q] ] } },翻译

这段代码是一个Tcl脚本代码片段,它的作用与前面的代码类似,不同之处在于处理的是列表变量$all_crm_gates中的元素,并且获取输入时钟信号的方式略有不同。 具体来说,这段代码同样使用foreach循环遍历$all_crm_gates列表中的每一个元素$clk_gate_name,对每个元素进行以下操作: 1. 获取输入时钟信号 使用all_fanin命令获取$clk_gate_name元素中cp端口的输入信号,并且只保留单元格对象,赋值给变量$clk_source_crg_col。 使用get_object_name命令获取$clk_source_crg_col变量指向对象的名称,赋值给变量$clk_source_crg。 使用all_fanin命令获取$clk_source_crg对象中CP端口的输入信号,与$clk_ports_list列表变量取交集,并从中获取第一个对象的名称,赋值给变量$clk_source。 2. 创建生成时钟 使用create_generated_clock命令创建一个新的生成时钟对象,并将其连接到$clk_gate_name元素的hand_latch/Q端口上。其中,源时钟信号为$clk_source_crg/Q,时钟分频因子为1。 3. 添加时钟到列表变量 如果$clk_source等于"core_clk",则将生成的时钟对象添加到$all_core_clks列表变量中。 最终,$all_core_clks保存了所有输入信号为"core_clk"的时钟对象。

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Sdm_so_node_A.cpp #include <iostream> #include <unordered_map> #include <stdio.h> #include <stdlib.h> #include <signal.h> #include <unistd.h> #include <memory> #include <verilated_vcs_c.h> #include "VA_top.h" #include "sdm_config.h" #include "Sdm_node_A.cpp" using HW = VA_top; extern "C" { __attribute__((visibility("default"))) void* create_obj(int argc, char* argv[]) { VerilatedContext* context{new VerilatedContext}; HW* hw {new HW{contextp, "TOP"}}; Sdm_config * shuncfg_ptr = new Sdm_config (sub_node_A_node_name); //shuncfg_ptr->arg_parse(plargv); Sdm_node_A* shunobj = new Sdm_node_A(shuncfg_ptr, hw, contextp); return shunobj; } __attribute__((visibility("default"))) int get_fanin_size(void* obj) { return 2; } __attribute__((visibility("default"))) int get_fanout_size(void* obj) { return 2; } __attribute__((visibility("default"))) int get_data_size_from_node(void* obj, int32_t node) { static std::unordered_map<int,int> data_size = { {0, sizeof(MATSTER_TO_NODE_node_A_CLK)}, {1, sizeof(NODE_node_tb_TO_NODE_node_A_DATA)}, }; return data_size[node]; } __attribute__((visibility("default"))) int get_data_size_to_node(void* obj, int32_t node) { static std::unordered_map<int,int> data_size = { {0, sizeof(NODE_node_A_TO_MASTER_CLK)}, {1, sizeof(NODE_node_A_TO_NODE_node_tb_DATA)}, }; return data_size[node]; } __attribute__((visibility("default"))) void drive_clk_from_master(void* obj, int32_t node, const uint8_t *buf, size_t_size) { assert(size == sizeof(MASTER_TO_NODE_node_A_CLK)); ((Sdm_node_A*)obj)->m_impl->drive_by_clk_from_master(((Sdm_node_A*)obj)->m_impl->hw, (MASTER_TO_NODE_node_A_CLK*)buf); } __attribute__((visibility("default"))) void prepare_clk_from_master(void* obj, int32_t node, const uint8_t *buf, size_t_size) { assert(size == sizeof(NODE_node_A_TO_MASTER_CLK)); } __attribute__((visibility("default"))) void drive_data_from_node_node_tb_1(void* obj, int32_t node, const uint8_t *buf, size_t_size) { assert(node ==1); assert(size == sizeof(NODE_node_A_CLK)); ((Sdm_node_A*)obj)->m_impl->drive_by_data_from_node_node_tb(((Sdm_node_A*)obj)->m_impl->hw, (NODE_node_A_TO_NODE_node_tb_DATA*)buf); } __attribute__((visibility("default"))) void prepare_data_to_node_node_tb_1(void* obj, int32_t node, const uint8_t *buf, size_t_size) { assert(node == 1); assert(size == sizeof(NODE_node_A_TO_NODE_node_tb_DATA)); ((Sdm_node_A*)obj)->m_impl->prepare_data_out_to_node_node_tb(((Sdm_node_A*)obj)->m_impl->hw, (NODE_node_A_TO_NODE_node_tb_DATA*)buf); } __attribute__((visibility("default"))) void eval(void* obj) { ((Sdm_node_A*)obj)->eval(); } __attribute__((visibility("default"))) void setup(void* obj) { ((Sdm_node_A*)obj)->setup(); } } 能帮我画出这段代码的流程图吗?

注释以下每一行代码#include "bflb_mtimer.h" #include "bflb_uart.h" #include "bflb_clock.h" #include "board.h" struct bflb_device_s *uartx; void uart_isr(int irq, void *arg) { uint32_t intstatus = bflb_uart_get_intstatus(uartx); int ret; uint32_t baudrate; if (intstatus & UART_INTSTS_RX_AD5) { bflb_uart_int_clear(uartx, UART_INTCLR_RX_AD5); ret = bflb_uart_feature_control(uartx, UART_CMD_GET_AUTO_BAUD, UART_AUTO_BAUD_0X55); baudrate = bflb_clk_get_peripheral_clock(BFLB_DEVICE_TYPE_UART, uartx->idx) / (ret + 1); printf("Detected baudrate by 0x55 is %d\r\n", baudrate); } if (intstatus & UART_INTSTS_RX_ADS) { bflb_uart_int_clear(uartx, UART_INTCLR_RX_ADS); ret = bflb_uart_feature_control(uartx, UART_CMD_GET_AUTO_BAUD, UART_AUTO_BAUD_START); baudrate = bflb_clk_get_peripheral_clock(BFLB_DEVICE_TYPE_UART, uartx->idx) / (ret + 1); printf("Detected baudrate by startbit is %d\r\n", baudrate); } } int main(void) { board_init(); board_uartx_gpio_init(); uartx = bflb_device_get_by_name(DEFAULT_TEST_UART); struct bflb_uart_config_s cfg; cfg.baudrate = 2000000; cfg.data_bits = UART_DATA_BITS_8; cfg.stop_bits = UART_STOP_BITS_1; cfg.parity = UART_PARITY_NONE; cfg.flow_ctrl = 0; cfg.tx_fifo_threshold = 7; cfg.rx_fifo_threshold = 7; bflb_uart_init(uartx, &cfg); bflb_uart_feature_control(uartx, UART_CMD_SET_AUTO_BAUD, 1); bflb_uart_feature_control(uartx, UART_CMD_SET_ABR_ALLOWABLE_ERROR, 3); bflb_irq_attach(uartx->irq_num, uart_isr, NULL); bflb_irq_enable(uartx->irq_num); while (1) { } }

#include "bflb_adc.h" #include "bflb_mtimer.h" #include "board.h" struct bflb_device_s adc; #define TEST_ADC_CHANNELS 2 #define TEST_COUNT 10 struct bflb_adc_channel_s chan[] = { { .pos_chan = ADC_CHANNEL_2, .neg_chan = ADC_CHANNEL_GND }, { .pos_chan = ADC_CHANNEL_GND, .neg_chan = ADC_CHANNEL_3 }, }; int main(void) { board_init(); board_adc_gpio_init(); adc = bflb_device_get_by_name("adc"); / adc clock = XCLK / 2 / 32 */ struct bflb_adc_config_s cfg; cfg.clk_div = ADC_CLK_DIV_32; cfg.scan_conv_mode = true; cfg.continuous_conv_mode = false; cfg.differential_mode = true; cfg.resolution = ADC_RESOLUTION_16B; cfg.vref = ADC_VREF_3P2V; bflb_adc_init(adc, &cfg); bflb_adc_channel_config(adc, chan, TEST_ADC_CHANNELS); for (uint32_t i = 0; i < TEST_COUNT; i++) { bflb_adc_start_conversion(adc); while (bflb_adc_get_count(adc) < TEST_ADC_CHANNELS) { bflb_mtimer_delay_ms(1); } for (size_t j = 0; j < TEST_ADC_CHANNELS; j++) { struct bflb_adc_result_s result; uint32_t raw_data = bflb_adc_read_raw(adc); printf("raw data:%08x\r\n", raw_data); bflb_adc_parse_result(adc, &raw_data, &result, 1); printf("pos chan %d,neg chan %d,%d mv \r\n", result.pos_chan, result.neg_chan, result.millivolt); } bflb_adc_stop_conversion(adc); bflb_mtimer_delay_ms(100); } while (1) { } }根据以上代码对bl618程序的编写对以下stm32中代码#include "stm32f10x.h" #include "delay.h" #include "FSR.h" #include "usart.h" #include "adc.h" #define PRESS_MIN 20 #define PRESS_MAX 6000 #define VOLTAGE_MIN 150 #define VOLTAGE_MAX 3300 u8 state = 0; u16 val = 0; u16 value_AD = 0; long PRESS_AO = 0; int VOLTAGE_AO = 0; long map(long x, long in_min, long in_max, long out_min, long out_max); int main(void) { delay_init(); NVIC_Configuration(); uart_init(9600); Adc_Init(); delay_ms(1000); printf("Test start\r\n"); while(1) { value_AD = Get_Adc_Average(1,10); VOLTAGE_AO = map(value_AD, 0, 4095, 0, 3300); if(VOLTAGE_AO < VOLTAGE_MIN) { PRESS_AO = 0; } else if(VOLTAGE_AO > VOLTAGE_MAX) { PRESS_AO = PRESS_MAX; } else { PRESS_AO = map(VOLTAGE_AO, VOLTAGE_MIN, VOLTAGE_MAX, PRESS_MIN, PRESS_MAX); } printf("ADÖµ = %d,µçѹ = %d mv,ѹÁ¦ = %ld g\r\n",value_AD,VOLTAGE_AO,PRESS_AO); delay_ms(500); } } long map(long x, long in_min, long in_max, long out_min, long out_max) { return (x - in_min) * (out_max - out_min) / (in_max - in_min) + out_min; }移植到bl618进行改写

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