Hierarchical SPEF (entities) definition
时间: 2024-02-24 15:57:00 浏览: 20
在 Hierarchical SPEF 中,可以使用实体(entities)来描述电路的层次结构。实体是一个包含多个端口的模块,可以包含其他实体和元件。每个实体都可以有自己的 SPEF 描述文件,以描述其端口和延迟特性。
下面是一个简单的例子,展示了如何使用实体来描述一个包含多个组件的电路:
```
* Entity definition for top-level circuit
entity top_circuit
ports
in1
in2
out1
end_ports
end_entity
* Entity definition for sub-circuit
entity sub_circuit
ports
in
out
end_ports
end_entity
* SPEF description for top-level circuit
* Includes the ports of top-level circuit and sub-circuit
* as well as the interconnect between them
* Delay values are not actual values
* They are used here for illustration purposes only
* Delay values should be extracted from the circuit's parasitic RC network
* using a tool such as SPEF extractor
*circuit delay table
* net_in1 0 in1
* net_in2 0 in2
* net_out1 out1 0
* net_in out 0
* net_out 0 out
sub_circuit net_in in 1p
net_in1 net_in 2p
net_in2 net_in 3p
net_out out 4p
net_out1 net_out 5p
```
在这个例子中,我们使用 `entity` 定义了两个实体:`top_circuit` 和 `sub_circuit`。`top_circuit` 包含三个端口:`in1`、`in2` 和 `out1`,而 `sub_circuit` 包含两个端口:`in` 和 `out`。在 `top_circuit` 的 SPEF 描述文件中,我们使用实体 `sub_circuit` 来描述了一个子电路,它包含一个名为 `net_in` 的端口和一个名为 `out` 的端口。我们还使用 `net_` 前缀来定义了不同的网络,并使用 `p` 来指定了延迟时间。
在实际的电路中,每个实体都可以有自己的 SPEF 描述文件,以描述其端口和延迟特性。然后,这些实体的 SPEF 描述文件可以组合在一起,以描述整个电路的延迟特性。
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