74LS74D触发器真值表

74LS74D是一种D触发器芯片，它有两个D触发器，每个触发器都有一个异步复位输入和一个时钟输入。这里是74LS74D的D触发器的真值表：

| D | CP | Q(n) | Q(n+1) |
|----|----|------|--------|
| 0 | ↑ | 0 | 0 |
| 0 | ↑ | 1 | 0 |
| 1 | ↑ | 0 | 1 |
| 1 | ↑ | 1 | 1 |

其中，D是数据输入，CP是时钟输入，Q(n)和Q(n+1)分别表示时钟前后的输出状态。当CP上升沿到来时，数据D的状态被存储在触发器中，同时输出Q(n)的状态也被复制到Q(n+1)中。

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74LS112jk触发器真值表

74LS112是一个双JK触发器芯片，其真值表如下：

| J | K | Q(t) | Q(t+1) |
|---|---|------|--------|
| 0 | 0 | Q(t) | Q(t) |
| 0 | 1 | Q(t) | 0 |
| 1 | 0 | Q(t) | 1 |
| 1 | 1 | Q(t) | ~Q(t) |

其中，J和K分别为输入端口，Q(t)为当前时刻的输出，Q(t+1)为下一时刻的输出。当J=0且K=0时，输出保持不变；当J=0且K=1时，输出为0；当J=1且K=0时，输出为1；当J=1且K=1时，输出为Q(t)的反相。

CC4013或74LS74 D触发器构成4位二进制异步加法计数真值表有加计数、输出、减计数的真值表怎么列

首先需要了解CC4013或74LS74 D触发器的工作原理，D触发器是一种具有存储功能的时序电路，其输出值取决于时钟信号和输入信号。D触发器有两个输入端，一个是数据输入端D，另一个是时钟输入端CLK。当时钟输入端CLK上升沿到来时，D触发器会将D端的数据存储到内部的锁存电路中，并输出到输出端Q上。

接下来，我们可以使用D触发器来构造4位二进制异步加法计数器。一个4位二进制计数器可以计数0~15，因此需要4个D触发器来实现。假设我们使用CC4013或74LS74 D触发器，其引脚分别为D、CLK、CLR、Q和/ Q。

对于4位二进制异步加法计数器，其真值表如下所示：

| 加计数 | 输出 | 减计数 | Q3 | Q2 | Q1 | Q0 |
|--------|------|--------|----|----|----|----|
| 0 | 0 | 0 | 0 | 0 | 0 | 0 |
| 0 | 1 | 1 | 0 | 0 | 0 | 1 |
| 1 | 2 | 0 | 0 | 0 | 1 | 0 |
| 1 | 3 | 1 | 0 | 0 | 1 | 1 |
| 0 | 4 | 0 | 0 | 1 | 0 | 0 |
| 0 | 5 | 1 | 0 | 1 | 0 | 1 |
| 1 | 6 | 0 | 0 | 1 | 1 | 0 |
| 1 | 7 | 1 | 0 | 1 | 1 | 1 |
| 0 | 8 | 0 | 1 | 0 | 0 | 0 |
| 0 | 9 | 1 | 1 | 0 | 0 | 1 |
| 1 | 10 | 0 | 1 | 0 | 1 | 0 |
| 1 | 11 | 1 | 1 | 0 | 1 | 1 |
| 0 | 12 | 0 | 1 | 1 | 0 | 0 |
| 0 | 13 | 1 | 1 | 1 | 0 | 1 |
| 1 | 14 | 0 | 1 | 1 | 1 | 0 |
| 1 | 15 | 1 | 1 | 1 | 1 | 1 |

其中，加计数为1表示计数器进行加法计数，加1；加计数为0时，计数器保持不变。减计数为1表示计数器进行减法计数，减1；减计数为0时，计数器保持不变。输出为计数器当前的计数值。

在真值表中，Q3~Q0分别表示计数器的四个位。例如，当计数器的当前计数值为9时，Q3=1，Q2=0，Q1=0，Q0=1。

需要注意的是，由于是异步计数器，因此在加计数和减计数同时为1时，计数器会先进行加法计数，然后再进行减法计数。因此，在设计电路时需要考虑这种情况。