ISE14.7如何查看RTL

在ISE14.7中，查看RTL（Register Transfer Level）可以通过以下步骤实现：

1. 打开ISE软件，并打开你要查看RTL的工程。

2. 在左侧的"Sources"面板中，找到并双击你要查看RTL的源文件。

3. 在弹出的编辑器中，点击菜单栏中的"Tools"，然后选择"Generate RTL Schematic"。

4. 在弹出的"Generate RTL Schematic"对话框中，选择你要查看的模块，然后点击"OK"按钮。

5. 生成完成后，在左侧的"Design"面板中，找到并展开"Synthesized Design"，然后双击你要查看RTL的模块。

6. 在弹出的"RTL Viewer"中，即可查看RTL的电路图。

总之，通过以上步骤，在ISE14.7中就可以方便地查看RTL。需要注意的是，在生成RTL时，需要保证源文件已经完成了综合和实现。

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ISE14.7如何查看RLT

在ISE14.7中，查看RLT（Result Logical Table）可以通过以下步骤实现：

1. 打开ISE软件，并打开你要查看RLT的工程。

2. 在左侧的"Processes"面板中，找到并展开"Implement Design"，然后双击"Generate Post-Implementation Simulation Model"。

3. 在弹出的"Generate Post-Implementation Simulation Model"对话框中，选择"Generate RTL View and Post-Map Simulation Model"，并勾选"View RTL schematic"和"Write RLT file"。

4. 点击"OK"按钮，开始生成RTL视图和RLT文件。

5. 生成完成后，在左侧的"Design"面板中，找到并展开"Simulation Sources"，然后双击你要查看RLT的源文件。

6. 在弹出的编辑器中，点击菜单栏中的"Simulate"，然后选择"Behavioral Simulation (Post-Map)"。

7. 在弹出的"ISim Simulator"对话框中，选择"View RLT"选项卡，即可查看并分析RLT。

总之，通过以上步骤，在ISE14.7中就可以方便地查看RLT。需要注意的是，在生成RLT时，需要选择"Write RLT file"选项，才能在后续的仿真中查看RLT。