电子科技大学数字逻辑综合实验：实验1-中小规模组合逻辑设计.pdf

1．逻辑输入采用实验箱的K1-K11，逻辑输出接L1-L10。测试实验箱上的HD74LS04P（非门）、SN74LS32N（或门）、SN74LS00N（与非门）、SN74HC86N（异或门）、SN74HC153（数据选择器、多路复用器）的逻辑功能。 2．采用小规模逻辑器件设计一位数据比较器：设一位数据比较器的输入为A、B，比较A>B，A=B，A<B，输出三个比较结果，输出采用低电平有效。 3．分别用小规模和中规模逻辑器件设计3输入多数表决器：设输入为A、B、C，当三个输入有两个或两个以上同意时，输出结果为同意，输入、输出的同意均为高电平有效。 4. 拓展内容（选做）设计一个4位二进制数检测电路，当对应的十进制数为3、7、大于等于11（十进制）时，输出1，否则输出0。尝试只使用与非门实现该逻辑电路。尝试使用4选1数据选择器和其它逻辑门实现该逻辑电路。